/* * dsi_regs.h: dsi register definitions. * * Copyright (c) 2011-2017, NVIDIA CORPORATION, All rights reserved. * * This software is licensed under the terms of the GNU General Public * License version 2, as published by the Free Software Foundation, and * may be copied, distributed, and modified under those terms. * * This program is distributed in the hope that it will be useful, * but WITHOUT ANY WARRANTY; without even the implied warranty of * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the * GNU General Public License for more details. * */ #ifndef __DRIVERS_VIDEO_TEGRA_DC_DSI_REG_H__ #define __DRIVERS_VIDEO_TEGRA_DC_DSI_REG_H__ enum { TEGRA_DSI_PAD_ENABLE, TEGRA_DSI_PAD_DISABLE, }; /* These are word offsets from base (not byte offsets) */ enum { OP_DONE = 1, }; #define DSI_SYNCPT_INDX_FIELD_SIZE 8 #define DSI_SYNCPT_INDX_FIELD_SIZE_NVDISPLAY 10 #define DSI_INCR_SYNCPT 0x00 /* DSI_INCR_SYNCPT_COND for * T21x - (((x) & 0xff) << 8) * Nvdisplay - (((x) & 0xff) << 10) */ #define DSI_INCR_SYNCPT_COND(x, y) (((x) & 0xff) << y) /* DSI_INCR_SYNCPT_INDX for * T21x - (((x) & 0xff) << 0) * Nvdisplay - (((x) & 0x3ff) << 0) */ #define DSI_INCR_SYNCPT_INDX(x, y) (((x) & ((1 << (y)) - 1)) << 0) #define DSI_INCR_SYNCPT_CNTRL 0x01 #define DSI_INCR_SYNCPT_ERROR 0x02 #define DSI_CTXSW 0x08 #define DSI_RD_DATA 0x09 #define DSI_WR_DATA 0x0a #define DSI_POWER_CONTROL 0x0b #define DSI_POWER_CONTROL_LEG_DSI_ENABLE(x) (((x) & 0x1) << 0) #define DSI_INT_ENABLE 0x0c #define DSI_INT_STATUS 0x0d #define DSI_INT_MASK 0x0e #define DSI_HOST_DSI_CONTROL 0x0f enum { RESET_CRC = 1, }; #define DSI_HOST_CONTROL_FIFO_STAT_RESET(x) (((x) & 0x1) << 21) #define DSI_HOST_DSI_CONTROL_CRC_RESET(x) (((x) & 0x1) << 20) enum { DSI_PHY_CLK_DIV1, DSI_PHY_CLK_DIV2, }; #define DSI_HOST_DSI_CONTROL_PHY_CLK_DIV(x) (((x) & 0x7) << 16) enum { SOL, FIFO_LEVEL, IMMEDIATE, }; #define DSI_HOST_DSI_CONTROL_HOST_TX_TRIG_SRC(x) (((x) & 0x3) << 12) enum { NORMAL, ENTER_ULPM, EXIT_ULPM, }; #define DSI_HOST_DSI_CONTROL_ULTRA_LOW_POWER(x) (((x) & 0x3) << 8) #define DSI_HOST_DSI_CONTROL_PERIPH_RESET(x) (((x) & 0x1) << 7) #define DSI_HOST_DSI_CONTROL_RAW_DATA(x) (((x) & 0x1) << 6) enum { TEGRA_DSI_LOW, TEGRA_DSI_HIGH, }; #define DSI_HOST_DSI_CONTROL_HIGH_SPEED_TRANS(x) (((x) & 0x1) << 5) enum { HOST_ONLY, VIDEO_HOST, }; #define DSI_HOST_DSI_CONTROL_PKT_WR_FIFO_SEL(x) (((x) & 0x1) << 4) #define DSI_HOST_DSI_CONTROL_IMM_BTA(x) (((x) & 0x1) << 3) #define DSI_HOST_DSI_CONTROL_PKT_BTA(x) (((x) & 0x1) << 2) #define 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