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tegrakernel/kernel/nvidia/drivers/net/ethernet/realtek/r8168_n.c

28391 lines
1.0 MiB
Raw Permalink Blame History

/*
################################################################################
#
# r8168 is the Linux device driver released for Realtek Gigabit Ethernet
# controllers with PCI-Express interface.
#
# Copyright(c) 2017-2018 Realtek Semiconductor Corp. All rights reserved.
#
# This program is free software; you can redistribute it and/or modify it
# under the terms of the GNU General Public License as published by the Free
# Software Foundation; either version 2 of the License, or (at your option)
# any later version.
#
# This program is distributed in the hope that it will be useful, but WITHOUT
# ANY WARRANTY; without even the implied warranty of MERCHANTABILITY or
# FITNESS FOR A PARTICULAR PURPOSE. See the GNU General Public License for
# more details.
#
# You should have received a copy of the GNU General Public License along with
# this program; if not, see <http://www.gnu.org/licenses/>.
#
# Author:
# Realtek NIC software team <nicfae@realtek.com>
# No. 2, Innovation Road II, Hsinchu Science Park, Hsinchu 300, Taiwan
#
################################################################################
*/
/************************************************************************************
* This product is covered by one or more of the following patents:
* US6,570,884, US6,115,776, and US6,327,625.
***********************************************************************************/
/*
* This driver is modified from r8169.c in Linux kernel 2.6.18
*/
#include <linux/kernel.h>
#include <linux/module.h>
#include <linux/version.h>
#include <linux/pci.h>
#include <linux/netdevice.h>
#include <linux/etherdevice.h>
#include <linux/delay.h>
#include <linux/mii.h>
#include <linux/if_vlan.h>
#include <linux/crc32.h>
#include <linux/interrupt.h>
#include <linux/in.h>
#include <linux/ip.h>
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,22)
#include <linux/ipv6.h>
#include <net/ip6_checksum.h>
#endif
#include <linux/tcp.h>
#include <linux/init.h>
#include <linux/rtnetlink.h>
#include <linux/completion.h>
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,26)
#include <linux/pci-aspm.h>
#endif
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,4,37)
#include <linux/prefetch.h>
#endif
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,0)
#define dev_printk(A,B,fmt,args...) printk(A fmt,##args)
#else
#include <linux/dma-mapping.h>
#include <linux/moduleparam.h>
#endif
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,31)
#include <linux/mdio.h>
#endif
#include <asm/io.h>
#include <asm/irq.h>
#include "r8168.h"
#include "r8168_asf.h"
#include "rtl_eeprom.h"
#include "rtltool.h"
#ifdef ENABLE_R8168_PROCFS
#include <linux/proc_fs.h>
#include <linux/seq_file.h>
#endif
/* Maximum number of multicast addresses to filter (vs. Rx-all-multicast).
The RTL chips use a 64 element hash table based on the Ethernet CRC. */
static const int multicast_filter_limit = 32;
#define _R(NAME,MAC,RCR,MASK, JumFrameSz) \
{ .name = NAME, .mcfg = MAC, .RCR_Cfg = RCR, .RxConfigMask = MASK, .jumbo_frame_sz = JumFrameSz }
static const struct {
const char *name;
u8 mcfg;
u32 RCR_Cfg;
u32 RxConfigMask; /* Clears the bits supported by this chip */
u32 jumbo_frame_sz;
} rtl_chip_info[] = {
_R("RTL8168B/8111B",
CFG_METHOD_1,
(Reserved2_data << Reserved2_shift) | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_4k),
_R("RTL8168B/8111B",
CFG_METHOD_2,
(Reserved2_data << Reserved2_shift) | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_4k),
_R("RTL8168B/8111B",
CFG_METHOD_3,
(Reserved2_data << Reserved2_shift) | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_4k),
_R("RTL8168C/8111C",
CFG_METHOD_4,
RxCfg_128_int_en | RxCfg_fet_multi_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_6k),
_R("RTL8168C/8111C",
CFG_METHOD_5,
RxCfg_128_int_en | RxCfg_fet_multi_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_6k),
_R("RTL8168C/8111C",
CFG_METHOD_6,
RxCfg_128_int_en | RxCfg_fet_multi_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_6k),
_R("RTL8168CP/8111CP",
CFG_METHOD_7,
RxCfg_128_int_en | RxCfg_fet_multi_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_6k),
_R("RTL8168CP/8111CP",
CFG_METHOD_8,
RxCfg_128_int_en | RxCfg_fet_multi_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_6k),
_R("RTL8168D/8111D",
CFG_METHOD_9,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168D/8111D",
CFG_METHOD_10,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168DP/8111DP",
CFG_METHOD_11,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168DP/8111DP",
CFG_METHOD_12,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168DP/8111DP",
CFG_METHOD_13,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168E/8111E",
CFG_METHOD_14,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168E/8111E",
CFG_METHOD_15,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168E-VL/8111E-VL",
CFG_METHOD_16,
RxCfg_128_int_en | RxEarly_off_V1 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e0080,
Jumbo_Frame_9k),
_R("RTL8168E-VL/8111E-VL",
CFG_METHOD_17,
RxCfg_128_int_en | RxEarly_off_V1 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168F/8111F",
CFG_METHOD_18,
RxCfg_128_int_en | RxEarly_off_V1 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168F/8111F",
CFG_METHOD_19,
RxCfg_128_int_en | RxEarly_off_V1 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8411",
CFG_METHOD_20,
RxCfg_128_int_en | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e1880,
Jumbo_Frame_9k),
_R("RTL8168G/8111G",
CFG_METHOD_21,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168G/8111G",
CFG_METHOD_22,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168EP/8111EP",
CFG_METHOD_23,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168GU/8111GU",
CFG_METHOD_24,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168GU/8111GU",
CFG_METHOD_25,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("8411B",
CFG_METHOD_26,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168EP/8111EP",
CFG_METHOD_27,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168EP/8111EP",
CFG_METHOD_28,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168H/8111H",
CFG_METHOD_29,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168H/8111H",
CFG_METHOD_30,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168FP/8111FP",
CFG_METHOD_31,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("RTL8168FP/8111FP",
CFG_METHOD_32,
RxCfg_128_int_en | RxEarly_off_V2 | Rx_Single_fetch_V2 | (RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_9k),
_R("Unknown",
CFG_METHOD_DEFAULT,
(RX_DMA_BURST << RxCfgDMAShift),
0xff7e5880,
Jumbo_Frame_1k)
};
#undef _R
#ifndef PCI_VENDOR_ID_DLINK
#define PCI_VENDOR_ID_DLINK 0x1186
#endif
static struct pci_device_id rtl8168_pci_tbl[] = {
{ PCI_DEVICE(PCI_VENDOR_ID_REALTEK, 0x8168), },
{ PCI_DEVICE(PCI_VENDOR_ID_REALTEK, 0x8161), },
{ PCI_VENDOR_ID_DLINK, 0x4300, 0x1186, 0x4b10,},
{0,},
};
MODULE_DEVICE_TABLE(pci, rtl8168_pci_tbl);
static int rx_copybreak = 0;
static int use_dac = 1;
static int timer_count = 0x2600;
static struct {
u32 msg_enable;
} debug = { -1 };
static unsigned int speed_mode = SPEED_1000;
static unsigned int duplex_mode = DUPLEX_FULL;
static unsigned int autoneg_mode = AUTONEG_ENABLE;
#ifdef CONFIG_ASPM
static int aspm = 1;
#else
static int aspm = 0;
#endif
#ifdef ENABLE_S5WOL
static int s5wol = 1;
#else
static int s5wol = 0;
#endif
#ifdef ENABLE_S5_KEEP_CURR_MAC
static int s5_keep_curr_mac = 1;
#else
static int s5_keep_curr_mac = 0;
#endif
#ifdef ENABLE_EEE
static int eee_enable = 1;
#else
static int eee_enable = 0;
#endif
#ifdef CONFIG_SOC_LAN
static ulong hwoptimize = HW_PATCH_SOC_LAN;
#else
static ulong hwoptimize = 0;
#endif
#ifdef ENABLE_S0_MAGIC_PACKET
static int s0_magic_packet = 1;
#else
static int s0_magic_packet = 0;
#endif
MODULE_AUTHOR("Realtek and the Linux r8168 crew <netdev@vger.kernel.org>");
MODULE_DESCRIPTION("RealTek RTL-8168 Gigabit Ethernet driver");
module_param(speed_mode, uint, 0);
MODULE_PARM_DESC(speed_mode, "force phy operation. Deprecated by ethtool (8).");
module_param(duplex_mode, uint, 0);
MODULE_PARM_DESC(duplex_mode, "force phy operation. Deprecated by ethtool (8).");
module_param(autoneg_mode, uint, 0);
MODULE_PARM_DESC(autoneg_mode, "force phy operation. Deprecated by ethtool (8).");
module_param(aspm, int, 0);
MODULE_PARM_DESC(aspm, "Enable ASPM.");
module_param(s5wol, int, 0);
MODULE_PARM_DESC(s5wol, "Enable Shutdown Wake On Lan.");
module_param(s5_keep_curr_mac, int, 0);
MODULE_PARM_DESC(s5_keep_curr_mac, "Enable Shutdown Keep Current MAC Address.");
module_param(rx_copybreak, int, 0);
MODULE_PARM_DESC(rx_copybreak, "Copy breakpoint for copy-only-tiny-frames");
module_param(use_dac, int, 0);
MODULE_PARM_DESC(use_dac, "Enable PCI DAC. Unsafe on 32 bit PCI slot.");
module_param(timer_count, int, 0);
MODULE_PARM_DESC(timer_count, "Timer Interrupt Interval.");
module_param(eee_enable, int, 0);
MODULE_PARM_DESC(eee_enable, "Enable Energy Efficient Ethernet.");
module_param(hwoptimize, ulong, 0);
MODULE_PARM_DESC(hwoptimize, "Enable HW optimization function.");
module_param(s0_magic_packet, int, 0);
MODULE_PARM_DESC(s0_magic_packet, "Enable S0 Magic Packet.");
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
module_param_named(debug, debug.msg_enable, int, 0);
MODULE_PARM_DESC(debug, "Debug verbosity level (0=none, ..., 16=all)");
#endif//LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
MODULE_LICENSE("GPL");
MODULE_VERSION(RTL8168_VERSION);
static void rtl8168_sleep_rx_enable(struct net_device *dev);
static void rtl8168_dsm(struct net_device *dev, int dev_state);
static void rtl8168_esd_timer(unsigned long __opaque);
static void rtl8168_link_timer(unsigned long __opaque);
static void rtl8168_tx_clear(struct rtl8168_private *tp);
static void rtl8168_rx_clear(struct rtl8168_private *tp);
static int rtl8168_open(struct net_device *dev);
static int rtl8168_start_xmit(struct sk_buff *skb, struct net_device *dev);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,19)
static irqreturn_t rtl8168_interrupt(int irq, void *dev_instance, struct pt_regs *regs);
#else
static irqreturn_t rtl8168_interrupt(int irq, void *dev_instance);
#endif
static void rtl8168_rx_desc_offset0_init(struct rtl8168_private *, int);
static int rtl8168_init_ring(struct net_device *dev);
static void rtl8168_hw_config(struct net_device *dev);
static void rtl8168_hw_start(struct net_device *dev);
static int rtl8168_close(struct net_device *dev);
static void rtl8168_set_rx_mode(struct net_device *dev);
static void rtl8168_tx_timeout(struct net_device *dev);
static struct net_device_stats *rtl8168_get_stats(struct net_device *dev);
static int rtl8168_rx_interrupt(struct net_device *, struct rtl8168_private *, void __iomem *, napi_budget);
static int rtl8168_change_mtu(struct net_device *dev, int new_mtu);
static void rtl8168_down(struct net_device *dev);
static int rtl8168_set_mac_address(struct net_device *dev, void *p);
void rtl8168_rar_set(struct rtl8168_private *tp, uint8_t *addr);
static void rtl8168_desc_addr_fill(struct rtl8168_private *);
static void rtl8168_tx_desc_init(struct rtl8168_private *tp);
static void rtl8168_rx_desc_init(struct rtl8168_private *tp);
static void rtl8168_hw_reset(struct net_device *dev);
static void rtl8168_phy_power_up(struct net_device *dev);
static void rtl8168_phy_power_down(struct net_device *dev);
static int rtl8168_set_speed(struct net_device *dev, u8 autoneg, u32 speed, u8 duplex);
#ifdef CONFIG_R8168_NAPI
static int rtl8168_poll(napi_ptr napi, napi_budget budget);
#endif
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,0)
#undef ethtool_ops
#define ethtool_ops _kc_ethtool_ops
struct _kc_ethtool_ops {
int (*get_settings)(struct net_device *, struct ethtool_cmd *);
int (*set_settings)(struct net_device *, struct ethtool_cmd *);
void (*get_drvinfo)(struct net_device *, struct ethtool_drvinfo *);
int (*get_regs_len)(struct net_device *);
void (*get_regs)(struct net_device *, struct ethtool_regs *, void *);
void (*get_wol)(struct net_device *, struct ethtool_wolinfo *);
int (*set_wol)(struct net_device *, struct ethtool_wolinfo *);
u32 (*get_msglevel)(struct net_device *);
void (*set_msglevel)(struct net_device *, u32);
int (*nway_reset)(struct net_device *);
u32 (*get_link)(struct net_device *);
int (*get_eeprom_len)(struct net_device *);
int (*get_eeprom)(struct net_device *, struct ethtool_eeprom *, u8 *);
int (*set_eeprom)(struct net_device *, struct ethtool_eeprom *, u8 *);
int (*get_coalesce)(struct net_device *, struct ethtool_coalesce *);
int (*set_coalesce)(struct net_device *, struct ethtool_coalesce *);
void (*get_ringparam)(struct net_device *, struct ethtool_ringparam *);
int (*set_ringparam)(struct net_device *, struct ethtool_ringparam *);
void (*get_pauseparam)(struct net_device *,
struct ethtool_pauseparam*);
int (*set_pauseparam)(struct net_device *,
struct ethtool_pauseparam*);
u32 (*get_rx_csum)(struct net_device *);
int (*set_rx_csum)(struct net_device *, u32);
u32 (*get_tx_csum)(struct net_device *);
int (*set_tx_csum)(struct net_device *, u32);
u32 (*get_sg)(struct net_device *);
int (*set_sg)(struct net_device *, u32);
u32 (*get_tso)(struct net_device *);
int (*set_tso)(struct net_device *, u32);
int (*self_test_count)(struct net_device *);
void (*self_test)(struct net_device *, struct ethtool_test *, u64 *);
void (*get_strings)(struct net_device *, u32 stringset, u8 *);
int (*phys_id)(struct net_device *, u32);
int (*get_stats_count)(struct net_device *);
void (*get_ethtool_stats)(struct net_device *, struct ethtool_stats *,
u64 *);
} *ethtool_ops = NULL;
#undef SET_ETHTOOL_OPS
#define SET_ETHTOOL_OPS(netdev, ops) (ethtool_ops = (ops))
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,0)
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,16,0)
#ifndef SET_ETHTOOL_OPS
#define SET_ETHTOOL_OPS(netdev,ops) \
( (netdev)->ethtool_ops = (ops) )
#endif //SET_ETHTOOL_OPS
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(3,16,0)
//#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,5)
#ifndef netif_msg_init
#define netif_msg_init _kc_netif_msg_init
/* copied from linux kernel 2.6.20 include/linux/netdevice.h */
static inline u32 netif_msg_init(int debug_value, int default_msg_enable_bits)
{
/* use default */
if (debug_value < 0 || debug_value >= (sizeof(u32) * 8))
return default_msg_enable_bits;
if (debug_value == 0) /* no output */
return 0;
/* set low N bits */
return (1 << debug_value) - 1;
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,5)
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,22)
static inline void eth_copy_and_sum (struct sk_buff *dest,
const unsigned char *src,
int len, int base)
{
memcpy (dest->data, src, len);
}
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,22)
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,7)
/* copied from linux kernel 2.6.20 /include/linux/time.h */
/* Parameters used to convert the timespec values: */
#define MSEC_PER_SEC 1000L
/* copied from linux kernel 2.6.20 /include/linux/jiffies.h */
/*
* Change timeval to jiffies, trying to avoid the
* most obvious overflows..
*
* And some not so obvious.
*
* Note that we don't want to return MAX_LONG, because
* for various timeout reasons we often end up having
* to wait "jiffies+1" in order to guarantee that we wait
* at _least_ "jiffies" - so "jiffies+1" had better still
* be positive.
*/
#define MAX_JIFFY_OFFSET ((~0UL >> 1)-1)
/*
* Convert jiffies to milliseconds and back.
*
* Avoid unnecessary multiplications/divisions in the
* two most common HZ cases:
*/
static inline unsigned int _kc_jiffies_to_msecs(const unsigned long j)
{
#if HZ <= MSEC_PER_SEC && !(MSEC_PER_SEC % HZ)
return (MSEC_PER_SEC / HZ) * j;
#elif HZ > MSEC_PER_SEC && !(HZ % MSEC_PER_SEC)
return (j + (HZ / MSEC_PER_SEC) - 1)/(HZ / MSEC_PER_SEC);
#else
return (j * MSEC_PER_SEC) / HZ;
#endif
}
static inline unsigned long _kc_msecs_to_jiffies(const unsigned int m)
{
if (m > _kc_jiffies_to_msecs(MAX_JIFFY_OFFSET))
return MAX_JIFFY_OFFSET;
#if HZ <= MSEC_PER_SEC && !(MSEC_PER_SEC % HZ)
return (m + (MSEC_PER_SEC / HZ) - 1) / (MSEC_PER_SEC / HZ);
#elif HZ > MSEC_PER_SEC && !(HZ % MSEC_PER_SEC)
return m * (HZ / MSEC_PER_SEC);
#else
return (m * HZ + MSEC_PER_SEC - 1) / MSEC_PER_SEC;
#endif
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,7)
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,11)
/* copied from linux kernel 2.6.12.6 /include/linux/pm.h */
typedef int __bitwise pci_power_t;
/* copied from linux kernel 2.6.12.6 /include/linux/pci.h */
typedef u32 __bitwise pm_message_t;
#define PCI_D0 ((pci_power_t __force) 0)
#define PCI_D1 ((pci_power_t __force) 1)
#define PCI_D2 ((pci_power_t __force) 2)
#define PCI_D3hot ((pci_power_t __force) 3)
#define PCI_D3cold ((pci_power_t __force) 4)
#define PCI_POWER_ERROR ((pci_power_t __force) -1)
/* copied from linux kernel 2.6.12.6 /drivers/pci/pci.c */
/**
* pci_choose_state - Choose the power state of a PCI device
* @dev: PCI device to be suspended
* @state: target sleep state for the whole system. This is the value
* that is passed to suspend() function.
*
* Returns PCI power state suitable for given device and given system
* message.
*/
pci_power_t pci_choose_state(struct pci_dev *dev, pm_message_t state)
{
if (!pci_find_capability(dev, PCI_CAP_ID_PM))
return PCI_D0;
switch (state) {
case 0:
return PCI_D0;
case 3:
return PCI_D3hot;
default:
printk("They asked me for state %d\n", state);
// BUG();
}
return PCI_D0;
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,11)
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,9)
/**
* msleep_interruptible - sleep waiting for waitqueue interruptions
* @msecs: Time in milliseconds to sleep for
*/
#define msleep_interruptible _kc_msleep_interruptible
unsigned long _kc_msleep_interruptible(unsigned int msecs)
{
unsigned long timeout = _kc_msecs_to_jiffies(msecs);
while (timeout && !signal_pending(current)) {
set_current_state(TASK_INTERRUPTIBLE);
timeout = schedule_timeout(timeout);
}
return _kc_jiffies_to_msecs(timeout);
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,9)
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,7)
/* copied from linux kernel 2.6.20 include/linux/sched.h */
#ifndef __sched
#define __sched __attribute__((__section__(".sched.text")))
#endif
/* copied from linux kernel 2.6.20 kernel/timer.c */
signed long __sched schedule_timeout_uninterruptible(signed long timeout)
{
__set_current_state(TASK_UNINTERRUPTIBLE);
return schedule_timeout(timeout);
}
/* copied from linux kernel 2.6.20 include/linux/mii.h */
#undef if_mii
#define if_mii _kc_if_mii
static inline struct mii_ioctl_data *if_mii(struct ifreq *rq)
{
return (struct mii_ioctl_data *) &rq->ifr_ifru;
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,7)
struct rtl8168_counters {
u64 tx_packets;
u64 rx_packets;
u64 tx_errors;
u32 rx_errors;
u16 rx_missed;
u16 align_errors;
u32 tx_one_collision;
u32 tx_multi_collision;
u64 rx_unicast;
u64 rx_broadcast;
u32 rx_multicast;
u16 tx_aborted;
u16 tx_underun;
};
/* SysFS node */
static int power_saver_flag;
static struct kobject *rt8168_ps_kobj;
static ssize_t show_power_saver(struct kobject *dev,
struct kobj_attribute *attr, char *buf) {
ssize_t ret;
ret = snprintf(buf, PAGE_SIZE, "%u\n", power_saver_flag);
return ret;
}
static ssize_t set_power_saver(struct kobject *dev,
struct kobj_attribute *attr, const char *buf, size_t count) {
sscanf(buf, "%d", &power_saver_flag);
if (!power_saver_flag) {
pr_debug("rt8168_power mode is set to big spender");
aspm = 0;
s5wol = 0;
eee_enable = 0;
} else {
pr_debug("rt8168_power mode is set to no waste");
#ifdef CONFIG_R8168_ASPM
aspm = 1;
#else
aspm = 0;
#endif
#ifdef CONFIG_R8168_S5WOL
s5wol = 1;
#else
s5wol = 0;
#endif
#ifdef ENABLE_EEE
eee_enable = 1;
#else
eee_enable = 0;
#endif
}
return count;
}
static const struct kobj_attribute rt8168_psaver_attr[] = {
__ATTR(mode, S_IRUGO | S_IWUSR | S_IWGRP, show_power_saver, set_power_saver),
};
static int rtl8168_sysfs_register(void)
{
int ret, i;
if (!kernel_kobj) {
pr_err("kernel_kobj is NULL\n");
return -1;
}
rt8168_ps_kobj = kobject_create_and_add("rt8168_power", kernel_kobj);
if (!rt8168_ps_kobj) {
pr_err("unable to create rt8168_power_saver kernel object!\n");
return -1;
}
for (i = 0; i < ARRAY_SIZE(rt8168_psaver_attr); i++) {
ret = sysfs_create_file(rt8168_ps_kobj,
&rt8168_psaver_attr[i].attr);
if (ret)
pr_err("failed to create %s\n",
rt8168_psaver_attr[i].attr.name);
}
return ret;
}
static int rtl8168_sysfs_remove(void)
{
int i;
if (!rt8168_ps_kobj)
return -1;
for (i = 0; i < ARRAY_SIZE(rt8168_psaver_attr); i++)
sysfs_remove_file(rt8168_ps_kobj, &rt8168_psaver_attr[i].attr);
kobject_put(rt8168_ps_kobj);
return 0;
}
#ifdef ENABLE_R8168_PROCFS
/****************************************************************************
* -----------------------------PROCFS STUFF-------------------------
*****************************************************************************
*/
static struct proc_dir_entry *rtl8168_proc;
static int proc_init_num = 0;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
static int proc_get_driver_variable(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
seq_puts(m, "\nDump Driver Variable\n");
spin_lock_irqsave(&tp->lock, flags);
seq_puts(m, "Variable\tValue\n----------\t-----\n");
seq_printf(m, "MODULENAME\t%s\n", MODULENAME);
seq_printf(m, "driver version\t%s\n", RTL8168_VERSION);
seq_printf(m, "chipset\t%d\n", tp->chipset);
seq_printf(m, "chipset_name\t%s\n", rtl_chip_info[tp->chipset].name);
seq_printf(m, "mtu\t%d\n", dev->mtu);
seq_printf(m, "NUM_RX_DESC\t0x%x\n", NUM_RX_DESC);
seq_printf(m, "cur_rx\t0x%x\n", tp->cur_rx);
seq_printf(m, "dirty_rx\t0x%x\n", tp->dirty_rx);
seq_printf(m, "NUM_TX_DESC\t0x%x\n", NUM_TX_DESC);
seq_printf(m, "cur_tx\t0x%x\n", tp->cur_tx);
seq_printf(m, "dirty_tx\t0x%x\n", tp->dirty_tx);
seq_printf(m, "rx_buf_sz\t0x%x\n", tp->rx_buf_sz);
seq_printf(m, "esd_flag\t0x%x\n", tp->esd_flag);
seq_printf(m, "pci_cfg_is_read\t0x%x\n", tp->pci_cfg_is_read);
seq_printf(m, "rtl8168_rx_config\t0x%x\n", tp->rtl8168_rx_config);
seq_printf(m, "cp_cmd\t0x%x\n", tp->cp_cmd);
seq_printf(m, "intr_mask\t0x%x\n", tp->intr_mask);
seq_printf(m, "timer_intr_mask\t0x%x\n", tp->timer_intr_mask);
seq_printf(m, "wol_enabled\t0x%x\n", tp->wol_enabled);
seq_printf(m, "wol_opts\t0x%x\n", tp->wol_opts);
seq_printf(m, "efuse_ver\t0x%x\n", tp->efuse_ver);
seq_printf(m, "eeprom_type\t0x%x\n", tp->eeprom_type);
seq_printf(m, "autoneg\t0x%x\n", tp->autoneg);
seq_printf(m, "duplex\t0x%x\n", tp->duplex);
seq_printf(m, "speed\t%d\n", tp->speed);
seq_printf(m, "eeprom_len\t0x%x\n", tp->eeprom_len);
seq_printf(m, "cur_page\t0x%x\n", tp->cur_page);
seq_printf(m, "bios_setting\t0x%x\n", tp->bios_setting);
seq_printf(m, "features\t0x%x\n", tp->features);
seq_printf(m, "org_pci_offset_99\t0x%x\n", tp->org_pci_offset_99);
seq_printf(m, "org_pci_offset_180\t0x%x\n", tp->org_pci_offset_180);
seq_printf(m, "issue_offset_99_event\t0x%x\n", tp->issue_offset_99_event);
seq_printf(m, "org_pci_offset_80\t0x%x\n", tp->org_pci_offset_80);
seq_printf(m, "org_pci_offset_81\t0x%x\n", tp->org_pci_offset_81);
seq_printf(m, "use_timer_interrrupt\t0x%x\n", tp->use_timer_interrrupt);
seq_printf(m, "HwIcVerUnknown\t0x%x\n", tp->HwIcVerUnknown);
seq_printf(m, "NotWrRamCodeToMicroP\t0x%x\n", tp->NotWrRamCodeToMicroP);
seq_printf(m, "NotWrMcuPatchCode\t0x%x\n", tp->NotWrMcuPatchCode);
seq_printf(m, "HwHasWrRamCodeToMicroP\t0x%x\n", tp->HwHasWrRamCodeToMicroP);
seq_printf(m, "sw_ram_code_ver\t0x%x\n", tp->sw_ram_code_ver);
seq_printf(m, "hw_ram_code_ver\t0x%x\n", tp->hw_ram_code_ver);
seq_printf(m, "rtk_enable_diag\t0x%x\n", tp->rtk_enable_diag);
seq_printf(m, "ShortPacketSwChecksum\t0x%x\n", tp->ShortPacketSwChecksum);
seq_printf(m, "UseSwPaddingShortPkt\t0x%x\n", tp->UseSwPaddingShortPkt);
seq_printf(m, "RequireAdcBiasPatch\t0x%x\n", tp->RequireAdcBiasPatch);
seq_printf(m, "AdcBiasPatchIoffset\t0x%x\n", tp->AdcBiasPatchIoffset);
seq_printf(m, "RequireAdjustUpsTxLinkPulseTiming\t0x%x\n", tp->RequireAdjustUpsTxLinkPulseTiming);
seq_printf(m, "SwrCnt1msIni\t0x%x\n", tp->SwrCnt1msIni);
seq_printf(m, "HwSuppNowIsOobVer\t0x%x\n", tp->HwSuppNowIsOobVer);
seq_printf(m, "HwFiberModeVer\t0x%x\n", tp->HwFiberModeVer);
seq_printf(m, "RequiredSecLanDonglePatch\t0x%x\n", tp->RequiredSecLanDonglePatch);
seq_printf(m, "HwSuppDashVer\t0x%x\n", tp->HwSuppDashVer);
seq_printf(m, "DASH\t0x%x\n", tp->DASH);
seq_printf(m, "dash_printer_enabled\t0x%x\n", tp->dash_printer_enabled);
seq_printf(m, "HwSuppKCPOffloadVer\t0x%x\n", tp->HwSuppKCPOffloadVer);
seq_printf(m, "speed_mode\t0x%x\n", speed_mode);
seq_printf(m, "duplex_mode\t0x%x\n", duplex_mode);
seq_printf(m, "autoneg_mode\t0x%x\n", autoneg_mode);
seq_printf(m, "aspm\t0x%x\n", aspm);
seq_printf(m, "s5wol\t0x%x\n", s5wol);
seq_printf(m, "s5_keep_curr_mac\t0x%x\n", s5_keep_curr_mac);
seq_printf(m, "eee_enable\t0x%x\n", eee_enable);
seq_printf(m, "hwoptimize\t0x%lx\n", hwoptimize);
seq_printf(m, "proc_init_num\t0x%x\n", proc_init_num);
seq_printf(m, "s0_magic_packet\t0x%x\n", s0_magic_packet);
seq_printf(m, "HwSuppMagicPktVer\t0x%x\n", tp->HwSuppMagicPktVer);
seq_printf(m, "HwSuppCheckPhyDisableModeVer\t0x%x\n", tp->HwSuppCheckPhyDisableModeVer);
seq_printf(m, "HwPkgDet\t0x%x\n", tp->HwPkgDet);
seq_printf(m, "random_mac\t0x%x\n", tp->random_mac);
seq_printf(m, "org_mac_addr\t%pM\n", tp->org_mac_addr);
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,13)
seq_printf(m, "perm_addr\t%pM\n", dev->perm_addr);
#endif
seq_printf(m, "dev_addr\t%pM\n", dev->dev_addr);
spin_unlock_irqrestore(&tp->lock, flags);
seq_putc(m, '\n');
return 0;
}
static int proc_get_tally_counter(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
struct rtl8168_counters *counters;
dma_addr_t paddr;
u32 cmd;
u32 WaitCnt;
unsigned long flags;
seq_puts(m, "\nDump Tally Counter\n");
//ASSERT_RTNL();
counters = tp->tally_vaddr;
paddr = tp->tally_paddr;
if (!counters) {
seq_puts(m, "\nDump Tally Counter Fail\n");
return 0;
}
spin_lock_irqsave(&tp->lock, flags);
RTL_W32(CounterAddrHigh, (u64)paddr >> 32);
cmd = (u64)paddr & DMA_BIT_MASK(32);
RTL_W32(CounterAddrLow, cmd);
RTL_W32(CounterAddrLow, cmd | CounterDump);
WaitCnt = 0;
while (RTL_R32(CounterAddrLow) & CounterDump) {
udelay(10);
WaitCnt++;
if (WaitCnt > 20)
break;
}
spin_unlock_irqrestore(&tp->lock, flags);
seq_puts(m, "Statistics\tValue\n----------\t-----\n");
seq_printf(m, "tx_packets\t%lld\n", le64_to_cpu(counters->tx_packets));
seq_printf(m, "rx_packets\t%lld\n", le64_to_cpu(counters->rx_packets));
seq_printf(m, "tx_errors\t%lld\n", le64_to_cpu(counters->tx_errors));
seq_printf(m, "rx_missed\t%lld\n", le64_to_cpu(counters->rx_missed));
seq_printf(m, "align_errors\t%lld\n", le64_to_cpu(counters->align_errors));
seq_printf(m, "tx_one_collision\t%lld\n", le64_to_cpu(counters->tx_one_collision));
seq_printf(m, "tx_multi_collision\t%lld\n", le64_to_cpu(counters->tx_multi_collision));
seq_printf(m, "rx_unicast\t%lld\n", le64_to_cpu(counters->rx_unicast));
seq_printf(m, "rx_broadcast\t%lld\n", le64_to_cpu(counters->rx_broadcast));
seq_printf(m, "rx_multicast\t%lld\n", le64_to_cpu(counters->rx_multicast));
seq_printf(m, "tx_aborted\t%lld\n", le64_to_cpu(counters->tx_aborted));
seq_printf(m, "tx_underun\t%lld\n", le64_to_cpu(counters->tx_underun));
seq_putc(m, '\n');
return 0;
}
static int proc_get_registers(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
int i, n, max = R8168_MAC_REGS_SIZE;
u8 byte_rd;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
seq_puts(m, "\nDump MAC Registers\n");
seq_puts(m, "Offset\tValue\n------\t-----\n");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
seq_printf(m, "\n0x%02x:\t", n);
for (i = 0; i < 16 && n < max; i++, n++) {
byte_rd = readb(ioaddr + n);
seq_printf(m, "%02x ", byte_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
seq_putc(m, '\n');
return 0;
}
static int proc_get_pcie_phy(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
int i, n, max = R8168_EPHY_REGS_SIZE/2;
u16 word_rd;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
seq_puts(m, "\nDump PCIE PHY\n");
seq_puts(m, "\nOffset\tValue\n------\t-----\n ");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
seq_printf(m, "\n0x%02x:\t", n);
for (i = 0; i < 8 && n < max; i++, n++) {
word_rd = rtl8168_ephy_read(ioaddr, n);
seq_printf(m, "%04x ", word_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
seq_putc(m, '\n');
return 0;
}
static int proc_get_eth_phy(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
int i, n, max = R8168_PHY_REGS_SIZE/2;
u16 word_rd;
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
seq_puts(m, "\nDump Ethernet PHY\n");
seq_puts(m, "\nOffset\tValue\n------\t-----\n ");
spin_lock_irqsave(&tp->lock, flags);
seq_puts(m, "\n####################page 0##################\n ");
mdio_write(tp, 0x1f, 0x0000);
for (n = 0; n < max;) {
seq_printf(m, "\n0x%02x:\t", n);
for (i = 0; i < 8 && n < max; i++, n++) {
word_rd = mdio_read(tp, n);
seq_printf(m, "%04x ", word_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
seq_putc(m, '\n');
return 0;
}
static int proc_get_extended_registers(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
int i, n, max = R8168_ERI_REGS_SIZE;
u32 dword_rd;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
/* RTL8168B does not support Extend GMAC */
seq_puts(m, "\nNot Support Dump Extended Registers\n");
return 0;
}
seq_puts(m, "\nDump Extended Registers\n");
seq_puts(m, "\nOffset\tValue\n------\t-----\n ");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
seq_printf(m, "\n0x%02x:\t", n);
for (i = 0; i < 4 && n < max; i++, n+=4) {
dword_rd = rtl8168_eri_read(ioaddr, n, 4, ERIAR_ExGMAC);
seq_printf(m, "%08x ", dword_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
seq_putc(m, '\n');
return 0;
}
static int proc_get_pci_registers(struct seq_file *m, void *v)
{
struct net_device *dev = m->private;
int i, n, max = R8168_PCI_REGS_SIZE;
u32 dword_rd;
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
seq_puts(m, "\nDump PCI Registers\n");
seq_puts(m, "\nOffset\tValue\n------\t-----\n ");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
seq_printf(m, "\n0x%03x:\t", n);
for (i = 0; i < 4 && n < max; i++, n+=4) {
pci_read_config_dword(tp->pci_dev, n, &dword_rd);
seq_printf(m, "%08x ", dword_rd);
}
}
n = 0x110;
pci_read_config_dword(tp->pci_dev, n, &dword_rd);
seq_printf(m, "\n0x%03x:\t%08x ", n, dword_rd);
n = 0x70c;
pci_read_config_dword(tp->pci_dev, n, &dword_rd);
seq_printf(m, "\n0x%03x:\t%08x ", n, dword_rd);
spin_unlock_irqrestore(&tp->lock, flags);
seq_putc(m, '\n');
return 0;
}
#else
static int proc_get_driver_variable(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
int len = 0;
len += snprintf(page + len, count - len,
"\nDump Driver Driver\n");
spin_lock_irqsave(&tp->lock, flags);
len += snprintf(page + len, count - len,
"Variable\tValue\n----------\t-----\n");
len += snprintf(page + len, count - len,
"MODULENAME\t%s\n"
"driver version\t%s\n"
"chipset\t%d\n"
"chipset_name\t%s\n"
"mtu\t%d\n"
"NUM_RX_DESC\t0x%x\n"
"cur_rx\t0x%x\n"
"dirty_rx\t0x%x\n"
"NUM_TX_DESC\t0x%x\n"
"cur_tx\t0x%x\n"
"dirty_tx\t0x%x\n"
"rx_buf_sz\t0x%x\n"
"esd_flag\t0x%x\n"
"pci_cfg_is_read\t0x%x\n"
"rtl8168_rx_config\t0x%x\n"
"cp_cmd\t0x%x\n"
"intr_mask\t0x%x\n"
"timer_intr_mask\t0x%x\n"
"wol_enabled\t0x%x\n"
"wol_opts\t0x%x\n"
"efuse_ver\t0x%x\n"
"eeprom_type\t0x%x\n"
"autoneg\t0x%x\n"
"duplex\t0x%x\n"
"speed\t%d\n"
"eeprom_len\t0x%x\n"
"cur_page\t0x%x\n"
"bios_setting\t0x%x\n"
"features\t0x%x\n"
"org_pci_offset_99\t0x%x\n"
"org_pci_offset_180\t0x%x\n"
"issue_offset_99_event\t0x%x\n"
"org_pci_offset_80\t0x%x\n"
"org_pci_offset_81\t0x%x\n"
"use_timer_interrrupt\t0x%x\n"
"HwIcVerUnknown\t0x%x\n"
"NotWrRamCodeToMicroP\t0x%x\n"
"NotWrMcuPatchCode\t0x%x\n"
"HwHasWrRamCodeToMicroP\t0x%x\n"
"sw_ram_code_ver\t0x%x\n"
"hw_ram_code_ver\t0x%x\n"
"rtk_enable_diag\t0x%x\n"
"ShortPacketSwChecksum\t0x%x\n"
"UseSwPaddingShortPkt\t0x%x\n"
"RequireAdcBiasPatch\t0x%x\n"
"AdcBiasPatchIoffset\t0x%x\n"
"RequireAdjustUpsTxLinkPulseTiming\t0x%x\n"
"SwrCnt1msIni\t0x%x\n"
"HwSuppNowIsOobVer\t0x%x\n"
"HwFiberModeVer\t0x%x\n"
"RequiredSecLanDonglePatch\t0x%x\n"
"HwSuppDashVer\t0x%x\n"
"DASH\t0x%x\n"
"dash_printer_enabled\t0x%x\n"
"HwSuppKCPOffloadVer\t0x%x\n"
"speed_mode\t0x%x\n"
"duplex_mode\t0x%x\n"
"autoneg_mode\t0x%x\n"
"aspm\t0x%x\n"
"s5wol\t0x%x\n"
"s5_keep_curr_mac\t0x%x\n"
"eee_enable\t0x%x\n"
"hwoptimize\t0x%lx\n"
"proc_init_num\t0x%x\n"
"s0_magic_packet\t0x%x\n"
"HwSuppMagicPktVer\t0x%x\n"
"HwSuppCheckPhyDisableModeVer\t0x%x\n"
"HwPkgDet\t0x%x\n"
"random_mac\t0x%x\n"
"org_mac_addr\t%pM\n"
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,13)
"perm_addr\t%pM\n"
#endif
"dev_addr\t%pM\n",
MODULENAME,
RTL8168_VERSION,
tp->chipset,
rtl_chip_info[tp->chipset].name,
dev->mtu,
NUM_RX_DESC,
tp->cur_rx,
tp->dirty_rx,
NUM_TX_DESC,
tp->cur_tx,
tp->dirty_tx,
tp->rx_buf_sz,
tp->esd_flag,
tp->pci_cfg_is_read,
tp->rtl8168_rx_config,
tp->cp_cmd,
tp->intr_mask,
tp->timer_intr_mask,
tp->wol_enabled,
tp->wol_opts,
tp->efuse_ver,
tp->eeprom_type,
tp->autoneg,
tp->duplex,
tp->speed,
tp->eeprom_len,
tp->cur_page,
tp->bios_setting,
tp->features,
tp->org_pci_offset_99,
tp->org_pci_offset_180,
tp->issue_offset_99_event,
tp->org_pci_offset_80,
tp->org_pci_offset_81,
tp->use_timer_interrrupt,
tp->HwIcVerUnknown,
tp->NotWrRamCodeToMicroP,
tp->NotWrMcuPatchCode,
tp->HwHasWrRamCodeToMicroP,
tp->sw_ram_code_ver,
tp->hw_ram_code_ver,
tp->rtk_enable_diag,
tp->ShortPacketSwChecksum,
tp->UseSwPaddingShortPkt,
tp->RequireAdcBiasPatch,
tp->AdcBiasPatchIoffset,
tp->RequireAdjustUpsTxLinkPulseTiming,
tp->SwrCnt1msIni,
tp->HwSuppNowIsOobVer,
tp->HwFiberModeVer,
tp->RequiredSecLanDonglePatch,
tp->HwSuppDashVer,
tp->DASH,
tp->dash_printer_enabled,
tp->HwSuppKCPOffloadVer,
speed_mode,
duplex_mode,
autoneg_mode,
aspm,
s5wol,
s5_keep_curr_mac,
eee_enable,
hwoptimize,
proc_init_num,
s0_magic_packet,
tp->HwSuppMagicPktVer,
tp->HwSuppCheckPhyDisableModeVer,
tp->HwPkgDet,
tp->random_mac,
tp->org_mac_addr,
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,13)
dev->perm_addr,
#endif
dev->dev_addr
);
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len, "\n");
*eof = 1;
return len;
}
static int proc_get_tally_counter(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
struct rtl8168_counters *counters;
dma_addr_t paddr;
u32 cmd;
u32 WaitCnt;
unsigned long flags;
int len = 0;
len += snprintf(page + len, count - len,
"\nDump Tally Counter\n");
//ASSERT_RTNL();
counters = tp->tally_vaddr;
paddr = tp->tally_paddr;
if (!counters) {
len += snprintf(page + len, count - len,
"\nDump Tally Counter Fail\n");
goto out;
}
spin_lock_irqsave(&tp->lock, flags);
RTL_W32(CounterAddrHigh, (u64)paddr >> 32);
cmd = (u64)paddr & DMA_BIT_MASK(32);
RTL_W32(CounterAddrLow, cmd);
RTL_W32(CounterAddrLow, cmd | CounterDump);
WaitCnt = 0;
while (RTL_R32(CounterAddrLow) & CounterDump) {
udelay(10);
WaitCnt++;
if (WaitCnt > 20)
break;
}
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len,
"Statistics\tValue\n----------\t-----\n");
len += snprintf(page + len, count - len,
"tx_packets\t%lld\n"
"rx_packets\t%lld\n"
"tx_errors\t%lld\n"
"rx_missed\t%lld\n"
"align_errors\t%lld\n"
"tx_one_collision\t%lld\n"
"tx_multi_collision\t%lld\n"
"rx_unicast\t%lld\n"
"rx_broadcast\t%lld\n"
"rx_multicast\t%lld\n"
"tx_aborted\t%lld\n"
"tx_underun\t%lld\n",
le64_to_cpu(counters->tx_packets),
le64_to_cpu(counters->rx_packets),
le64_to_cpu(counters->tx_errors),
le64_to_cpu(counters->rx_missed),
le64_to_cpu(counters->align_errors),
le64_to_cpu(counters->tx_one_collision),
le64_to_cpu(counters->tx_multi_collision),
le64_to_cpu(counters->rx_unicast),
le64_to_cpu(counters->rx_broadcast),
le64_to_cpu(counters->rx_multicast),
le64_to_cpu(counters->tx_aborted),
le64_to_cpu(counters->tx_underun)
);
len += snprintf(page + len, count - len, "\n");
out:
*eof = 1;
return len;
}
static int proc_get_registers(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
int i, n, max = R8168_MAC_REGS_SIZE;
u8 byte_rd;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
int len = 0;
len += snprintf(page + len, count - len,
"\nDump MAC Registers\n"
"Offset\tValue\n------\t-----\n");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
len += snprintf(page + len, count - len,
"\n0x%02x:\t",
n);
for (i = 0; i < 16 && n < max; i++, n++) {
byte_rd = readb(ioaddr + n);
len += snprintf(page + len, count - len,
"%02x ",
byte_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len, "\n");
*eof = 1;
return len;
}
static int proc_get_pcie_phy(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
int i, n, max = R8168_EPHY_REGS_SIZE/2;
u16 word_rd;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
int len = 0;
len += snprintf(page + len, count - len,
"\nDump PCIE PHY\n"
"Offset\tValue\n------\t-----\n");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
len += snprintf(page + len, count - len,
"\n0x%02x:\t",
n);
for (i = 0; i < 8 && n < max; i++, n++) {
word_rd = rtl8168_ephy_read(ioaddr, n);
len += snprintf(page + len, count - len,
"%04x ",
word_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len, "\n");
*eof = 1;
return len;
}
static int proc_get_eth_phy(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
int i, n, max = R8168_PHY_REGS_SIZE/2;
u16 word_rd;
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
int len = 0;
len += snprintf(page + len, count - len,
"\nDump Ethernet PHY\n"
"Offset\tValue\n------\t-----\n");
spin_lock_irqsave(&tp->lock, flags);
len += snprintf(page + len, count - len,
"\n####################page 0##################\n");
mdio_write(tp, 0x1f, 0x0000);
for (n = 0; n < max;) {
len += snprintf(page + len, count - len,
"\n0x%02x:\t",
n);
for (i = 0; i < 8 && n < max; i++, n++) {
word_rd = mdio_read(tp, n);
len += snprintf(page + len, count - len,
"%04x ",
word_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len, "\n");
*eof = 1;
return len;
}
static int proc_get_extended_registers(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
int i, n, max = R8168_ERI_REGS_SIZE;
u32 dword_rd;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
int len = 0;
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
/* RTL8168B does not support Extend GMAC */
len += snprintf(page + len, count - len,
"\nNot Support Dump Extended Registers\n");
goto out;
}
len += snprintf(page + len, count - len,
"\nDump Extended Registers\n"
"Offset\tValue\n------\t-----\n");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
len += snprintf(page + len, count - len,
"\n0x%02x:\t",
n);
for (i = 0; i < 4 && n < max; i++, n+=4) {
dword_rd = rtl8168_eri_read(ioaddr, n, 4, ERIAR_ExGMAC);
len += snprintf(page + len, count - len,
"%08x ",
dword_rd);
}
}
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len, "\n");
out:
*eof = 1;
return len;
}
static int proc_get_pci_registers(char *page, char **start,
off_t offset, int count,
int *eof, void *data)
{
struct net_device *dev = data;
int i, n, max = R8168_PCI_REGS_SIZE;
u32 dword_rd;
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
int len = 0;
len += snprintf(page + len, count - len,
"\nDump PCI Registers\n"
"Offset\tValue\n------\t-----\n");
spin_lock_irqsave(&tp->lock, flags);
for (n = 0; n < max;) {
len += snprintf(page + len, count - len,
"\n0x%03x:\t",
n);
for (i = 0; i < 4 && n < max; i++, n+=4) {
pci_read_config_dword(tp->pci_dev, n, &dword_rd);
len += snprintf(page + len, count - len,
"%08x ",
dword_rd);
}
}
n = 0x110;
pci_read_config_dword(tp->pci_dev, n, &dword_rd);
len += snprintf(page + len, count - len,
"\n0x%03x:\t%08x ",
n,
dword_rd);
n = 0x70c;
pci_read_config_dword(tp->pci_dev, n, &dword_rd);
len += snprintf(page + len, count - len,
"\n0x%03x:\t%08x ",
n,
dword_rd);
spin_unlock_irqrestore(&tp->lock, flags);
len += snprintf(page + len, count - len, "\n");
*eof = 1;
return len;
}
#endif
static void rtl8168_proc_module_init(void)
{
//create /proc/net/r8168
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,32)
rtl8168_proc = proc_mkdir(MODULENAME, init_net.proc_net);
#else
rtl8168_proc = proc_mkdir(MODULENAME, proc_net);
#endif
if (!rtl8168_proc)
dprintk("cannot create %s proc entry \n", MODULENAME);
}
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
/*
* seq_file wrappers for procfile show routines.
*/
static int rtl8168_proc_open(struct inode *inode, struct file *file)
{
struct net_device *dev = proc_get_parent_data(inode);
int (*show)(struct seq_file *, void *) = PDE_DATA(inode);
return single_open(file, show, dev);
}
static const struct file_operations rtl8168_proc_fops = {
.open = rtl8168_proc_open,
.read = seq_read,
.llseek = seq_lseek,
.release = single_release,
};
#endif
/*
* Table of proc files we need to create.
*/
struct rtl8168_proc_file {
char name[12];
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
int (*show)(struct seq_file *, void *);
#else
int (*show)(char *, char **, off_t, int, int *, void *);
#endif
};
static const struct rtl8168_proc_file rtl8168_proc_files[] = {
{ "driver_var", &proc_get_driver_variable },
{ "tally", &proc_get_tally_counter },
{ "registers", &proc_get_registers },
{ "pcie_phy", &proc_get_pcie_phy },
{ "eth_phy", &proc_get_eth_phy },
{ "ext_regs", &proc_get_extended_registers },
{ "pci_regs", &proc_get_pci_registers },
{ "" }
};
static void rtl8168_proc_init(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
const struct rtl8168_proc_file *f;
struct proc_dir_entry *dir;
if (rtl8168_proc && !tp->proc_dir) {
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
dir = proc_mkdir_data(dev->name, 0, rtl8168_proc, dev);
if (!dir) {
printk("Unable to initialize /proc/net/%s/%s\n",
MODULENAME, dev->name);
return;
}
tp->proc_dir = dir;
proc_init_num++;
for (f = rtl8168_proc_files; f->name[0]; f++) {
if (!proc_create_data(f->name, S_IFREG | S_IRUGO, dir,
&rtl8168_proc_fops, f->show)) {
printk("Unable to initialize "
"/proc/net/%s/%s/%s\n",
MODULENAME, dev->name, f->name);
return;
}
}
#else
dir = proc_mkdir(dev->name, rtl8168_proc);
if (!dir) {
printk("Unable to initialize /proc/net/%s/%s\n",
MODULENAME, dev->name);
return;
}
tp->proc_dir = dir;
proc_init_num++;
for (f = rtl8168_proc_files; f->name[0]; f++) {
if (!create_proc_read_entry(f->name, S_IFREG | S_IRUGO,
dir, f->show, dev)) {
printk("Unable to initialize "
"/proc/net/%s/%s/%s\n",
MODULENAME, dev->name, f->name);
return;
}
}
#endif
}
}
static void rtl8168_proc_remove(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
if (tp->proc_dir) {
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
remove_proc_subtree(dev->name, rtl8168_proc);
proc_init_num--;
#else
const struct rtl8168_proc_file *f;
struct rtl8168_private *tp = netdev_priv(dev);
for (f = rtl8168_proc_files; f->name[0]; f++)
remove_proc_entry(f->name, tp->proc_dir);
remove_proc_entry(dev->name, rtl8168_proc);
proc_init_num--;
#endif
tp->proc_dir = NULL;
}
}
#endif //ENABLE_R8168_PROCFS
static inline u16 map_phy_ocp_addr(u16 PageNum, u8 RegNum)
{
u16 OcpPageNum = 0;
u8 OcpRegNum = 0;
u16 OcpPhyAddress = 0;
if ( PageNum == 0 ) {
OcpPageNum = OCP_STD_PHY_BASE_PAGE + ( RegNum / 8 );
OcpRegNum = 0x10 + ( RegNum % 8 );
} else {
OcpPageNum = PageNum;
OcpRegNum = RegNum;
}
OcpPageNum <<= 4;
if ( OcpRegNum < 16 ) {
OcpPhyAddress = 0;
} else {
OcpRegNum -= 16;
OcpRegNum <<= 1;
OcpPhyAddress = OcpPageNum + OcpRegNum;
}
return OcpPhyAddress;
}
static void mdio_write_phy_ocp(struct rtl8168_private *tp,
u16 PageNum,
u32 RegAddr,
u32 value)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 data32;
u16 ocp_addr;
int i;
ocp_addr = map_phy_ocp_addr(PageNum, RegAddr);
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,18)
WARN_ON_ONCE(ocp_addr % 2);
#endif
data32 = ocp_addr/2;
data32 <<= OCPR_Addr_Reg_shift;
data32 |= OCPR_Write | value;
RTL_W32(PHYOCP, data32);
for (i = 0; i < 100; i++) {
udelay(1);
if (!(RTL_R32(PHYOCP) & OCPR_Flag))
break;
}
}
static void mdio_real_write(struct rtl8168_private *tp,
u32 RegAddr,
u32 value)
{
void __iomem *ioaddr = tp->mmio_addr;
int i;
if (RegAddr == 0x1F) {
tp->cur_page = value;
}
if (tp->mcfg == CFG_METHOD_11) {
RTL_W32(OCPDR, OCPDR_Write |
(RegAddr & OCPDR_Reg_Mask) << OCPDR_GPHY_Reg_shift |
(value & OCPDR_Data_Mask));
RTL_W32(OCPAR, OCPAR_GPHY_Write);
RTL_W32(EPHY_RXER_NUM, 0);
for (i = 0; i < 100; i++) {
mdelay(1);
if (!(RTL_R32(OCPAR) & OCPAR_Flag))
break;
}
} else if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 || tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
if (RegAddr == 0x1F) {
return;
}
mdio_write_phy_ocp(tp, tp->cur_page, RegAddr, value);
} else {
if (tp->mcfg == CFG_METHOD_12 || tp->mcfg == CFG_METHOD_13)
RTL_W32(0xD0, RTL_R32(0xD0) & ~0x00020000);
RTL_W32(PHYAR, PHYAR_Write |
(RegAddr & PHYAR_Reg_Mask) << PHYAR_Reg_shift |
(value & PHYAR_Data_Mask));
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed writing to the specified MII register */
if (!(RTL_R32(PHYAR) & PHYAR_Flag)) {
udelay(20);
break;
}
}
if (tp->mcfg == CFG_METHOD_12 || tp->mcfg == CFG_METHOD_13)
RTL_W32(0xD0, RTL_R32(0xD0) | 0x00020000);
}
}
void mdio_write(struct rtl8168_private *tp,
u32 RegAddr,
u32 value)
{
if (tp->rtk_enable_diag) return;
mdio_real_write(tp, RegAddr, value);
}
void mdio_prot_write(struct rtl8168_private *tp,
u32 RegAddr,
u32 value)
{
mdio_real_write(tp, RegAddr, value);
}
static u32 mdio_read_phy_ocp(struct rtl8168_private *tp,
u16 PageNum,
u32 RegAddr)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 data32;
u16 ocp_addr;
int i, value = 0;
ocp_addr = map_phy_ocp_addr(PageNum, RegAddr);
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,18)
WARN_ON_ONCE(ocp_addr % 2);
#endif
data32 = ocp_addr/2;
data32 <<= OCPR_Addr_Reg_shift;
RTL_W32(PHYOCP, data32);
for (i = 0; i < 100; i++) {
udelay(1);
if (RTL_R32(PHYOCP) & OCPR_Flag)
break;
}
value = RTL_R32(PHYOCP) & OCPDR_Data_Mask;
return value;
}
u32 mdio_read(struct rtl8168_private *tp,
u32 RegAddr)
{
void __iomem *ioaddr = tp->mmio_addr;
int i, value = 0;
if (tp->mcfg==CFG_METHOD_11) {
RTL_W32(OCPDR, OCPDR_Read |
(RegAddr & OCPDR_Reg_Mask) << OCPDR_GPHY_Reg_shift);
RTL_W32(OCPAR, OCPAR_GPHY_Write);
RTL_W32(EPHY_RXER_NUM, 0);
for (i = 0; i < 100; i++) {
mdelay(1);
if (!(RTL_R32(OCPAR) & OCPAR_Flag))
break;
}
mdelay(1);
RTL_W32(OCPAR, OCPAR_GPHY_Read);
RTL_W32(EPHY_RXER_NUM, 0);
for (i = 0; i < 100; i++) {
mdelay(1);
if (RTL_R32(OCPAR) & OCPAR_Flag)
break;
}
value = RTL_R32(OCPDR) & OCPDR_Data_Mask;
} else if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 || tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
value = mdio_read_phy_ocp(tp, tp->cur_page, RegAddr);
} else {
if (tp->mcfg == CFG_METHOD_12 || tp->mcfg == CFG_METHOD_13)
RTL_W32(0xD0, RTL_R32(0xD0) & ~0x00020000);
RTL_W32(PHYAR,
PHYAR_Read | (RegAddr & PHYAR_Reg_Mask) << PHYAR_Reg_shift);
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed retrieving data from the specified MII register */
if (RTL_R32(PHYAR) & PHYAR_Flag) {
value = RTL_R32(PHYAR) & PHYAR_Data_Mask;
udelay(20);
break;
}
}
if (tp->mcfg == CFG_METHOD_12 || tp->mcfg == CFG_METHOD_13)
RTL_W32(0xD0, RTL_R32(0xD0) | 0x00020000);
}
return value;
}
static void ClearAndSetEthPhyBit(struct rtl8168_private *tp, u8 addr, u16 clearmask, u16 setmask)
{
u16 PhyRegValue;
PhyRegValue = mdio_read( tp, addr );
PhyRegValue &= ~clearmask;
PhyRegValue |= setmask;
mdio_write( tp, addr, PhyRegValue);
}
void ClearEthPhyBit(struct rtl8168_private *tp, u8 addr, u16 mask)
{
ClearAndSetEthPhyBit( tp,
addr,
mask,
0
);
}
void SetEthPhyBit(struct rtl8168_private *tp, u8 addr, u16 mask)
{
ClearAndSetEthPhyBit( tp,
addr,
0,
mask
);
}
void mac_ocp_write(struct rtl8168_private *tp, u16 reg_addr, u16 value)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 data32;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,18)
WARN_ON_ONCE(reg_addr % 2);
#endif
data32 = reg_addr/2;
data32 <<= OCPR_Addr_Reg_shift;
data32 += value;
data32 |= OCPR_Write;
RTL_W32(MACOCP, data32);
}
u16 mac_ocp_read(struct rtl8168_private *tp, u16 reg_addr)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 data32;
u16 data16 = 0;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,18)
WARN_ON_ONCE(reg_addr % 2);
#endif
data32 = reg_addr/2;
data32 <<= OCPR_Addr_Reg_shift;
RTL_W32(MACOCP, data32);
data16 = (u16)RTL_R32(MACOCP);
return data16;
}
static u32 real_ocp_read(struct rtl8168_private *tp, u16 addr, u8 len)
{
void __iomem *ioaddr = tp->mmio_addr;
int i, val_shift, shift = 0;
u32 value1 = 0, value2 = 0, mask;
if (len > 4 || len <= 0)
return -1;
while (len > 0) {
val_shift = addr % 4;
addr = addr & ~0x3;
RTL_W32(OCPAR, (0x0F<<12) | (addr&0xFFF));
for (i = 0; i < 20; i++) {
udelay(100);
if (RTL_R32(OCPAR) & OCPAR_Flag)
break;
}
if (len == 1) mask = (0xFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 2) mask = (0xFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 3) mask = (0xFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else mask = (0xFFFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
value1 = RTL_R32(OCPDR) & mask;
value2 |= (value1 >> val_shift * 8) << shift * 8;
if (len <= 4 - val_shift) {
len = 0;
} else {
len -= (4 - val_shift);
shift = 4 - val_shift;
addr += 4;
}
}
udelay(20);
return value2;
}
u32 OCP_read_with_oob_base_address(struct rtl8168_private *tp, u16 addr, u8 len, const u32 base_address)
{
void __iomem *ioaddr = tp->mmio_addr;
return rtl8168_eri_read_with_oob_base_address(ioaddr, addr, len, ERIAR_OOB, base_address);
}
u32 OCP_read(struct rtl8168_private *tp, u16 addr, u8 len)
{
u32 value = 0;
if (HW_DASH_SUPPORT_TYPE_2(tp))
value = OCP_read_with_oob_base_address(tp, addr, len, NO_BASE_ADDRESS);
else if (HW_DASH_SUPPORT_TYPE_3(tp))
value = OCP_read_with_oob_base_address(tp, addr, len, RTL8168FP_OOBMAC_BASE);
else
value = real_ocp_read(tp, addr, len);
return value;
}
static int real_ocp_write(struct rtl8168_private *tp, u16 addr, u8 len, u32 value)
{
void __iomem *ioaddr = tp->mmio_addr;
int i, val_shift, shift = 0;
u32 value1 = 0, mask;
if (len > 4 || len <= 0)
return -1;
while (len > 0) {
val_shift = addr % 4;
addr = addr & ~0x3;
if (len == 1) mask = (0xFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 2) mask = (0xFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 3) mask = (0xFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else mask = (0xFFFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
value1 = OCP_read(tp, addr, 4) & ~mask;
value1 |= ((value << val_shift * 8) >> shift * 8);
RTL_W32(OCPDR, value1);
RTL_W32(OCPAR, OCPAR_Flag | (0x0F<<12) | (addr&0xFFF));
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed ERI write */
if (!(RTL_R32(OCPAR) & OCPAR_Flag))
break;
}
if (len <= 4 - val_shift) {
len = 0;
} else {
len -= (4 - val_shift);
shift = 4 - val_shift;
addr += 4;
}
}
udelay(20);
return 0;
}
u32 OCP_write_with_oob_base_address(struct rtl8168_private *tp, u16 addr, u8 len, u32 value, const u32 base_address)
{
void __iomem *ioaddr = tp->mmio_addr;
return rtl8168_eri_write_with_oob_base_address(ioaddr, addr, len, value, ERIAR_OOB, base_address);
}
void OCP_write(struct rtl8168_private *tp, u16 addr, u8 len, u32 value)
{
if (HW_DASH_SUPPORT_TYPE_2(tp))
OCP_write_with_oob_base_address(tp, addr, len, value, NO_BASE_ADDRESS);
else if (HW_DASH_SUPPORT_TYPE_3(tp))
OCP_write_with_oob_base_address(tp, addr, len, value, RTL8168FP_OOBMAC_BASE);
else
real_ocp_write(tp, addr, len, value);
}
void OOB_mutex_lock(struct rtl8168_private *tp)
{
u8 reg_16, reg_a0;
u32 wait_cnt_0, wait_Cnt_1;
u16 ocp_reg_mutex_ib;
u16 ocp_reg_mutex_oob;
u16 ocp_reg_mutex_prio;
if (!tp->DASH) return;
switch (tp->mcfg) {
case CFG_METHOD_11:
case CFG_METHOD_12:
ocp_reg_mutex_oob = 0x16;
ocp_reg_mutex_ib = 0x17;
ocp_reg_mutex_prio = 0x9C;
break;
case CFG_METHOD_13:
ocp_reg_mutex_oob = 0x06;
ocp_reg_mutex_ib = 0x07;
ocp_reg_mutex_prio = 0x9C;
break;
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_31:
case CFG_METHOD_32:
default:
ocp_reg_mutex_oob = 0x110;
ocp_reg_mutex_ib = 0x114;
ocp_reg_mutex_prio = 0x11C;
break;
}
OCP_write(tp, ocp_reg_mutex_ib, 1, BIT_0);
reg_16 = OCP_read(tp, ocp_reg_mutex_oob, 1);
wait_cnt_0 = 0;
while(reg_16) {
reg_a0 = OCP_read(tp, ocp_reg_mutex_prio, 1);
if (reg_a0) {
OCP_write(tp, ocp_reg_mutex_ib, 1, 0x00);
reg_a0 = OCP_read(tp, ocp_reg_mutex_prio, 1);
wait_Cnt_1 = 0;
while(reg_a0) {
reg_a0 = OCP_read(tp, ocp_reg_mutex_prio, 1);
wait_Cnt_1++;
if (wait_Cnt_1 > 2000)
break;
};
OCP_write(tp, ocp_reg_mutex_ib, 1, BIT_0);
}
reg_16 = OCP_read(tp, ocp_reg_mutex_oob, 1);
wait_cnt_0++;
if (wait_cnt_0 > 2000)
break;
};
}
void OOB_mutex_unlock(struct rtl8168_private *tp)
{
u16 ocp_reg_mutex_ib;
u16 ocp_reg_mutex_oob;
u16 ocp_reg_mutex_prio;
if (!tp->DASH) return;
switch (tp->mcfg) {
case CFG_METHOD_11:
case CFG_METHOD_12:
ocp_reg_mutex_oob = 0x16;
ocp_reg_mutex_ib = 0x17;
ocp_reg_mutex_prio = 0x9C;
break;
case CFG_METHOD_13:
ocp_reg_mutex_oob = 0x06;
ocp_reg_mutex_ib = 0x07;
ocp_reg_mutex_prio = 0x9C;
break;
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_31:
case CFG_METHOD_32:
default:
ocp_reg_mutex_oob = 0x110;
ocp_reg_mutex_ib = 0x114;
ocp_reg_mutex_prio = 0x11C;
break;
}
OCP_write(tp, ocp_reg_mutex_prio, 1, BIT_0);
OCP_write(tp, ocp_reg_mutex_ib, 1, 0x00);
}
void OOB_notify(struct rtl8168_private *tp, u8 cmd)
{
void __iomem *ioaddr = tp->mmio_addr;
rtl8168_eri_write(ioaddr, 0xE8, 1, cmd, ERIAR_ExGMAC);
OCP_write(tp, 0x30, 1, 0x01);
}
static int rtl8168_check_dash(struct rtl8168_private *tp)
{
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
if (OCP_read(tp, 0x128, 1) & BIT_0)
return 1;
else
return 0;
} else {
u32 reg;
if (tp->mcfg == CFG_METHOD_13)
reg = 0xb8;
else
reg = 0x10;
if (OCP_read(tp, reg, 2) & 0x00008000)
return 1;
else
return 0;
}
}
void Dash2DisableTx(struct rtl8168_private *tp)
{
if (!tp->DASH) return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
u16 WaitCnt;
u8 TmpUchar;
//Disable oob Tx
RTL_CMAC_W8(CMAC_IBCR2, RTL_CMAC_R8(CMAC_IBCR2) & ~( BIT_0 ));
WaitCnt = 0;
//wait oob tx disable
do {
TmpUchar = RTL_CMAC_R8(CMAC_IBISR0);
if ( TmpUchar & ISRIMR_DASH_TYPE2_TX_DISABLE_IDLE ) {
break;
}
udelay( 50 );
WaitCnt++;
} while(WaitCnt < 2000);
//Clear ISRIMR_DASH_TYPE2_TX_DISABLE_IDLE
RTL_CMAC_W8(CMAC_IBISR0, RTL_CMAC_R8(CMAC_IBISR0) | ISRIMR_DASH_TYPE2_TX_DISABLE_IDLE);
}
}
void Dash2EnableTx(struct rtl8168_private *tp)
{
if (!tp->DASH) return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
RTL_CMAC_W8(CMAC_IBCR2, RTL_CMAC_R8(CMAC_IBCR2) | BIT_0);
}
}
void Dash2DisableRx(struct rtl8168_private *tp)
{
if (!tp->DASH) return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
RTL_CMAC_W8(CMAC_IBCR0, RTL_CMAC_R8(CMAC_IBCR0) & ~( BIT_0 ));
}
}
void Dash2EnableRx(struct rtl8168_private *tp)
{
if (!tp->DASH) return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
RTL_CMAC_W8(CMAC_IBCR0, RTL_CMAC_R8(CMAC_IBCR0) | BIT_0);
}
}
static void Dash2DisableTxRx(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
Dash2DisableTx( tp );
Dash2DisableRx( tp );
}
}
static void rtl8168_driver_start(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if (!tp->DASH)
return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
int timeout;
u32 tmp_value;
OCP_write(tp, 0x180, 1, OOB_CMD_DRIVER_START);
tmp_value = OCP_read(tp, 0x30, 1);
tmp_value |= BIT_0;
OCP_write(tp, 0x30, 1, tmp_value);
for (timeout = 0; timeout < 10; timeout++) {
mdelay(10);
if (OCP_read(tp, 0x124, 1) & BIT_0)
break;
}
} else {
int timeout;
u32 reg;
if (tp->mcfg == CFG_METHOD_13) {
RTL_W8(TwiCmdReg, RTL_R8(TwiCmdReg) | ( BIT_7 ));
}
OOB_notify(tp, OOB_CMD_DRIVER_START);
if (tp->mcfg == CFG_METHOD_13)
reg = 0xB8;
else
reg = 0x10;
for (timeout = 0; timeout < 10; timeout++) {
mdelay(10);
if (OCP_read(tp, reg, 2) & BIT_11)
break;
}
}
}
static void rtl8168_driver_stop(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if (!tp->DASH)
return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
struct net_device *dev = tp->dev;
int timeout;
u32 tmp_value;
Dash2DisableTxRx(dev);
OCP_write(tp, 0x180, 1, OOB_CMD_DRIVER_STOP);
tmp_value = OCP_read(tp, 0x30, 1);
tmp_value |= BIT_0;
OCP_write(tp, 0x30, 1, tmp_value);
for (timeout = 0; timeout < 10; timeout++) {
mdelay(10);
if (!(OCP_read(tp, 0x124, 1) & BIT_0))
break;
}
} else {
int timeout;
u32 reg;
OOB_notify(tp, OOB_CMD_DRIVER_STOP);
if (tp->mcfg == CFG_METHOD_13)
reg = 0xB8;
else
reg = 0x10;
for (timeout = 0; timeout < 10; timeout++) {
mdelay(10);
if ((OCP_read(tp, reg, 2) & BIT_11) == 0)
break;
}
if (tp->mcfg == CFG_METHOD_13) {
RTL_W8(TwiCmdReg, RTL_R8(TwiCmdReg) & ~( BIT_7 ));
}
}
}
void rtl8168_ephy_write(void __iomem *ioaddr, int RegAddr, int value)
{
int i;
RTL_W32(EPHYAR,
EPHYAR_Write |
(RegAddr & EPHYAR_Reg_Mask) << EPHYAR_Reg_shift |
(value & EPHYAR_Data_Mask));
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed EPHY write */
if (!(RTL_R32(EPHYAR) & EPHYAR_Flag))
break;
}
udelay(20);
}
u16 rtl8168_ephy_read(void __iomem *ioaddr, int RegAddr)
{
int i;
u16 value = 0xffff;
RTL_W32(EPHYAR,
EPHYAR_Read | (RegAddr & EPHYAR_Reg_Mask) << EPHYAR_Reg_shift);
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed EPHY read */
if (RTL_R32(EPHYAR) & EPHYAR_Flag) {
value = (u16) (RTL_R32(EPHYAR) & EPHYAR_Data_Mask);
break;
}
}
udelay(20);
return value;
}
static void ClearAndSetPCIePhyBit(struct rtl8168_private *tp, u8 addr, u16 clearmask, u16 setmask)
{
void __iomem *ioaddr = tp->mmio_addr;
u16 EphyValue;
EphyValue = rtl8168_ephy_read( ioaddr, addr );
EphyValue &= ~clearmask;
EphyValue |= setmask;
rtl8168_ephy_write( ioaddr, addr, EphyValue);
}
static void ClearPCIePhyBit(struct rtl8168_private *tp, u8 addr, u16 mask)
{
ClearAndSetPCIePhyBit( tp,
addr,
mask,
0
);
}
static void SetPCIePhyBit( struct rtl8168_private *tp, u8 addr, u16 mask)
{
ClearAndSetPCIePhyBit( tp,
addr,
0,
mask
);
}
static u32
rtl8168_csi_other_fun_read(struct rtl8168_private *tp,
u8 multi_fun_sel_bit,
u32 addr)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 cmd;
int i;
u32 value = 0;
cmd = CSIAR_Read | CSIAR_ByteEn << CSIAR_ByteEn_shift | (addr & CSIAR_Addr_Mask);
if (tp->mcfg != CFG_METHOD_20 && tp->mcfg != CFG_METHOD_23 &&
tp->mcfg != CFG_METHOD_26 && tp->mcfg != CFG_METHOD_27 &&
tp->mcfg != CFG_METHOD_28 && tp->mcfg != CFG_METHOD_31 &&
tp->mcfg != CFG_METHOD_32) {
multi_fun_sel_bit = 0;
}
if ( multi_fun_sel_bit > 7 ) {
return 0xffffffff;
}
cmd |= multi_fun_sel_bit << 16;
RTL_W32(CSIAR, cmd);
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed CSI read */
if (RTL_R32(CSIAR) & CSIAR_Flag) {
value = (u32)RTL_R32(CSIDR);
break;
}
}
udelay(20);
return value;
}
static void
rtl8168_csi_other_fun_write(struct rtl8168_private *tp,
u8 multi_fun_sel_bit,
u32 addr,
u32 value)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 cmd;
int i;
RTL_W32(CSIDR, value);
cmd = CSIAR_Write | CSIAR_ByteEn << CSIAR_ByteEn_shift | (addr & CSIAR_Addr_Mask);
if (tp->mcfg != CFG_METHOD_20 && tp->mcfg != CFG_METHOD_23 &&
tp->mcfg != CFG_METHOD_26 && tp->mcfg != CFG_METHOD_27 &&
tp->mcfg != CFG_METHOD_28 && tp->mcfg != CFG_METHOD_31 &&
tp->mcfg != CFG_METHOD_32) {
multi_fun_sel_bit = 0;
}
if ( multi_fun_sel_bit > 7 ) {
return;
}
cmd |= multi_fun_sel_bit << 16;
RTL_W32(CSIAR, cmd);
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed CSI write */
if (!(RTL_R32(CSIAR) & CSIAR_Flag))
break;
}
udelay(20);
}
static u32
rtl8168_csi_read(struct rtl8168_private *tp,
u32 addr)
{
u8 multi_fun_sel_bit;
if (tp->mcfg == CFG_METHOD_20)
multi_fun_sel_bit = 2;
else if (tp->mcfg == CFG_METHOD_26 || tp->mcfg == CFG_METHOD_31 ||
tp->mcfg == CFG_METHOD_32)
multi_fun_sel_bit = 1;
else
multi_fun_sel_bit = 0;
return rtl8168_csi_other_fun_read(tp, multi_fun_sel_bit, addr);
}
static void
rtl8168_csi_write(struct rtl8168_private *tp,
u32 addr,
u32 value)
{
u8 multi_fun_sel_bit;
if (tp->mcfg == CFG_METHOD_20)
multi_fun_sel_bit = 2;
else if (tp->mcfg == CFG_METHOD_26 || tp->mcfg == CFG_METHOD_31 ||
tp->mcfg == CFG_METHOD_32)
multi_fun_sel_bit = 1;
else
multi_fun_sel_bit = 0;
rtl8168_csi_other_fun_write(tp, multi_fun_sel_bit, addr, value);
}
static u8
rtl8168_csi_fun0_read_byte(struct rtl8168_private *tp,
u32 addr)
{
u8 RetVal = 0;
if (tp->mcfg == CFG_METHOD_20 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
u32 TmpUlong;
u16 RegAlignAddr;
u8 ShiftByte;
RegAlignAddr = addr & ~(0x3);
ShiftByte = addr & (0x3);
TmpUlong = rtl8168_csi_other_fun_read(tp, 0, addr);
TmpUlong >>= (8*ShiftByte);
RetVal = (u8)TmpUlong;
} else {
struct pci_dev *pdev = tp->pci_dev;
pci_read_config_byte(pdev, addr, &RetVal);
}
udelay(20);
return RetVal;
}
static void
rtl8168_csi_fun0_write_byte(struct rtl8168_private *tp,
u32 addr,
u8 value)
{
if (tp->mcfg == CFG_METHOD_20 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
u32 TmpUlong;
u16 RegAlignAddr;
u8 ShiftByte;
RegAlignAddr = addr & ~(0x3);
ShiftByte = addr & (0x3);
TmpUlong = rtl8168_csi_other_fun_read(tp, 0, RegAlignAddr);
TmpUlong &= ~(0xFF << (8*ShiftByte));
TmpUlong |= (value << (8*ShiftByte));
rtl8168_csi_other_fun_write( tp, 0, RegAlignAddr, TmpUlong );
} else {
struct pci_dev *pdev = tp->pci_dev;
pci_write_config_byte(pdev, addr, value);
}
udelay(20);
}
static void
rtl8168_csi_set_dash_other_fun(struct rtl8168_private *tp,
u16 addr,
u32 clearmask,
u32 setmask,
u8 goto_d3)
{
u8 multi_fun_sel_bit;
u32 TmpUlong;
switch(tp->mcfg) {
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
for (multi_fun_sel_bit = 1; multi_fun_sel_bit < 4; multi_fun_sel_bit++) {
TmpUlong = rtl8168_csi_other_fun_read(tp, multi_fun_sel_bit, addr);
TmpUlong &= ~clearmask;
TmpUlong |= setmask;
rtl8168_csi_other_fun_write(tp, multi_fun_sel_bit, addr, TmpUlong);
}
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
for (multi_fun_sel_bit = 0; multi_fun_sel_bit < 8; multi_fun_sel_bit++) {
u8 set_other_fun = FALSE;
if (multi_fun_sel_bit == 1) {
set_other_fun = FALSE;
} else if (multi_fun_sel_bit == 0 || multi_fun_sel_bit == 2 || multi_fun_sel_bit == 7) {
if (goto_d3)
set_other_fun = TRUE;
} else if (multi_fun_sel_bit == 3 || multi_fun_sel_bit == 4) {
TmpUlong = rtl8168_csi_other_fun_read(tp, multi_fun_sel_bit, 0xF000);
if (TmpUlong == 0xFFFFFFFF)
set_other_fun = TRUE;
else
set_other_fun = FALSE;
} else { //func 5, 6
if (tp->DASH) {
TmpUlong = mac_ocp_read(tp, 0x184);
if (TmpUlong & BIT_26)
set_other_fun = FALSE;
else
set_other_fun = TRUE;
}
}
if (set_other_fun) {
TmpUlong = rtl8168_csi_other_fun_read(tp, multi_fun_sel_bit, addr);
TmpUlong &= ~clearmask;
TmpUlong |= setmask;
rtl8168_csi_other_fun_write(tp, multi_fun_sel_bit, addr, TmpUlong);
}
}
break;
}
}
u32 rtl8168_eri_read_with_oob_base_address(void __iomem *ioaddr, int addr, int len, int type, const u32 base_address)
{
int i, val_shift, shift = 0;
u32 value1 = 0, value2 = 0, mask;
u32 eri_cmd;
const u32 transformed_base_address = ((base_address & 0x00FFF000) << 6) | (base_address & 0x000FFF);
if (len > 4 || len <= 0)
return -1;
while (len > 0) {
val_shift = addr % ERIAR_Addr_Align;
addr = addr & ~0x3;
eri_cmd = ERIAR_Read |
transformed_base_address |
type << ERIAR_Type_shift |
ERIAR_ByteEn << ERIAR_ByteEn_shift |
(addr & 0x0FFF);
if (addr & 0xF000) {
u32 tmp;
tmp = addr & 0xF000;
tmp >>= 12;
eri_cmd |= (tmp << 20) & 0x00F00000;
}
RTL_W32(ERIAR, eri_cmd);
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed ERI read */
if (RTL_R32(ERIAR) & ERIAR_Flag)
break;
}
if (len == 1) mask = (0xFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 2) mask = (0xFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 3) mask = (0xFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else mask = (0xFFFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
value1 = RTL_R32(ERIDR) & mask;
value2 |= (value1 >> val_shift * 8) << shift * 8;
if (len <= 4 - val_shift) {
len = 0;
} else {
len -= (4 - val_shift);
shift = 4 - val_shift;
addr += 4;
}
}
udelay(20);
return value2;
}
u32 rtl8168_eri_read(void __iomem *ioaddr, int addr, int len, int type)
{
return rtl8168_eri_read_with_oob_base_address(ioaddr, addr, len, type, 0);
}
int rtl8168_eri_write_with_oob_base_address(void __iomem *ioaddr, int addr, int len, u32 value, int type, const u32 base_address)
{
int i, val_shift, shift = 0;
u32 value1 = 0, mask;
u32 eri_cmd;
const u32 transformed_base_address = ((base_address & 0x00FFF000) << 6) | (base_address & 0x000FFF);
if (len > 4 || len <= 0)
return -1;
while (len > 0) {
val_shift = addr % ERIAR_Addr_Align;
addr = addr & ~0x3;
if (len == 1) mask = (0xFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 2) mask = (0xFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else if (len == 3) mask = (0xFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
else mask = (0xFFFFFFFF << (val_shift * 8)) & 0xFFFFFFFF;
value1 = rtl8168_eri_read_with_oob_base_address(ioaddr, addr, 4, type, base_address) & ~mask;
value1 |= ((value << val_shift * 8) >> shift * 8);
RTL_W32(ERIDR, value1);
eri_cmd = ERIAR_Write |
transformed_base_address |
type << ERIAR_Type_shift |
ERIAR_ByteEn << ERIAR_ByteEn_shift |
(addr & 0x0FFF);
if (addr & 0xF000) {
u32 tmp;
tmp = addr & 0xF000;
tmp >>= 12;
eri_cmd |= (tmp << 20) & 0x00F00000;
}
RTL_W32(ERIAR, eri_cmd);
for (i = 0; i < 10; i++) {
udelay(100);
/* Check if the RTL8168 has completed ERI write */
if (!(RTL_R32(ERIAR) & ERIAR_Flag))
break;
}
if (len <= 4 - val_shift) {
len = 0;
} else {
len -= (4 - val_shift);
shift = 4 - val_shift;
addr += 4;
}
}
udelay(20);
return 0;
}
int rtl8168_eri_write(void __iomem *ioaddr, int addr, int len, u32 value, int type)
{
return rtl8168_eri_write_with_oob_base_address(ioaddr, addr, len, value, type, NO_BASE_ADDRESS);
}
static void
rtl8168_enable_rxdvgate(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_3);
mdelay(2);
break;
}
}
static void
rtl8168_disable_rxdvgate(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W8(0xF2, RTL_R8(0xF2) & ~BIT_3);
mdelay(2);
break;
}
}
static u8
rtl8168_is_gpio_low(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u8 gpio_low = FALSE;
switch (tp->HwSuppCheckPhyDisableModeVer) {
case 1:
case 2:
if (!(mac_ocp_read(tp, 0xDC04) & BIT_9))
gpio_low = TRUE;
break;
case 3:
if (!(mac_ocp_read(tp, 0xDC04) & BIT_13))
gpio_low = TRUE;
break;
}
if (gpio_low)
dprintk("gpio is low.\n");
return gpio_low;
}
static u8
rtl8168_is_phy_disable_mode_enabled(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u8 phy_disable_mode_enabled = FALSE;
switch (tp->HwSuppCheckPhyDisableModeVer) {
case 1:
if (mac_ocp_read(tp, 0xDC20) & BIT_1)
phy_disable_mode_enabled = TRUE;
break;
case 2:
case 3:
if (RTL_R8(0xF2) & BIT_5)
phy_disable_mode_enabled = TRUE;
break;
}
if (phy_disable_mode_enabled)
dprintk("phy disable mode enabled.\n");
return phy_disable_mode_enabled;
}
static u8
rtl8168_is_in_phy_disable_mode(struct net_device *dev)
{
u8 in_phy_disable_mode = FALSE;
if (rtl8168_is_phy_disable_mode_enabled(dev) && rtl8168_is_gpio_low(dev))
in_phy_disable_mode = TRUE;
if (in_phy_disable_mode)
dprintk("Hardware is in phy disable mode.\n");
return in_phy_disable_mode;
}
static void
rtl8168_enable_phy_disable_mode(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->HwSuppCheckPhyDisableModeVer) {
case 1:
mac_ocp_write(tp, 0xDC20, mac_ocp_read(tp, 0xDC20) | BIT_1);
break;
case 2:
case 3:
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_5);
break;
}
dprintk("enable phy disable mode.\n");
}
static void
rtl8168_disable_phy_disable_mode(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->HwSuppCheckPhyDisableModeVer) {
case 1:
mac_ocp_write(tp, 0xDC20, mac_ocp_read(tp, 0xDC20) & ~BIT_1);
break;
case 2:
case 3:
RTL_W8(0xF2, RTL_R8(0xF2) & ~BIT_5);
break;
}
mdelay(1);
dprintk("disable phy disable mode.\n");
}
void
rtl8168_wait_txrx_fifo_empty(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int i;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
for (i = 0; i < 10; i++) {
udelay(100);
if (RTL_R32(TxConfig) & BIT_11)
break;
}
for (i = 0; i < 10; i++) {
udelay(100);
if ((RTL_R8(MCUCmd_reg) & (Txfifo_empty | Rxfifo_empty)) == (Txfifo_empty | Rxfifo_empty))
break;
}
break;
}
}
#ifdef ENABLE_DASH_SUPPORT
inline void
rtl8168_enable_dash2_interrupt(struct rtl8168_private *tp, void __iomem *ioaddr)
{
if (!tp->DASH) return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
RTL_CMAC_W8(CMAC_IBIMR0, ( ISRIMR_DASH_TYPE2_ROK | ISRIMR_DASH_TYPE2_TOK | ISRIMR_DASH_TYPE2_TDU | ISRIMR_DASH_TYPE2_RDU | ISRIMR_DASH_TYPE2_RX_DISABLE_IDLE ));
}
}
static inline void
rtl8168_disable_dash2_interrupt(struct rtl8168_private *tp, void __iomem *ioaddr)
{
if (!tp->DASH) return;
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
RTL_CMAC_W8(CMAC_IBIMR0, 0);
}
}
#endif
static inline void
rtl8168_enable_hw_interrupt(struct rtl8168_private *tp, void __iomem *ioaddr)
{
RTL_W16(IntrMask, tp->intr_mask);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH)
rtl8168_enable_dash2_interrupt(tp, ioaddr);
#endif
}
static inline void
rtl8168_disable_hw_interrupt(struct rtl8168_private *tp, void __iomem *ioaddr)
{
RTL_W16(IntrMask, 0x0000);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH)
rtl8168_disable_dash2_interrupt(tp, ioaddr);
#endif
}
static inline void
rtl8168_switch_to_hw_interrupt(struct rtl8168_private *tp, void __iomem *ioaddr)
{
RTL_W32(TimeInt0, 0x0000);
rtl8168_enable_hw_interrupt(tp, ioaddr);
}
static inline void
rtl8168_switch_to_timer_interrupt(struct rtl8168_private *tp, void __iomem *ioaddr)
{
if (tp->use_timer_interrrupt) {
RTL_W32(TCTR, timer_count);
RTL_W32(TimeInt0, timer_count);
RTL_W16(IntrMask, tp->timer_intr_mask);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH)
rtl8168_enable_dash2_interrupt(tp, ioaddr);
#endif
} else {
rtl8168_switch_to_hw_interrupt(tp, ioaddr);
}
}
static void
rtl8168_irq_mask_and_ack(struct rtl8168_private *tp, void __iomem *ioaddr)
{
rtl8168_disable_hw_interrupt(tp, ioaddr);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH) {
if (tp->dash_printer_enabled) {
RTL_W16(IntrStatus, RTL_R16(IntrStatus) &
~(ISRIMR_DASH_INTR_EN | ISRIMR_DASH_INTR_CMAC_RESET));
} else {
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
RTL_CMAC_W8(CMAC_IBISR0, RTL_CMAC_R8(CMAC_IBISR0));
}
}
} else {
RTL_W16(IntrStatus, RTL_R16(IntrStatus));
}
#else
RTL_W16(IntrStatus, RTL_R16(IntrStatus));
#endif
}
static void
rtl8168_nic_reset(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int i;
RTL_W32(RxConfig, (RX_DMA_BURST << RxCfgDMAShift));
rtl8168_enable_rxdvgate(dev);
rtl8168_wait_txrx_fifo_empty(dev);
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
mdelay(10);
break;
case CFG_METHOD_4:
case CFG_METHOD_5:
case CFG_METHOD_6:
case CFG_METHOD_7:
case CFG_METHOD_8:
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_14:
case CFG_METHOD_15:
RTL_W8(ChipCmd, StopReq | CmdRxEnb | CmdTxEnb);
udelay(100);
break;
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
while (RTL_R8(TxPoll) & NPQ)
udelay(20);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mdelay(2);
break;
default:
mdelay(10);
break;
}
/* Soft reset the chip. */
RTL_W8(ChipCmd, CmdReset);
/* Check that the chip has finished the reset. */
for (i = 100; i > 0; i--) {
udelay(100);
if ((RTL_R8(ChipCmd) & CmdReset) == 0)
break;
}
switch (tp->mcfg) {
case CFG_METHOD_11:
OOB_mutex_lock(tp);
OCP_write(tp, 0x10, 2, OCP_read(tp, 0x010, 2)&~0x00004000);
OOB_mutex_unlock(tp);
OOB_notify(tp, OOB_CMD_RESET);
for (i = 0; i < 10; i++) {
mdelay(10);
if (OCP_read(tp, 0x010, 2)&0x00004000)
break;
}
for (i = 0; i < 5; i++) {
if ( OCP_read(tp, 0x034, 1) == 0)
break;
}
break;
}
}
static void
rtl8168_hw_clear_timer_int(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
RTL_W32(TimeInt0, 0x0000);
switch (tp->mcfg) {
case CFG_METHOD_4:
case CFG_METHOD_5:
case CFG_METHOD_6:
case CFG_METHOD_7:
case CFG_METHOD_8:
RTL_W32(TimeInt1, 0x0000);
break;
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W32(TimeInt1, 0x0000);
RTL_W32(TimeInt2, 0x0000);
RTL_W32(TimeInt3, 0x0000);
break;
}
}
static void
rtl8168_hw_reset(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
/* Disable interrupts */
rtl8168_irq_mask_and_ack(tp, ioaddr);
rtl8168_hw_clear_timer_int(dev);
rtl8168_nic_reset(dev);
}
static void rtl8168_mac_loopback_test(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
struct net_device *dev = tp->dev;
struct sk_buff *skb, *rx_skb;
dma_addr_t mapping;
struct TxDesc *txd;
struct RxDesc *rxd;
void *tmpAddr;
u32 len, rx_len, rx_cmd;
u16 type;
u8 pattern;
int i;
if (tp->DASH)
return;
pattern = 0x5A;
len = 60;
type = htons(ETH_P_IP);
txd = tp->TxDescArray;
rxd = tp->RxDescArray;
rx_skb = tp->Rx_skbuff[0];
RTL_W32(TxConfig, (RTL_R32(TxConfig) & ~0x00060000) | 0x00020000);
do {
skb = dev_alloc_skb(len + RTK_RX_ALIGN);
if (unlikely(!skb))
dev_printk(KERN_NOTICE, &tp->pci_dev->dev, "-ENOMEM;\n");
} while (unlikely(skb == NULL));
skb_reserve(skb, RTK_RX_ALIGN);
memcpy(skb_put(skb, dev->addr_len), dev->dev_addr, dev->addr_len);
memcpy(skb_put(skb, dev->addr_len), dev->dev_addr, dev->addr_len);
memcpy(skb_put(skb, sizeof(type)), &type, sizeof(type));
tmpAddr = skb_put(skb, len - 14);
mapping = pci_map_single(tp->pci_dev, skb->data, len, PCI_DMA_TODEVICE);
pci_dma_sync_single_for_cpu(tp->pci_dev, le64_to_cpu(mapping),
len, PCI_DMA_TODEVICE);
txd->addr = cpu_to_le64(mapping);
txd->opts2 = 0;
while (1) {
memset(tmpAddr, pattern++, len - 14);
pci_dma_sync_single_for_device(tp->pci_dev,
le64_to_cpu(mapping),
len, PCI_DMA_TODEVICE);
txd->opts1 = cpu_to_le32(DescOwn | FirstFrag | LastFrag | len);
RTL_W32(RxConfig, RTL_R32(RxConfig) | AcceptMyPhys);
smp_wmb();
RTL_W8(TxPoll, NPQ); /* set polling bit */
for (i = 0; i < 50; i++) {
udelay(200);
rx_cmd = le32_to_cpu(rxd->opts1);
if ((rx_cmd & DescOwn) == 0)
break;
}
RTL_W32(RxConfig, RTL_R32(RxConfig) & ~(AcceptErr | AcceptRunt | AcceptBroadcast | AcceptMulticast | AcceptMyPhys | AcceptAllPhys));
rx_len = rx_cmd & 0x3FFF;
rx_len -= 4;
rxd->opts1 = cpu_to_le32(DescOwn | tp->rx_buf_sz);
pci_dma_sync_single_for_cpu(tp->pci_dev, le64_to_cpu(mapping), len, PCI_DMA_TODEVICE);
if (rx_len == len) {
pci_dma_sync_single_for_cpu(tp->pci_dev, le64_to_cpu(rxd->addr), tp->rx_buf_sz, PCI_DMA_FROMDEVICE);
i = memcmp(skb->data, rx_skb->data, rx_len);
pci_dma_sync_single_for_device(tp->pci_dev, le64_to_cpu(rxd->addr), tp->rx_buf_sz, PCI_DMA_FROMDEVICE);
if (i == 0) {
// dev_printk(KERN_INFO, &tp->pci_dev->dev, "loopback test finished\n",rx_len,len);
break;
}
}
rtl8168_hw_reset(dev);
rtl8168_disable_rxdvgate(dev);
RTL_W8(ChipCmd, CmdTxEnb | CmdRxEnb);
}
tp->dirty_tx++;
tp->dirty_rx++;
tp->cur_tx++;
tp->cur_rx++;
pci_unmap_single(tp->pci_dev, le64_to_cpu(mapping),
len, PCI_DMA_TODEVICE);
RTL_W32(TxConfig, RTL_R32(TxConfig) & ~0x00060000);
dev_kfree_skb_any(skb);
RTL_W16(IntrStatus, 0xFFBF);
}
static unsigned int
rtl8168_xmii_reset_pending(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int retval;
unsigned long flags;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1f, 0x0000);
retval = mdio_read(tp, MII_BMCR) & BMCR_RESET;
spin_unlock_irqrestore(&tp->phy_lock, flags);
return retval;
}
static unsigned int
rtl8168_xmii_link_ok(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned int retval;
retval = (RTL_R8(PHYstatus) & LinkStatus) ? 1 : 0;
return retval;
}
static void
rtl8168_xmii_reset_enable(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
int i, val = 0;
unsigned long flags;
spin_lock_irqsave(&tp->phy_lock, flags);
if (rtl8168_is_in_phy_disable_mode(dev)) {
spin_unlock_irqrestore(&tp->phy_lock, flags);
return;
}
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, MII_ADVERTISE, mdio_read(tp, MII_ADVERTISE) &
~(ADVERTISE_10HALF | ADVERTISE_10FULL |
ADVERTISE_100HALF | ADVERTISE_100FULL));
mdio_write(tp, MII_CTRL1000, mdio_read(tp, MII_CTRL1000) &
~(ADVERTISE_1000HALF | ADVERTISE_1000FULL));
mdio_write(tp, MII_BMCR, BMCR_RESET | BMCR_ANENABLE);
for (i = 0; i < 2500; i++) {
val = mdio_read(tp, MII_BMCR) & BMCR_RESET;
if (!val) {
spin_unlock_irqrestore(&tp->phy_lock, flags);
return;
}
mdelay(1);
}
spin_unlock_irqrestore(&tp->phy_lock, flags);
if (netif_msg_link(tp))
printk(KERN_ERR "%s: PHY reset failed.\n", dev->name);
}
static void
rtl8168dp_10mbps_gphy_para(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u8 status = RTL_R8(PHYstatus);
unsigned long flags;
spin_lock_irqsave(&tp->phy_lock, flags);
if ((status & LinkStatus) && (status & _10bps)) {
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x10, 0x04EE);
} else {
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x10, 0x01EE);
}
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
void rtl8168_init_ring_indexes(struct rtl8168_private *tp)
{
tp->dirty_tx = 0;
tp->dirty_rx = 0;
tp->cur_tx = 0;
tp->cur_rx = 0;
}
static void
rtl8168_issue_offset_99_event(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_27:
case CFG_METHOD_28:
if (tp->mcfg == CFG_METHOD_24 || tp->mcfg == CFG_METHOD_25 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28) {
rtl8168_eri_write(ioaddr, 0x3FC, 4, 0x00000000, ERIAR_ExGMAC);
} else {
rtl8168_eri_write(ioaddr, 0x3FC, 4, 0x083C083C, ERIAR_ExGMAC);
}
csi_tmp = rtl8168_eri_read(ioaddr, 0x3F8, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x3F8, 1, csi_tmp, ERIAR_ExGMAC);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1EA, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x1EA, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
}
#ifdef ENABLE_DASH_SUPPORT
static void
NICChkTypeEnableDashInterrupt(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if (tp->DASH) {
//
// even disconnected, enable 3 dash interrupt mask bits for in-band/out-band communication
//
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
rtl8168_enable_dash2_interrupt(tp, ioaddr);
RTL_W16(IntrMask, (ISRIMR_DASH_INTR_EN | ISRIMR_DASH_INTR_CMAC_RESET));
} else {
RTL_W16(IntrMask, (ISRIMR_DP_DASH_OK | ISRIMR_DP_HOST_OK | ISRIMR_DP_REQSYS_OK));
}
}
}
#endif
static void
rtl8168_check_link_status(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int link_status_on;
unsigned long flags;
link_status_on = tp->link_ok(dev);
if (tp->mcfg == CFG_METHOD_11)
rtl8168dp_10mbps_gphy_para(dev);
if (netif_carrier_ok(dev) != link_status_on) {
if (link_status_on) {
/*
* rtl8168_hw_config() is called in rtl8168_open(),
* so skip it if this first linkup attempt after
* interface up. This flag doesn't need synchronization
* because the link_status timer starts at the end of
* rtl8168_open() and timer is destroyed in
* rtl8168_down().
*/
if (!tp->first_link_up)
rtl8168_hw_config(dev);
else
tp->first_link_up = false;
/*
* FIFO overrun errors are observed when ASPM is enabled
* and flow control is disabled. This is causing perf
* drop. So disable ASPM if flow control is disabled.
*/
if (aspm && ((RTL_R8(PHYstatus) & (TxFlowCtrl | RxFlowCtrl)) !=
(TxFlowCtrl | RxFlowCtrl)))
pci_disable_link_state(tp->pci_dev, PCIE_LINK_STATE_L0S |
PCIE_LINK_STATE_L1 | PCIE_LINK_STATE_CLKPM);
if (tp->mcfg == CFG_METHOD_18 || tp->mcfg == CFG_METHOD_19 || tp->mcfg == CFG_METHOD_20) {
if (RTL_R8(PHYstatus) & _1000bpsF) {
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x00000011, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x0000001f, ERIAR_ExGMAC);
} else if (RTL_R8(PHYstatus) & _100bps) {
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x0000001f, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x0000001f, ERIAR_ExGMAC);
} else {
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x0000001f, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x0000002d, ERIAR_ExGMAC);
}
} else if ((tp->mcfg == CFG_METHOD_16 || tp->mcfg == CFG_METHOD_17) && netif_running(dev)) {
if (tp->mcfg == CFG_METHOD_16 && (RTL_R8(PHYstatus) & _10bps)) {
RTL_W32(RxConfig, RTL_R32(RxConfig) | AcceptAllPhys);
} else if (tp->mcfg == CFG_METHOD_17) {
if (RTL_R8(PHYstatus) & _1000bpsF) {
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x00000011, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x00000005, ERIAR_ExGMAC);
} else if (RTL_R8(PHYstatus) & _100bps) {
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x0000001f, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x00000005, ERIAR_ExGMAC);
} else {
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x0000001f, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x0000003f, ERIAR_ExGMAC);
}
}
} else if ((tp->mcfg == CFG_METHOD_14 || tp->mcfg == CFG_METHOD_15) && eee_enable ==1) {
/*Full -Duplex mode*/
if (RTL_R8(PHYstatus)&FullDup) {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0006);
mdio_write(tp, 0x00, 0x5a30);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
if (RTL_R8(PHYstatus) & (_10bps | _100bps))
RTL_W32(TxConfig, (RTL_R32(TxConfig) & ~BIT_19) | BIT_25);
} else {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0006);
mdio_write(tp, 0x00, 0x5a00);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
if (RTL_R8(PHYstatus) & (_10bps | _100bps))
RTL_W32(TxConfig, (RTL_R32(TxConfig) & ~BIT_19) | (InterFrameGap << TxInterFrameGapShift));
}
} else if ((tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 || tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) &&
netif_running(dev)) {
if (RTL_R8(PHYstatus)&FullDup)
RTL_W32(TxConfig, (RTL_R32(TxConfig) | (BIT_24 | BIT_25)) & ~BIT_19);
else
RTL_W32(TxConfig, (RTL_R32(TxConfig) | BIT_25) & ~(BIT_19 | BIT_24));
}
if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
/*half mode*/
if (!(RTL_R8(PHYstatus)&FullDup)) {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, MII_ADVERTISE, mdio_read(tp, MII_ADVERTISE)&~(ADVERTISE_PAUSE_CAP|ADVERTISE_PAUSE_ASYM));
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
}
if ((tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) && (RTL_R8(PHYstatus) & _10bps)) {
u32 csi_tmp;
csi_tmp = rtl8168_eri_read(ioaddr, 0x1D0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_1;
rtl8168_eri_write(ioaddr, 0x1D0, 1, csi_tmp, ERIAR_ExGMAC);
}
rtl8168_hw_start(dev);
netif_carrier_on(dev);
netif_wake_queue(dev);
if (netif_msg_ifup(tp))
printk(KERN_INFO PFX "%s: link up\n", dev->name);
} else {
if (netif_msg_ifdown(tp))
printk(KERN_INFO PFX "%s: link down\n", dev->name);
netif_stop_queue(dev);
netif_carrier_off(dev);
rtl8168_hw_reset(dev);
rtl8168_tx_clear(tp);
rtl8168_rx_clear(tp);
rtl8168_init_ring(dev);
rtl8168_set_speed(dev, tp->autoneg, tp->speed, tp->duplex);
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_27:
case CFG_METHOD_28:
if (tp->org_pci_offset_99 & BIT_2)
tp->issue_offset_99_event = TRUE;
break;
}
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH) {
NICChkTypeEnableDashInterrupt(tp);
}
#endif
/* Enable ASPM during eth link down. */
if (aspm)
pci_enable_link_state(tp->pci_dev, PCIE_LINK_STATE_L1);
}
}
if (!link_status_on) {
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_27:
case CFG_METHOD_28:
if (tp->issue_offset_99_event) {
if (!(RTL_R8(PHYstatus) & PowerSaveStatus)) {
tp->issue_offset_99_event = FALSE;
rtl8168_issue_offset_99_event(tp);
}
}
break;
}
}
}
static void
rtl8168_link_option(u8 *aut,
u16 *spd,
u8 *dup)
{
if ((*spd != SPEED_1000) && (*spd != SPEED_100) && (*spd != SPEED_10))
*spd = SPEED_1000;
if ((*dup != DUPLEX_FULL) && (*dup != DUPLEX_HALF))
*dup = DUPLEX_FULL;
if ((*aut != AUTONEG_ENABLE) && (*aut != AUTONEG_DISABLE))
*aut = AUTONEG_ENABLE;
}
void
rtl8168_wait_ll_share_fifo_ready(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int i;
for (i = 0; i < 10; i++) {
udelay(100);
if (RTL_R16(0xD2) & BIT_9)
break;
}
}
static void
rtl8168_disable_pci_offset_99(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
csi_tmp = rtl8168_eri_read(ioaddr, 0x3F2, 2, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_0 | BIT_1);
rtl8168_eri_write(ioaddr, 0x3F2, 2, csi_tmp, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_csi_fun0_write_byte(tp, 0x99, 0x00);
break;
}
}
static void
rtl8168_enable_pci_offset_99(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_csi_fun0_write_byte(tp, 0x99, tp->org_pci_offset_99);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
csi_tmp = rtl8168_eri_read(ioaddr, 0x3F2, 2, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_0 | BIT_1);
if (!(tp->org_pci_offset_99 & (BIT_5 | BIT_6)))
csi_tmp |= BIT_1;
if (!(tp->org_pci_offset_99 & BIT_2))
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x3F2, 2, csi_tmp, ERIAR_ExGMAC);
break;
}
}
static void
rtl8168_init_pci_offset_99(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_26:
if (tp->org_pci_offset_99 & BIT_2) {
csi_tmp = rtl8168_eri_read(ioaddr, 0x5C2, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_1;
rtl8168_eri_write(ioaddr, 0x5C2, 1, csi_tmp, ERIAR_ExGMAC);
}
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
csi_tmp = rtl8168_eri_read(ioaddr, 0x3F2, 2, ERIAR_ExGMAC);
csi_tmp &= ~( BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12 | BIT_13 | BIT_14 | BIT_15 );
csi_tmp |= ( BIT_9 | BIT_10 | BIT_13 | BIT_14 | BIT_15 );
rtl8168_eri_write(ioaddr, 0x3F2, 2, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x3F5, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_6 | BIT_7;
rtl8168_eri_write(ioaddr, 0x3F5, 1, csi_tmp, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xE02C, 0x1880);
mac_ocp_write(tp, 0xE02E, 0x4880);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_26:
rtl8168_eri_write(ioaddr, 0x5C0, 1, 0xFA, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_26:
if (tp->org_pci_offset_99 & BIT_2) {
csi_tmp = rtl8168_eri_read(ioaddr, 0x5C8, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x5C8, 1, csi_tmp, ERIAR_ExGMAC);
}
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
if (tp->org_pci_offset_99 & BIT_2)
mac_ocp_write(tp, 0xE0A2, mac_ocp_read(tp, 0xE0A2) | BIT_0);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_23:
rtl8168_eri_write(ioaddr, 0x2E8, 2, 0x883C, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2EA, 2, 0x8C12, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2EC, 2, 0x9003, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2E2, 2, 0x883C, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2E4, 2, 0x8C12, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2E6, 2, 0x9003, ERIAR_ExGMAC);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_eri_write(ioaddr, 0x2E8, 2, 0x9003, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2EA, 2, 0x9003, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2EC, 2, 0x9003, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2E2, 2, 0x883C, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2E4, 2, 0x8C12, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x2E6, 2, 0x9003, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
csi_tmp = rtl8168_eri_read(ioaddr, 0x3FA, 2, ERIAR_ExGMAC);
csi_tmp |= BIT_14;
rtl8168_eri_write(ioaddr, 0x3FA, 2, csi_tmp, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
if (tp->org_pci_offset_99 & BIT_2)
RTL_W8(0xB6, RTL_R8(0xB6) | BIT_0);
break;
}
rtl8168_enable_pci_offset_99(tp);
}
static void
rtl8168_disable_pci_offset_180(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1E2, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_2;
rtl8168_eri_write(ioaddr, 0x1E2, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_26:
rtl8168_eri_write(ioaddr, 0x1E9, 1, 0x0A, ERIAR_ExGMAC);
break;
}
}
static void
rtl8168_enable_pci_offset_180(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_25:
case CFG_METHOD_28:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1E8, 4, ERIAR_ExGMAC);
csi_tmp &= ~(0x0000FF00);
csi_tmp |= (0x00006400);
rtl8168_eri_write(ioaddr, 0x1E8, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1E4, 4, ERIAR_ExGMAC);
csi_tmp &= ~(0x0000FF00);
rtl8168_eri_write(ioaddr, 0x1E4, 4, csi_tmp, ERIAR_ExGMAC);
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1E8, 4, ERIAR_ExGMAC);
csi_tmp &= ~(0x0000FFF0);
csi_tmp |= (0x00000640);
rtl8168_eri_write(ioaddr, 0x1E8, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1E4, 4, ERIAR_ExGMAC);
csi_tmp &= ~(0x0000FF00);
rtl8168_eri_write(ioaddr, 0x1E4, 4, csi_tmp, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1E2, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_2;
rtl8168_eri_write(ioaddr, 0x1E2, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_26:
rtl8168_eri_write(ioaddr, 0x1E9, 1, 0x64, ERIAR_ExGMAC);
break;
}
mac_ocp_write(tp, 0xE094, 0x0000);
}
static void
rtl8168_init_pci_offset_180(struct rtl8168_private *tp)
{
if (tp->org_pci_offset_180 & (BIT_0|BIT_1))
rtl8168_enable_pci_offset_180(tp);
else
rtl8168_disable_pci_offset_180(tp);
}
static void
rtl8168_set_pci_99_180_exit_driver_para(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_issue_offset_99_event(tp);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_disable_pci_offset_99(tp);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_disable_pci_offset_180(tp);
break;
}
}
static void
rtl8168_enable_cfg9346_write(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
RTL_W8(Cfg9346, RTL_R8(Cfg9346) | Cfg9346_Unlock);
}
static void
rtl8168_disable_cfg9346_write(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
RTL_W8(Cfg9346, RTL_R8(Cfg9346) & ~Cfg9346_Unlock);
}
static void
rtl8168_hw_d3_para(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
RTL_W16(RxMaxSize, RX_BUF_SIZE);
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
if (!aspm) {
RTL_W8(0xF1, RTL_R8(0xF1) & ~BIT_7);
rtl8168_enable_cfg9346_write(tp);
RTL_W8(Config2, RTL_R8(Config2) & ~BIT_7);
RTL_W8(Config5, RTL_R8(Config5) & ~BIT_0);
rtl8168_disable_cfg9346_write(tp);
}
break;
}
if (tp->mcfg == CFG_METHOD_18 || tp->mcfg == CFG_METHOD_19 || tp->mcfg == CFG_METHOD_20) {
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x0000001f, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x0000002d, ERIAR_ExGMAC);
spin_unlock_irqrestore(&tp->phy_lock, flags);
} else if (tp->mcfg == CFG_METHOD_16) {
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_eri_write(ioaddr, 0x1bc, 4, 0x0000001f, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0x1dc, 4, 0x0000003f, ERIAR_ExGMAC);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 || tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_eri_write(ioaddr, 0x2F8, 2, 0x0064, ERIAR_ExGMAC);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
if (tp->bios_setting & BIT_28) {
if (tp->mcfg == CFG_METHOD_18 || tp->mcfg == CFG_METHOD_19 ||
tp->mcfg == CFG_METHOD_20) {
u32 gphy_val;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x04, 0x0061);
mdio_write(tp, 0x09, 0x0000);
mdio_write(tp, 0x00, 0x9200);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B80);
gphy_val = mdio_read(tp, 0x06);
gphy_val &= ~BIT_7;
mdio_write(tp, 0x06, gphy_val);
mdelay(1);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002C);
gphy_val = mdio_read(tp, 0x16);
gphy_val &= ~BIT_10;
mdio_write(tp, 0x16, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
}
if (tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_csi_set_dash_other_fun(tp, 0x44, 0x00, (BIT_0 | BIT_1), TRUE);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
rtl8168_set_pci_99_180_exit_driver_para(dev);
/*disable ocp phy power saving*/
if (tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write_phy_ocp(tp, 0x0C41, 0x13, 0x0000);
mdio_write_phy_ocp(tp, 0x0C41, 0x13, 0x0500);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
rtl8168_disable_rxdvgate(dev);
}
static void
rtl8168_enable_magic_packet(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->HwSuppMagicPktVer) {
case WAKEUP_MAGIC_PACKET_V1:
rtl8168_enable_cfg9346_write(tp);
RTL_W8(Config3, RTL_R8(Config3) | MagicPacket);
rtl8168_disable_cfg9346_write(tp);
break;
case WAKEUP_MAGIC_PACKET_V2:
csi_tmp = rtl8168_eri_read(ioaddr, 0xDE, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDE, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
}
static void
rtl8168_disable_magic_packet(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
switch (tp->HwSuppMagicPktVer) {
case WAKEUP_MAGIC_PACKET_V1:
rtl8168_enable_cfg9346_write(tp);
RTL_W8(Config3, RTL_R8(Config3) & ~MagicPacket);
rtl8168_disable_cfg9346_write(tp);
break;
case WAKEUP_MAGIC_PACKET_V2:
csi_tmp = rtl8168_eri_read(ioaddr, 0xDE, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDE, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
}
#define WAKE_ANY (WAKE_PHY | WAKE_MAGIC | WAKE_UCAST | WAKE_BCAST | WAKE_MCAST)
static void
rtl8168_get_hw_wol(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u8 options;
u32 csi_tmp;
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
tp->wol_opts = 0;
options = RTL_R8(Config1);
if (!(options & PMEnable))
goto out_unlock;
options = RTL_R8(Config3);
if (options & LinkUp)
tp->wol_opts |= WAKE_PHY;
switch (tp->HwSuppMagicPktVer) {
case WAKEUP_MAGIC_PACKET_V2:
csi_tmp = rtl8168_eri_read(ioaddr, 0xDE, 1, ERIAR_ExGMAC);
if (csi_tmp & BIT_0)
tp->wol_opts |= WAKE_MAGIC;
break;
default:
if (options & MagicPacket)
tp->wol_opts |= WAKE_MAGIC;
break;
}
options = RTL_R8(Config5);
if (options & UWF)
tp->wol_opts |= WAKE_UCAST;
if (options & BWF)
tp->wol_opts |= WAKE_BCAST;
if (options & MWF)
tp->wol_opts |= WAKE_MCAST;
out_unlock:
tp->wol_enabled = (tp->wol_opts) ? WOL_ENABLED : WOL_DISABLED;
spin_unlock_irqrestore(&tp->lock, flags);
}
static void
rtl8168_set_hw_wol(struct net_device *dev, u32 wolopts)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int i,tmp;
static struct {
u32 opt;
u16 reg;
u8 mask;
} cfg[] = {
{ WAKE_PHY, Config3, LinkUp },
{ WAKE_UCAST, Config5, UWF },
{ WAKE_BCAST, Config5, BWF },
{ WAKE_MCAST, Config5, MWF },
{ WAKE_ANY, Config5, LanWake },
{ WAKE_MAGIC, Config3, MagicPacket },
};
switch (tp->HwSuppMagicPktVer) {
case WAKEUP_MAGIC_PACKET_V2:
tmp = ARRAY_SIZE(cfg) - 1;
if (wolopts & WAKE_MAGIC)
rtl8168_enable_magic_packet(dev);
else
rtl8168_disable_magic_packet(dev);
break;
default:
tmp = ARRAY_SIZE(cfg);
break;
}
rtl8168_enable_cfg9346_write(tp);
for (i = 0; i < tmp; i++) {
u8 options = RTL_R8(cfg[i].reg) & ~cfg[i].mask;
if (wolopts & cfg[i].opt)
options |= cfg[i].mask;
RTL_W8(cfg[i].reg, options);
}
rtl8168_disable_cfg9346_write(tp);
}
static void
rtl8168_phy_restart_nway(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
if (rtl8168_is_in_phy_disable_mode(dev)) return;
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, MII_BMCR, BMCR_RESET | BMCR_ANENABLE | BMCR_ANRESTART);
}
static void
rtl8168_phy_setup_force_mode(struct net_device *dev, u32 speed, u8 duplex)
{
struct rtl8168_private *tp = netdev_priv(dev);
u16 bmcr_true_force = 0;
if (rtl8168_is_in_phy_disable_mode(dev)) return;
#ifndef BMCR_SPEED100
#define BMCR_SPEED100 0x0040
#endif
#ifndef BMCR_SPEED10
#define BMCR_SPEED10 0x0000
#endif
if ((speed == SPEED_10) && (duplex == DUPLEX_HALF)) {
bmcr_true_force = BMCR_SPEED10;
} else if ((speed == SPEED_10) && (duplex == DUPLEX_FULL)) {
bmcr_true_force = BMCR_SPEED10 | BMCR_FULLDPLX;
} else if ((speed == SPEED_100) && (duplex == DUPLEX_HALF)) {
bmcr_true_force = BMCR_SPEED100;
} else if ((speed == SPEED_100) && (duplex == DUPLEX_FULL)) {
bmcr_true_force = BMCR_SPEED100 | BMCR_FULLDPLX;
} else {
netif_err(tp, drv, dev, "Failed to set phy force mode!\n");
return;
}
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, MII_BMCR, bmcr_true_force);
}
static void
rtl8168_powerdown_pll(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
if (tp->wol_enabled == WOL_ENABLED || tp->DASH || tp->EnableKCPOffload) {
int auto_nego;
int giga_ctrl;
u16 val;
unsigned long flags;
rtl8168_set_hw_wol(dev, tp->wol_opts);
if (tp->mcfg == CFG_METHOD_16 || tp->mcfg == CFG_METHOD_17 ||
tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_24 || tp->mcfg == CFG_METHOD_25 ||
tp->mcfg == CFG_METHOD_26 || tp->mcfg == CFG_METHOD_23 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
rtl8168_enable_cfg9346_write(tp);
RTL_W8(Config2, RTL_R8(Config2) | PMSTS_En);
rtl8168_disable_cfg9346_write(tp);
}
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
auto_nego = mdio_read(tp, MII_ADVERTISE);
auto_nego &= ~(ADVERTISE_10HALF | ADVERTISE_10FULL
| ADVERTISE_100HALF | ADVERTISE_100FULL);
val = mdio_read(tp, MII_LPA);
#ifdef CONFIG_DOWN_SPEED_100
auto_nego |= (ADVERTISE_100FULL | ADVERTISE_100HALF | ADVERTISE_10HALF | ADVERTISE_10FULL);
#else
if (val & (LPA_10HALF | LPA_10FULL))
auto_nego |= (ADVERTISE_10HALF | ADVERTISE_10FULL);
else
auto_nego |= (ADVERTISE_100FULL | ADVERTISE_100HALF | ADVERTISE_10HALF | ADVERTISE_10FULL);
#endif
if (tp->DASH)
auto_nego |= (ADVERTISE_100FULL | ADVERTISE_100HALF | ADVERTISE_10HALF | ADVERTISE_10FULL);
if (((tp->mcfg == CFG_METHOD_7) || (tp->mcfg == CFG_METHOD_8)) && (RTL_R16(CPlusCmd) & ASF))
auto_nego |= (ADVERTISE_100FULL | ADVERTISE_100HALF | ADVERTISE_10HALF | ADVERTISE_10FULL);
giga_ctrl = mdio_read(tp, MII_CTRL1000) & ~(ADVERTISE_1000HALF | ADVERTISE_1000FULL);
mdio_write(tp, MII_ADVERTISE, auto_nego);
mdio_write(tp, MII_CTRL1000, giga_ctrl);
rtl8168_phy_restart_nway(dev);
spin_unlock_irqrestore(&tp->phy_lock, flags);
RTL_W32(RxConfig, RTL_R32(RxConfig) | AcceptBroadcast | AcceptMulticast | AcceptMyPhys);
return;
}
if (tp->DASH)
return;
if (((tp->mcfg == CFG_METHOD_7) || (tp->mcfg == CFG_METHOD_8)) && (RTL_R16(CPlusCmd) & ASF))
return;
rtl8168_phy_power_down(dev);
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W8(PMCH, RTL_R8(PMCH) & ~BIT_7);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
RTL_W8(0xD0, RTL_R8(0xD0) & ~BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) & ~BIT_6);
break;
}
}
static void rtl8168_powerup_pll(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W8(PMCH, RTL_R8(PMCH) | BIT_7 | BIT_6);
break;
}
rtl8168_phy_power_up(dev);
}
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static void
rtl8168_get_wol(struct net_device *dev,
struct ethtool_wolinfo *wol)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u8 options;
unsigned long flags;
wol->wolopts = 0;
if (tp->mcfg == CFG_METHOD_DEFAULT) {
wol->supported = 0;
return;
} else {
wol->supported = WAKE_ANY;
}
spin_lock_irqsave(&tp->lock, flags);
options = RTL_R8(Config1);
if (!(options & PMEnable))
goto out_unlock;
wol->wolopts = tp->wol_opts;
out_unlock:
spin_unlock_irqrestore(&tp->lock, flags);
}
static int
rtl8168_set_wol(struct net_device *dev,
struct ethtool_wolinfo *wol)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
if (tp->mcfg == CFG_METHOD_DEFAULT)
return -EOPNOTSUPP;
spin_lock_irqsave(&tp->lock, flags);
tp->wol_opts = wol->wolopts;
tp->wol_enabled = (tp->wol_opts) ? WOL_ENABLED : WOL_DISABLED;
spin_unlock_irqrestore(&tp->lock, flags);
device_set_wakeup_enable(&tp->pci_dev->dev, wol->wolopts);
return 0;
}
static void
rtl8168_get_drvinfo(struct net_device *dev,
struct ethtool_drvinfo *info)
{
struct rtl8168_private *tp = netdev_priv(dev);
strcpy(info->driver, MODULENAME);
strcpy(info->version, RTL8168_VERSION);
strcpy(info->bus_info, pci_name(tp->pci_dev));
info->regdump_len = R8168_REGS_DUMP_SIZE;
info->eedump_len = tp->eeprom_len;
}
static int
rtl8168_get_regs_len(struct net_device *dev)
{
return R8168_REGS_DUMP_SIZE;
}
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static int
rtl8168_set_speed_xmii(struct net_device *dev,
u8 autoneg,
u32 speed,
u8 duplex)
{
struct rtl8168_private *tp = netdev_priv(dev);
int auto_nego = 0;
int giga_ctrl = 0;
unsigned long flags;
if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
//Disable Giga Lite
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A42);
ClearEthPhyBit(tp, 0x14, BIT_9);
mdio_write(tp, 0x1F, 0x0A40);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
if ((speed != SPEED_1000) &&
(speed != SPEED_100) &&
(speed != SPEED_10)) {
speed = SPEED_1000;
duplex = DUPLEX_FULL;
}
auto_nego = mdio_read(tp, MII_ADVERTISE);
auto_nego &= ~(ADVERTISE_10HALF | ADVERTISE_10FULL | ADVERTISE_100HALF | ADVERTISE_100FULL | ADVERTISE_PAUSE_CAP | ADVERTISE_PAUSE_ASYM);
giga_ctrl = mdio_read(tp, MII_CTRL1000);
giga_ctrl &= ~(ADVERTISE_1000HALF | ADVERTISE_1000FULL);
if ((autoneg == AUTONEG_ENABLE) || (speed == SPEED_1000)) {
/*n-way force*/
if ((speed == SPEED_10) && (duplex == DUPLEX_HALF)) {
auto_nego |= ADVERTISE_10HALF;
} else if ((speed == SPEED_10) && (duplex == DUPLEX_FULL)) {
auto_nego |= ADVERTISE_10HALF |
ADVERTISE_10FULL;
} else if ((speed == SPEED_100) && (duplex == DUPLEX_HALF)) {
auto_nego |= ADVERTISE_100HALF |
ADVERTISE_10HALF |
ADVERTISE_10FULL;
} else if ((speed == SPEED_100) && (duplex == DUPLEX_FULL)) {
auto_nego |= ADVERTISE_100HALF |
ADVERTISE_100FULL |
ADVERTISE_10HALF |
ADVERTISE_10FULL;
} else if (speed == SPEED_1000) {
giga_ctrl |= ADVERTISE_1000HALF |
ADVERTISE_1000FULL;
auto_nego |= ADVERTISE_100HALF |
ADVERTISE_100FULL |
ADVERTISE_10HALF |
ADVERTISE_10FULL;
}
//flow control
if (dev->mtu <= ETH_DATA_LEN)
auto_nego |= ADVERTISE_PAUSE_CAP|ADVERTISE_PAUSE_ASYM;
tp->phy_auto_nego_reg = auto_nego;
tp->phy_1000_ctrl_reg = giga_ctrl;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, MII_ADVERTISE, auto_nego);
mdio_write(tp, MII_CTRL1000, giga_ctrl);
rtl8168_phy_restart_nway(dev);
spin_unlock_irqrestore(&tp->phy_lock, flags);
mdelay(20);
} else {
/*true force*/
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_phy_setup_force_mode(dev, speed, duplex);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
tp->autoneg = autoneg;
tp->speed = speed;
tp->duplex = duplex;
if (tp->mcfg == CFG_METHOD_11)
rtl8168dp_10mbps_gphy_para(dev);
return 0;
}
static int
rtl8168_set_speed(struct net_device *dev,
u8 autoneg,
u32 speed,
u8 duplex)
{
struct rtl8168_private *tp = netdev_priv(dev);
int ret;
ret = tp->set_speed(dev, autoneg, speed, duplex);
return ret;
}
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static int
rtl8168_set_settings(struct net_device *dev,
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,6,0)
struct ethtool_cmd *cmd
#else
const struct ethtool_link_ksettings *cmd
#endif
)
{
struct rtl8168_private *tp = netdev_priv(dev);
int ret;
unsigned long flags;
u8 autoneg;
u32 speed;
u8 duplex;
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,6,0)
autoneg = cmd->autoneg;
speed = cmd->speed;
duplex = cmd->duplex;
#else
const struct ethtool_link_settings *base = &cmd->base;
autoneg = base->autoneg;
speed = base->speed;
duplex = base->duplex;
#endif
spin_lock_irqsave(&tp->lock, flags);
ret = rtl8168_set_speed(dev, autoneg, speed, duplex);
spin_unlock_irqrestore(&tp->lock, flags);
return ret;
}
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,3,0)
static u32
rtl8168_get_tx_csum(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u32 ret;
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
ret = ((dev->features & NETIF_F_IP_CSUM) != 0);
#else
ret = ((dev->features & (NETIF_F_IP_CSUM | NETIF_F_IPV6_CSUM)) != 0);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
spin_unlock_irqrestore(&tp->lock, flags);
return ret;
}
static u32
rtl8168_get_rx_csum(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u32 ret;
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
ret = tp->cp_cmd & RxChkSum;
spin_unlock_irqrestore(&tp->lock, flags);
return ret;
}
static int
rtl8168_set_tx_csum(struct net_device *dev,
u32 data)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
if (tp->mcfg == CFG_METHOD_DEFAULT)
return -EOPNOTSUPP;
spin_lock_irqsave(&tp->lock, flags);
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
if (data)
dev->features |= NETIF_F_IP_CSUM;
else
dev->features &= ~NETIF_F_IP_CSUM;
#else
if (data)
if ((tp->mcfg == CFG_METHOD_1) || (tp->mcfg == CFG_METHOD_2) || (tp->mcfg == CFG_METHOD_3))
dev->features |= NETIF_F_IP_CSUM;
else
dev->features |= (NETIF_F_IP_CSUM | NETIF_F_IPV6_CSUM);
else
dev->features &= ~(NETIF_F_IP_CSUM | NETIF_F_IPV6_CSUM);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
spin_unlock_irqrestore(&tp->lock, flags);
return 0;
}
static int
rtl8168_set_rx_csum(struct net_device *dev,
u32 data)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
if (tp->mcfg == CFG_METHOD_DEFAULT)
return -EOPNOTSUPP;
spin_lock_irqsave(&tp->lock, flags);
if (data)
tp->cp_cmd |= RxChkSum;
else
tp->cp_cmd &= ~RxChkSum;
RTL_W16(CPlusCmd, tp->cp_cmd);
spin_unlock_irqrestore(&tp->lock, flags);
return 0;
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(3,3,0)
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
#ifdef CONFIG_R8168_VLAN
static inline u32
rtl8168_tx_vlan_tag(struct rtl8168_private *tp,
struct sk_buff *skb)
{
u32 tag;
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
tag = (tp->vlgrp && vlan_tx_tag_present(skb)) ?
TxVlanTag | swab16(vlan_tx_tag_get(skb)) : 0x00;
#elif LINUX_VERSION_CODE < KERNEL_VERSION(4,0,0)
tag = (vlan_tx_tag_present(skb)) ?
TxVlanTag | swab16(vlan_tx_tag_get(skb)) : 0x00;
#else
tag = (skb_vlan_tag_present(skb)) ?
TxVlanTag | swab16(skb_vlan_tag_get(skb)) : 0x00;
#endif
return tag;
}
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
static void
rtl8168_vlan_rx_register(struct net_device *dev,
struct vlan_group *grp)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
tp->vlgrp = grp;
if (tp->vlgrp)
tp->cp_cmd |= RxVlan;
else
tp->cp_cmd &= ~RxVlan;
RTL_W16(CPlusCmd, tp->cp_cmd);
RTL_R16(CPlusCmd);
spin_unlock_irqrestore(&tp->lock, flags);
}
#endif
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,22)
static void
rtl8168_vlan_rx_kill_vid(struct net_device *dev,
unsigned short vid)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,21)
if (tp->vlgrp)
tp->vlgrp->vlan_devices[vid] = NULL;
#else
vlan_group_set_device(tp->vlgrp, vid, NULL);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,21)
spin_unlock_irqrestore(&tp->lock, flags);
}
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,22)
static int
rtl8168_rx_vlan_skb(struct rtl8168_private *tp,
struct RxDesc *desc,
struct sk_buff *skb)
{
u32 opts2 = le32_to_cpu(desc->opts2);
int ret = -1;
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
if (tp->vlgrp && (opts2 & RxVlanTag)) {
rtl8168_rx_hwaccel_skb(skb, tp->vlgrp,
swab16(opts2 & 0xffff));
ret = 0;
}
#elif LINUX_VERSION_CODE < KERNEL_VERSION(3,10,0)
if (opts2 & RxVlanTag)
__vlan_hwaccel_put_tag(skb, swab16(opts2 & 0xffff));
#else
if (opts2 & RxVlanTag)
__vlan_hwaccel_put_tag(skb, htons(ETH_P_8021Q), swab16(opts2 & 0xffff));
#endif
desc->opts2 = 0;
return ret;
}
#else /* !CONFIG_R8168_VLAN */
static inline u32
rtl8168_tx_vlan_tag(struct rtl8168_private *tp,
struct sk_buff *skb)
{
return 0;
}
static int
rtl8168_rx_vlan_skb(struct rtl8168_private *tp,
struct RxDesc *desc,
struct sk_buff *skb)
{
return -1;
}
#endif
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,0,0)
static netdev_features_t rtl8168_fix_features(struct net_device *dev,
netdev_features_t features)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
if (dev->mtu > MSS_MAX)
features &= ~NETIF_F_ALL_TSO;
if (dev->mtu > ETH_DATA_LEN) {
features &= ~NETIF_F_ALL_TSO;
features &= ~NETIF_F_ALL_CSUM;
}
spin_unlock_irqrestore(&tp->lock, flags);
return features;
}
static int rtl8168_hw_set_features(struct net_device *dev,
netdev_features_t features)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u32 rx_config;
rx_config = RTL_R32(RxConfig);
if (features & NETIF_F_RXALL)
rx_config |= (AcceptErr | AcceptRunt);
else
rx_config &= ~(AcceptErr | AcceptRunt);
RTL_W32(RxConfig, rx_config);
if (features & NETIF_F_RXCSUM)
tp->cp_cmd |= RxChkSum;
else
tp->cp_cmd &= ~RxChkSum;
if (dev->features & NETIF_F_HW_VLAN_RX)
tp->cp_cmd |= RxVlan;
else
tp->cp_cmd &= ~RxVlan;
RTL_W16(CPlusCmd, tp->cp_cmd);
RTL_R16(CPlusCmd);
return 0;
}
static int rtl8168_set_features(struct net_device *dev,
netdev_features_t features)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
features &= NETIF_F_RXALL | NETIF_F_RXCSUM | NETIF_F_HW_VLAN_RX;
spin_lock_irqsave(&tp->lock, flags);
if (features ^ dev->features)
rtl8168_hw_set_features(dev, features);
spin_unlock_irqrestore(&tp->lock, flags);
return 0;
}
#endif
static void rtl8168_gset_xmii(struct net_device *dev,
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,6,0)
struct ethtool_cmd *cmd
#else
struct ethtool_link_ksettings *cmd
#endif
)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u8 status;
u8 autoneg, duplex;
u32 speed = 0;
u32 supported, advertising;
unsigned long flags;
supported = SUPPORTED_10baseT_Half |
SUPPORTED_10baseT_Full |
SUPPORTED_100baseT_Half |
SUPPORTED_100baseT_Full |
SUPPORTED_1000baseT_Full |
SUPPORTED_Autoneg |
SUPPORTED_TP;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
autoneg = (mdio_read(tp, MII_BMCR) & BMCR_ANENABLE) ? 1 : 0;
spin_unlock_irqrestore(&tp->phy_lock, flags);
advertising = ADVERTISED_TP | ADVERTISED_Autoneg;
if (tp->phy_auto_nego_reg & ADVERTISE_10HALF)
advertising |= ADVERTISED_10baseT_Half;
if (tp->phy_auto_nego_reg & ADVERTISE_10FULL)
advertising |= ADVERTISED_10baseT_Full;
if (tp->phy_auto_nego_reg & ADVERTISE_100HALF)
advertising |= ADVERTISED_100baseT_Half;
if (tp->phy_auto_nego_reg & ADVERTISE_100FULL)
advertising |= ADVERTISED_100baseT_Full;
if (tp->phy_1000_ctrl_reg & ADVERTISE_1000FULL)
advertising |= ADVERTISED_1000baseT_Full;
status = RTL_R8(PHYstatus);
if (status & _1000bpsF)
speed = SPEED_1000;
else if (status & _100bps)
speed = SPEED_100;
else if (status & _10bps)
speed = SPEED_10;
if (status & TxFlowCtrl)
advertising |= ADVERTISED_Asym_Pause;
if (status & RxFlowCtrl)
advertising |= ADVERTISED_Pause;
duplex = ((status & _1000bpsF) || (status & FullDup)) ?
DUPLEX_FULL : DUPLEX_HALF;
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,6,0)
cmd->supported = supported;
cmd->advertising = advertising;
cmd->autoneg = autoneg;
cmd->speed = speed;
cmd->duplex = duplex;
#else
ethtool_convert_legacy_u32_to_link_mode(cmd->link_modes.supported,
supported);
ethtool_convert_legacy_u32_to_link_mode(cmd->link_modes.advertising,
advertising);
cmd->base.autoneg = autoneg;
cmd->base.speed = speed;
cmd->base.duplex = duplex;
#endif
}
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static int
rtl8168_get_settings(struct net_device *dev,
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,6,0)
struct ethtool_cmd *cmd
#else
struct ethtool_link_ksettings *cmd
#endif
)
{
struct rtl8168_private *tp = netdev_priv(dev);
tp->get_settings(dev, cmd);
return 0;
}
static void rtl8168_get_regs(struct net_device *dev, struct ethtool_regs *regs,
void *p)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned int i;
u8 *data = p;
unsigned long flags;
if (regs->len < R8168_REGS_DUMP_SIZE)
return /* -EINVAL */;
memset(p, 0, regs->len);
spin_lock_irqsave(&tp->lock, flags);
for (i = 0; i < R8168_MAC_REGS_SIZE; i++)
*data++ = readb(ioaddr + i);
spin_unlock_irqrestore(&tp->lock, flags);
data = (u8*)p + 256;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
for (i = 0; i < R8168_PHY_REGS_SIZE/2; i++) {
*(u16*)data = mdio_read(tp, i);
data += 2;
}
data = (u8*)p + 256 * 2;
for (i = 0; i < R8168_EPHY_REGS_SIZE/2; i++) {
*(u16*)data = rtl8168_ephy_read(ioaddr, i);
data += 2;
}
data = (u8*)p + 256 * 3;
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
/* RTL8168B does not support Extend GMAC */
break;
default:
for (i = 0; i < R8168_ERI_REGS_SIZE; i+=4) {
*(u32*)data = rtl8168_eri_read(ioaddr, i , 4, ERIAR_ExGMAC);
data += 4;
}
break;
}
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
static u32
rtl8168_get_msglevel(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
return tp->msg_enable;
}
static void
rtl8168_set_msglevel(struct net_device *dev,
u32 value)
{
struct rtl8168_private *tp = netdev_priv(dev);
tp->msg_enable = value;
}
static const char rtl8168_gstrings[][ETH_GSTRING_LEN] = {
"tx_packets",
"rx_packets",
"tx_errors",
"rx_errors",
"rx_missed",
"align_errors",
"tx_single_collisions",
"tx_multi_collisions",
"unicast",
"broadcast",
"multicast",
"tx_aborted",
"tx_underrun",
};
#endif //#LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,33)
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static int rtl8168_get_stats_count(struct net_device *dev)
{
return ARRAY_SIZE(rtl8168_gstrings);
}
#endif //#LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
#else
static int rtl8168_get_sset_count(struct net_device *dev, int sset)
{
switch (sset) {
case ETH_SS_STATS:
return ARRAY_SIZE(rtl8168_gstrings);
default:
return -EOPNOTSUPP;
}
}
#endif
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static void
rtl8168_get_ethtool_stats(struct net_device *dev,
struct ethtool_stats *stats,
u64 *data)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
struct rtl8168_counters *counters;
dma_addr_t paddr;
u32 cmd;
u32 WaitCnt;
unsigned long flags;
ASSERT_RTNL();
counters = tp->tally_vaddr;
paddr = tp->tally_paddr;
if (!counters)
return;
spin_lock_irqsave(&tp->lock, flags);
RTL_W32(CounterAddrHigh, (u64)paddr >> 32);
cmd = (u64)paddr & DMA_BIT_MASK(32);
RTL_W32(CounterAddrLow, cmd);
RTL_W32(CounterAddrLow, cmd | CounterDump);
WaitCnt = 0;
while (RTL_R32(CounterAddrLow) & CounterDump) {
udelay(10);
WaitCnt++;
if (WaitCnt > 20)
break;
}
spin_unlock_irqrestore(&tp->lock, flags);
data[0] = le64_to_cpu(counters->tx_packets);
data[1] = le64_to_cpu(counters->rx_packets);
data[2] = le64_to_cpu(counters->tx_errors);
data[3] = le32_to_cpu(counters->rx_errors);
data[4] = le16_to_cpu(counters->rx_missed);
data[5] = le16_to_cpu(counters->align_errors);
data[6] = le32_to_cpu(counters->tx_one_collision);
data[7] = le32_to_cpu(counters->tx_multi_collision);
data[8] = le64_to_cpu(counters->rx_unicast);
data[9] = le64_to_cpu(counters->rx_broadcast);
data[10] = le32_to_cpu(counters->rx_multicast);
data[11] = le16_to_cpu(counters->tx_aborted);
data[12] = le16_to_cpu(counters->tx_underun);
}
static void
rtl8168_get_strings(struct net_device *dev,
u32 stringset,
u8 *data)
{
switch (stringset) {
case ETH_SS_STATS:
memcpy(data, *rtl8168_gstrings, sizeof(rtl8168_gstrings));
break;
}
}
#endif //#LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static int rtl_get_eeprom_len(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
return tp->eeprom_len;
}
static int rtl_get_eeprom(struct net_device *dev, struct ethtool_eeprom *eeprom, u8 *buf)
{
struct rtl8168_private *tp = netdev_priv(dev);
int i,j,ret;
int start_w, end_w;
int VPD_addr, VPD_data;
u32 *eeprom_buff;
u16 tmp;
if (tp->eeprom_type == EEPROM_TYPE_NONE) {
dev_printk(KERN_DEBUG, &tp->pci_dev->dev, "Detect none EEPROM\n");
return -EOPNOTSUPP;
} else if (eeprom->len == 0 || (eeprom->offset+eeprom->len) > tp->eeprom_len) {
dev_printk(KERN_DEBUG, &tp->pci_dev->dev, "Invalid parameter\n");
return -EINVAL;
}
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
VPD_addr = 0xCE;
VPD_data = 0xD0;
break;
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
return -EOPNOTSUPP;
default:
VPD_addr = 0xD2;
VPD_data = 0xD4;
break;
}
start_w = eeprom->offset >> 2;
end_w = (eeprom->offset + eeprom->len - 1) >> 2;
eeprom_buff = kmalloc(sizeof(u32)*(end_w - start_w + 1), GFP_KERNEL);
if (!eeprom_buff)
return -ENOMEM;
rtl8168_enable_cfg9346_write(tp);
ret = -EFAULT;
for (i=start_w; i<=end_w; i++) {
pci_write_config_word(tp->pci_dev, VPD_addr, (u16)i*4);
ret = -EFAULT;
for (j = 0; j < 10; j++) {
udelay(400);
pci_read_config_word(tp->pci_dev, VPD_addr, &tmp);
if (tmp&0x8000) {
ret = 0;
break;
}
}
if (ret)
break;
pci_read_config_dword(tp->pci_dev, VPD_data, &eeprom_buff[i-start_w]);
}
rtl8168_disable_cfg9346_write(tp);
if (!ret)
memcpy(buf, (u8 *)eeprom_buff + (eeprom->offset & 3), eeprom->len);
kfree(eeprom_buff);
return ret;
}
#undef ethtool_op_get_link
#define ethtool_op_get_link _kc_ethtool_op_get_link
u32 _kc_ethtool_op_get_link(struct net_device *dev)
{
return netif_carrier_ok(dev) ? 1 : 0;
}
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,3,0)
#undef ethtool_op_get_sg
#define ethtool_op_get_sg _kc_ethtool_op_get_sg
u32 _kc_ethtool_op_get_sg(struct net_device *dev)
{
#ifdef NETIF_F_SG
return (dev->features & NETIF_F_SG) != 0;
#else
return 0;
#endif
}
#undef ethtool_op_set_sg
#define ethtool_op_set_sg _kc_ethtool_op_set_sg
int _kc_ethtool_op_set_sg(struct net_device *dev, u32 data)
{
struct rtl8168_private *tp = netdev_priv(dev);
if (tp->mcfg == CFG_METHOD_DEFAULT)
return -EOPNOTSUPP;
#ifdef NETIF_F_SG
if (data)
dev->features |= NETIF_F_SG;
else
dev->features &= ~NETIF_F_SG;
#endif
return 0;
}
#endif
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,6,0)
static int
rtl_ethtool_get_eee(struct net_device *net, struct ethtool_eee *eee)
{
struct rtl8168_private *tp = netdev_priv(net);
void __iomem *ioaddr = tp->mmio_addr;
u32 lp, adv, supported = 0;
unsigned long flags;
u16 val;
switch (tp->mcfg) {
case CFG_METHOD_27:
case CFG_METHOD_28:
break;
default:
return -EOPNOTSUPP;
}
if (unlikely(tp->rtk_enable_diag))
return -EBUSY;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A5C);
val = mdio_read(tp, 0x12);
supported = mmd_eee_cap_to_ethtool_sup_t(val);
mdio_write(tp, 0x1F, 0x0A5D);
val = mdio_read(tp, 0x10);
adv = mmd_eee_adv_to_ethtool_adv_t(val);
val = mdio_read(tp, 0x11);
lp = mmd_eee_adv_to_ethtool_adv_t(val);
val = rtl8168_eri_read(ioaddr, 0x1B0, 2, ERIAR_ExGMAC);
val &= BIT_1 | BIT_0;
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
eee->eee_enabled = !!val;
eee->eee_active = !!(supported & adv & lp);
eee->supported = supported;
eee->advertised = adv;
eee->lp_advertised = lp;
return 0;
}
static int
rtl_ethtool_set_eee(struct net_device *net, struct ethtool_eee *eee)
{
struct rtl8168_private *tp = netdev_priv(net);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
u32 data;
switch (tp->mcfg) {
case CFG_METHOD_27:
case CFG_METHOD_28:
break;
default:
return -EOPNOTSUPP;
}
if (unlikely(tp->rtk_enable_diag))
return -EBUSY;
spin_lock_irqsave(&tp->phy_lock, flags);
data = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
if (eee->eee_enabled) {
data |= BIT_1 | BIT_0;
rtl8168_eri_write(ioaddr, 0x1B0, 4, data, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x11);
mdio_write(tp, 0x11, data | BIT_4);
data = ethtool_adv_to_mmd_eee_adv_t(eee->advertised);
mdio_write(tp, 0x1F, 0x0A5D);
mdio_write(tp, 0x10, data);
} else {
data &= ~(BIT_1 | BIT_0);
rtl8168_eri_write(ioaddr, 0x1B0, 4, data, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x11);
mdio_write(tp, 0x11, data & ~BIT_4);
mdio_write(tp, 0x1F, 0x0A5D);
mdio_write(tp, 0x10, 0x0000);
}
mdio_write(tp, 0x1F, 0x0000);
data = mdio_read(tp, MII_BMCR);
data |= BMCR_RESET;
mdio_write(tp, MII_BMCR, data);
spin_unlock_irqrestore(&tp->phy_lock, flags);
return 0;
}
#endif /* LINUX_VERSION_CODE >= KERNEL_VERSION(3,6,0) */
static int rtl_nway_reset(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
int ret, bmcr;
if (unlikely(tp->rtk_enable_diag))
return -EBUSY;
spin_lock_irqsave(&tp->phy_lock, flags);
/* if autoneg is off, it's an error */
mdio_write(tp, 0x1F, 0x0000);
bmcr = mdio_read(tp, MII_BMCR);
if (bmcr & BMCR_ANENABLE) {
bmcr |= BMCR_ANRESTART;
mdio_write(tp, MII_BMCR, bmcr);
ret = 0;
} else {
ret = -EINVAL;
}
spin_unlock_irqrestore(&tp->phy_lock, flags);
return ret;
}
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static const struct ethtool_ops rtl8168_ethtool_ops = {
.get_drvinfo = rtl8168_get_drvinfo,
.get_regs_len = rtl8168_get_regs_len,
.get_link = ethtool_op_get_link,
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,6,0)
.get_settings = rtl8168_get_settings,
.set_settings = rtl8168_set_settings,
#else
.get_link_ksettings = rtl8168_get_settings,
.set_link_ksettings = rtl8168_set_settings,
#endif
.get_msglevel = rtl8168_get_msglevel,
.set_msglevel = rtl8168_set_msglevel,
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,3,0)
.get_rx_csum = rtl8168_get_rx_csum,
.set_rx_csum = rtl8168_set_rx_csum,
.get_tx_csum = rtl8168_get_tx_csum,
.set_tx_csum = rtl8168_set_tx_csum,
.get_sg = ethtool_op_get_sg,
.set_sg = ethtool_op_set_sg,
#ifdef NETIF_F_TSO
.get_tso = ethtool_op_get_tso,
.set_tso = ethtool_op_set_tso,
#endif
#endif
.get_regs = rtl8168_get_regs,
.get_wol = rtl8168_get_wol,
.set_wol = rtl8168_set_wol,
.get_strings = rtl8168_get_strings,
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,33)
.get_stats_count = rtl8168_get_stats_count,
#else
.get_sset_count = rtl8168_get_sset_count,
#endif
.get_ethtool_stats = rtl8168_get_ethtool_stats,
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,23)
#ifdef ETHTOOL_GPERMADDR
.get_perm_addr = ethtool_op_get_perm_addr,
#endif
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,23)
.get_eeprom = rtl_get_eeprom,
.get_eeprom_len = rtl_get_eeprom_len,
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,5,0)
.get_ts_info = ethtool_op_get_ts_info,
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(3,5,0)
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,6,0)
.get_eee = rtl_ethtool_get_eee,
.set_eee = rtl_ethtool_set_eee,
#endif /* LINUX_VERSION_CODE >= KERNEL_VERSION(3,6,0) */
.nway_reset = rtl_nway_reset,
};
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,4,22)
static int rtl8168_enable_EEE(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
int ret;
u16 data;
u16 PhyRegValue;
u32 csi_tmp;
u32 WaitCnt;
unsigned long flags;
ret = 0;
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0020);
data = mdio_read(tp, 0x15) | 0x0100;
mdio_write(tp, 0x15, data);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
data = mdio_read(tp, 0x06) | 0x2000;
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0006);
mdio_write(tp, 0x00, 0x5A30);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0x0007);
mdio_write(tp, 0x0E, 0x003C);
mdio_write(tp, 0x0D, 0x4007);
mdio_write(tp, 0x0E, 0x0006);
mdio_write(tp, 0x0D, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
if ((RTL_R8(Config4)&0x40) && (RTL_R8(0x6D) & BIT_7)) {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8AC8);
mdio_write(tp, 0x06, RTL_R16(CustomLED));
mdio_write(tp, 0x05, 0x8B82);
data = mdio_read(tp, 0x06) | 0x0010;
mdio_write(tp, 0x05, 0x8B82);
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
break;
case CFG_METHOD_16:
case CFG_METHOD_17:
spin_lock_irqsave(&tp->phy_lock, flags);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC) | 0x0003;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
mdio_write(tp,0x1F , 0x0004);
mdio_write(tp,0x1F , 0x0007);
mdio_write(tp,0x1E , 0x0020);
data = mdio_read(tp, 0x15)|0x0100;
mdio_write(tp,0x15 , data);
mdio_write(tp,0x1F , 0x0002);
mdio_write(tp,0x1F , 0x0005);
mdio_write(tp,0x05 , 0x8B85);
data = mdio_read(tp, 0x06)|0x2000;
mdio_write(tp,0x06 , data);
mdio_write(tp,0x1F , 0x0000);
mdio_write(tp,0x0D , 0x0007);
mdio_write(tp,0x0E , 0x003C);
mdio_write(tp,0x0D , 0x4007);
mdio_write(tp,0x0E , 0x0006);
mdio_write(tp,0x0D , 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
spin_lock_irqsave(&tp->phy_lock, flags);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp |= BIT_1 | BIT_0;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1e, 0x0020);
data = mdio_read(tp, 0x15);
data |= BIT_8;
mdio_write(tp, 0x15, data);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
data = mdio_read(tp, 0x06);
data |= BIT_13;
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0x0007);
mdio_write(tp, 0x0E, 0x003C);
mdio_write(tp, 0x0D, 0x4007);
mdio_write(tp, 0x0E, 0x0006);
mdio_write(tp, 0x0D, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp |= BIT_1 | BIT_0;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x11);
mdio_write(tp, 0x11, data | BIT_4);
mdio_write(tp, 0x1F, 0x0A5D);
mdio_write(tp, 0x10, 0x0006);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
default:
// dev_printk(KERN_DEBUG, &tp->pci_dev->dev, "Not Support EEE\n");
ret = -EOPNOTSUPP;
break;
}
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A4A);
SetEthPhyBit(tp, 0x11, BIT_9);
mdio_write(tp, 0x1F, 0x0A42);
SetEthPhyBit(tp, 0x14, BIT_7);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
/*Advanced EEE*/
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp,0x1F, 0x0B82);
SetEthPhyBit(tp, 0x10, BIT_4);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp,0x1F, 0x0B80);
WaitCnt = 0;
do {
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= 0x0040;
udelay(100);
WaitCnt++;
} while(PhyRegValue != 0x0040 && WaitCnt <1000);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_25:
rtl8168_eri_write(ioaddr, 0x1EA, 1, 0xFA, ERIAR_ExGMAC);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x10);
if (data & BIT_10) {
mdio_write(tp, 0x1F, 0x0A42);
data = mdio_read(tp, 0x16);
data &= ~(BIT_1);
mdio_write(tp, 0x16, data);
} else {
mdio_write(tp, 0x1F, 0x0A42);
data = mdio_read(tp, 0x16);
data |= BIT_1;
mdio_write(tp, 0x16, data);
}
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_26:
data = mac_ocp_read(tp, 0xE052);
data |= BIT_0;
mac_ocp_write(tp, 0xE052, data);
data = mac_ocp_read(tp, 0xE056);
data &= 0xFF0F;
data |= (BIT_4 | BIT_5 | BIT_6);
mac_ocp_write(tp, 0xE056, data);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x10);
if (data & BIT_10) {
mdio_write(tp, 0x1F, 0x0A42);
data = mdio_read(tp, 0x16);
data &= ~(BIT_1);
mdio_write(tp, 0x16, data);
} else {
mdio_write(tp, 0x1F, 0x0A42);
data = mdio_read(tp, 0x16);
data |= BIT_1;
mdio_write(tp, 0x16, data);
}
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_27:
case CFG_METHOD_28:
OOB_mutex_lock(tp);
data = mac_ocp_read(tp, 0xE052);
data &= ~BIT_0;
mac_ocp_write(tp, 0xE052, data);
OOB_mutex_unlock(tp);
data = mac_ocp_read(tp, 0xE056);
data &= 0xFF0F;
data |= (BIT_4 | BIT_5 | BIT_6);
mac_ocp_write(tp, 0xE056, data);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
data = mac_ocp_read(tp, 0xE052);
data |= BIT_0;
mac_ocp_write(tp, 0xE052, data);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x10) | BIT_15;
mdio_write(tp, 0x10, data);
mdio_write(tp, 0x1F, 0x0A44);
data = mdio_read(tp, 0x11) | BIT_13 | BIT_14;
data &= ~(BIT_12);
mdio_write(tp, 0x11, data);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
OOB_mutex_lock(tp);
data = mac_ocp_read(tp, 0xE052);
data |= BIT_0;
mac_ocp_write(tp, 0xE052, data);
OOB_mutex_unlock(tp);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x10) | BIT_15;
mdio_write(tp, 0x10, data);
mdio_write(tp, 0x1F, 0x0A44);
data = mdio_read(tp, 0x11) | BIT_13 | BIT_14;
data &= ~(BIT_12);
mdio_write(tp, 0x11, data);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0B82);
ClearEthPhyBit(tp, 0x10, BIT_4);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
return ret;
}
static int rtl8168_disable_EEE(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
int ret;
u16 data;
u16 PhyRegValue;
u32 csi_tmp;
u32 WaitCnt;
unsigned long flags;
ret = 0;
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
data = mdio_read(tp, 0x06) & ~0x2000;
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0020);
data = mdio_read(tp, 0x15) & ~0x0100;
mdio_write(tp, 0x15, data);
mdio_write(tp, 0x1F, 0x0006);
mdio_write(tp, 0x00, 0x5A00);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0x0007);
mdio_write(tp, 0x0E, 0x003C);
mdio_write(tp, 0x0D, 0x4007);
mdio_write(tp, 0x0E, 0x0000);
mdio_write(tp, 0x0D, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
if (RTL_R8(Config4) & 0x40) {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B82);
data = mdio_read(tp, 0x06) & ~0x0010;
mdio_write(tp, 0x05, 0x8B82);
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
break;
case CFG_METHOD_16:
case CFG_METHOD_17:
spin_lock_irqsave(&tp->phy_lock, flags);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0,4, ERIAR_ExGMAC)& ~0x0003;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
data = mdio_read(tp, 0x06) & ~0x2000;
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0004);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0020);
data = mdio_read(tp, 0x15) & ~0x0100;
mdio_write(tp,0x15 , data);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0x0007);
mdio_write(tp, 0x0E, 0x003C);
mdio_write(tp, 0x0D, 0x4007);
mdio_write(tp, 0x0E, 0x0000);
mdio_write(tp, 0x0D, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
spin_lock_irqsave(&tp->phy_lock, flags);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_1 | BIT_0);
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
data = mdio_read(tp, 0x06);
data &= ~BIT_13;
mdio_write(tp, 0x06, data);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1e, 0x0020);
data = mdio_read(tp, 0x15);
data &= ~BIT_8;
mdio_write(tp, 0x15, data);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0x0007);
mdio_write(tp, 0x0E, 0x003C);
mdio_write(tp, 0x0D, 0x4007);
mdio_write(tp, 0x0E, 0x0000);
mdio_write(tp, 0x0D, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_1 | BIT_0);
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x11);
mdio_write(tp, 0x11, data & ~BIT_4);
mdio_write(tp, 0x1F, 0x0A5D);
mdio_write(tp, 0x10, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
default:
// dev_printk(KERN_DEBUG, &tp->pci_dev->dev, "Not Support EEE\n");
ret = -EOPNOTSUPP;
break;
}
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A42);
ClearEthPhyBit(tp, 0x14, BIT_7);
mdio_write(tp, 0x1F, 0x0A4A);
ClearEthPhyBit(tp, 0x11, BIT_9);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
/*Advanced EEE*/
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp,0x1F, 0x0B82);
SetEthPhyBit(tp, 0x10, BIT_4);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp,0x1F, 0x0B80);
WaitCnt = 0;
do {
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= 0x0040;
udelay(100);
WaitCnt++;
} while(PhyRegValue != 0x0040 && WaitCnt <1000);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_25:
rtl8168_eri_write(ioaddr, 0x1EA, 1, 0x00, ERIAR_ExGMAC);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A42);
data = mdio_read(tp, 0x16);
data &= ~(BIT_1);
mdio_write(tp, 0x16, data);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_26:
data = mac_ocp_read(tp, 0xE052);
data &= ~(BIT_0);
mac_ocp_write(tp, 0xE052, data);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A42);
data = mdio_read(tp, 0x16);
data &= ~(BIT_1);
mdio_write(tp, 0x16, data);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_27:
case CFG_METHOD_28:
data = mac_ocp_read(tp, 0xE052);
data &= ~(BIT_0);
mac_ocp_write(tp, 0xE052, data);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
data = mac_ocp_read(tp, 0xE052);
data &= ~(BIT_0);
mac_ocp_write(tp, 0xE052, data);
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
data = mdio_read(tp, 0x10) & ~(BIT_15);
mdio_write(tp, 0x10, data);
mdio_write(tp, 0x1F, 0x0A44);
data = mdio_read(tp, 0x11) & ~(BIT_12 | BIT_13 | BIT_14);
mdio_write(tp, 0x11, data);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0B82);
ClearEthPhyBit(tp, 0x10, BIT_4);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
}
return ret;
}
#if 0
static int rtl8168_enable_green_feature(struct rtl8168_private *tp)
{
u16 gphy_val;
unsigned long flags;
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0003);
gphy_val = mdio_read(tp, 0x10) | 0x0400;
mdio_write(tp, 0x10, gphy_val);
gphy_val = mdio_read(tp, 0x19) | 0x0001;
mdio_write(tp, 0x19, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
gphy_val = mdio_read(tp, 0x01) & ~0x0100;
mdio_write(tp, 0x01, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x00, 0x9200);
spin_unlock_irqrestore(&tp->phy_lock, flags);
mdelay(20);
break;
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1f, 0x0003);
gphy_val = mdio_read(tp, 0x10);
gphy_val |= BIT_10;
mdio_write(tp, 0x10, gphy_val);
gphy_val = mdio_read(tp, 0x19);
gphy_val |= BIT_0;
mdio_write(tp, 0x19, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
gphy_val = mdio_read(tp, 0x01);
gphy_val |= BIT_8;
mdio_write(tp, 0x01, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x9200);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_21:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8011);
SetEthPhyBit( tp, 0x14, BIT_14 );
mdio_write(tp, 0x1F, 0x0A40);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x00, 0x9200);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8045);
mdio_write(tp, 0x14, 0x0000);
mdio_write(tp, 0x13, 0x804d);
mdio_write(tp, 0x14, 0x1222);
mdio_write(tp, 0x13, 0x805d);
mdio_write(tp, 0x14, 0x0022);
mdio_write(tp, 0x13, 0x8011);
SetEthPhyBit( tp, 0x14, BIT_15 );
mdio_write(tp, 0x1F, 0x0A40);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x00, 0x9200);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
default:
dev_printk(KERN_DEBUG, &tp->pci_dev->dev, "Not Support Green Feature\n");
break;
}
return 0;
}
static int rtl8168_disable_green_feature(struct rtl8168_private *tp)
{
u16 gphy_val;
unsigned long flags;
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0005);
gphy_val = mdio_read(tp, 0x01) | 0x0100;
mdio_write(tp, 0x01, gphy_val);
mdio_write(tp, 0x1F, 0x0003);
gphy_val = mdio_read(tp, 0x10) & ~0x0400;
mdio_write(tp, 0x10, gphy_val);
gphy_val = mdio_read(tp, 0x19) & ~0x0001;
mdio_write(tp, 0x19, gphy_val);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x06) & ~0x7000;
gphy_val |= 0x3000;
mdio_write(tp, 0x06, gphy_val);
gphy_val = mdio_read(tp, 0x0D) & 0x0700;
gphy_val |= 0x0500;
mdio_write(tp, 0x0D, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1f, 0x0003);
gphy_val = mdio_read(tp, 0x19);
gphy_val &= ~BIT_0;
mdio_write(tp, 0x19, gphy_val);
gphy_val = mdio_read(tp, 0x10);
gphy_val &= ~BIT_10;
mdio_write(tp, 0x10, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_21:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8011);
ClearEthPhyBit( tp, 0x14, BIT_14 );
mdio_write(tp, 0x1F, 0x0A40);
mdio_write(tp, 0x00, 0x9200);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8045);
mdio_write(tp, 0x14, 0x2444);
mdio_write(tp, 0x13, 0x804d);
mdio_write(tp, 0x14, 0x2444);
mdio_write(tp, 0x13, 0x805d);
mdio_write(tp, 0x14, 0x2444);
mdio_write(tp, 0x13, 0x8011);
SetEthPhyBit( tp, 0x14, BIT_15 );
mdio_write(tp, 0x1F, 0x0A40);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x00, 0x9200);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
default:
dev_printk(KERN_DEBUG, &tp->pci_dev->dev, "Not Support Green Feature\n");
break;
}
return 0;
}
#endif
static void rtl8168_get_mac_version(struct rtl8168_private *tp, void __iomem *ioaddr)
{
u32 reg,val32;
u32 ICVerID;
val32 = RTL_R32(TxConfig);
reg = val32 & 0x7c800000;
ICVerID = val32 & 0x00700000;
switch (reg) {
case 0x30000000:
tp->mcfg = CFG_METHOD_1;
tp->efuse_ver = EFUSE_NOT_SUPPORT;
break;
case 0x38000000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_2;
} else if (ICVerID == 0x00500000) {
tp->mcfg = CFG_METHOD_3;
} else {
tp->mcfg = CFG_METHOD_3;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_NOT_SUPPORT;
break;
case 0x3C000000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_4;
} else if (ICVerID == 0x00200000) {
tp->mcfg = CFG_METHOD_5;
} else if (ICVerID == 0x00400000) {
tp->mcfg = CFG_METHOD_6;
} else {
tp->mcfg = CFG_METHOD_6;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_NOT_SUPPORT;
break;
case 0x3C800000:
if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_7;
} else if (ICVerID == 0x00300000) {
tp->mcfg = CFG_METHOD_8;
} else {
tp->mcfg = CFG_METHOD_8;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_NOT_SUPPORT;
break;
case 0x28000000:
if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_9;
} else if (ICVerID == 0x00300000) {
tp->mcfg = CFG_METHOD_10;
} else {
tp->mcfg = CFG_METHOD_10;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V1;
break;
case 0x28800000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_11;
} else if (ICVerID == 0x00200000) {
tp->mcfg = CFG_METHOD_12;
RTL_W32(0xD0, RTL_R32(0xD0) | 0x00020000);
} else if (ICVerID == 0x00300000) {
tp->mcfg = CFG_METHOD_13;
} else {
tp->mcfg = CFG_METHOD_13;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V1;
break;
case 0x2C000000:
if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_14;
} else if (ICVerID == 0x00200000) {
tp->mcfg = CFG_METHOD_15;
} else {
tp->mcfg = CFG_METHOD_15;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V2;
break;
case 0x2C800000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_16;
} else if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_17;
} else {
tp->mcfg = CFG_METHOD_17;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x48000000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_18;
} else if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_19;
} else {
tp->mcfg = CFG_METHOD_19;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x48800000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_20;
} else {
tp->mcfg = CFG_METHOD_20;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x4C000000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_21;
} else if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_22;
} else {
tp->mcfg = CFG_METHOD_22;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x50000000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_23;
} else if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_27;
} else if (ICVerID == 0x00200000) {
tp->mcfg = CFG_METHOD_28;
} else {
tp->mcfg = CFG_METHOD_28;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x50800000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_24;
} else if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_25;
} else {
tp->mcfg = CFG_METHOD_25;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x5C800000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_26;
} else {
tp->mcfg = CFG_METHOD_26;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x54000000:
if (ICVerID == 0x00000000) {
tp->mcfg = CFG_METHOD_29;
} else if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_30;
} else {
tp->mcfg = CFG_METHOD_30;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
case 0x54800000:
if (ICVerID == 0x00100000) {
tp->mcfg = CFG_METHOD_31;
} else if (ICVerID == 0x00200000) {
tp->mcfg = CFG_METHOD_32;
} else {
tp->mcfg = CFG_METHOD_32;
tp->HwIcVerUnknown = TRUE;
}
tp->efuse_ver = EFUSE_SUPPORT_V3;
break;
default:
printk("unknown chip version (%x)\n",reg);
tp->mcfg = CFG_METHOD_DEFAULT;
tp->HwIcVerUnknown = TRUE;
tp->efuse_ver = EFUSE_NOT_SUPPORT;
break;
}
}
static void
rtl8168_print_mac_version(struct rtl8168_private *tp)
{
int i;
for (i = ARRAY_SIZE(rtl_chip_info) - 1; i >= 0; i--) {
if (tp->mcfg == rtl_chip_info[i].mcfg) {
dprintk("Realtek PCIe GBE Family Controller mcfg = %04d\n",
rtl_chip_info[i].mcfg);
return;
}
}
dprintk("mac_version == Unknown\n");
}
static u8 rtl8168_calc_efuse_dummy_bit(u16 reg)
{
int s,a,b;
u8 dummyBitPos = 0;
s=reg% 32;
a=s % 16;
b=s/16;
if (s/16) {
dummyBitPos = (u8)(16-a);
} else {
dummyBitPos = (u8)a;
}
return dummyBitPos;
}
static u32 rtl8168_decode_efuse_cmd(struct rtl8168_private *tp, u32 DwCmd)
{
u16 reg = (u16)((DwCmd & 0x00FE0000) >> 17);
u32 DummyPos = rtl8168_calc_efuse_dummy_bit(reg);
u32 DeCodeDwCmd = DwCmd;
u32 Dw17BitData;
if (tp->efuse_ver < 3) {
DeCodeDwCmd = (DwCmd>>(DummyPos+1))<<DummyPos;
if (DummyPos > 0) {
DeCodeDwCmd |= ((DwCmd<<(32-DummyPos))>>(32-DummyPos));
}
} else {
reg = (u16)((DwCmd & 0x007F0000) >> 16);
DummyPos = rtl8168_calc_efuse_dummy_bit(reg);
Dw17BitData = ((DwCmd & BIT_23) >> 23);
Dw17BitData <<= 16;
Dw17BitData |= (DwCmd & 0x0000FFFF);
DeCodeDwCmd = (Dw17BitData>>(DummyPos+1))<<DummyPos;
if (DummyPos > 0) {
DeCodeDwCmd |= ((Dw17BitData<<(32-DummyPos))>>(32-DummyPos));
}
}
return DeCodeDwCmd;
}
static u8 rtl8168_efuse_read(struct rtl8168_private *tp, u16 reg)
{
void __iomem *ioaddr = tp->mmio_addr;
u8 efuse_data = 0;
u32 temp;
int cnt;
if (tp->efuse_ver == EFUSE_NOT_SUPPORT)
return EFUSE_READ_FAIL;
if (tp->efuse_ver == EFUSE_SUPPORT_V1) {
temp = EFUSE_READ | ((reg & EFUSE_Reg_Mask) << EFUSE_Reg_Shift);
RTL_W32(EFUSEAR, temp);
cnt = 0;
do {
udelay(100);
temp = RTL_R32(EFUSEAR);
cnt++;
} while (!(temp & EFUSE_READ_OK) && (cnt < EFUSE_Check_Cnt));
if (cnt == EFUSE_Check_Cnt)
efuse_data = EFUSE_READ_FAIL;
else
efuse_data = (u8)(RTL_R32(EFUSEAR) & EFUSE_Data_Mask);
} else if (tp->efuse_ver == EFUSE_SUPPORT_V2) {
temp = (reg/2) & 0x03ff;
temp <<= 17;
temp |= EFUSE_READ;
RTL_W32(EFUSEAR, temp);
cnt = 0;
do {
udelay(100);
temp = RTL_R32(EFUSEAR);
cnt++;
} while (!(temp & EFUSE_READ_OK) && (cnt < EFUSE_Check_Cnt));
if (cnt == EFUSE_Check_Cnt) {
efuse_data = EFUSE_READ_FAIL;
} else {
temp = RTL_R32(EFUSEAR);
temp = rtl8168_decode_efuse_cmd(tp, temp);
if (reg%2) {
temp >>= 8;
efuse_data = (u8)temp;
} else {
efuse_data = (u8)temp;
}
}
} else if (tp->efuse_ver == EFUSE_SUPPORT_V3) {
temp = (reg/2) & 0x03ff;
temp <<= 16;
temp |= EFUSE_READ;
RTL_W32(EFUSEAR, temp);
cnt = 0;
do {
udelay(100);
temp = RTL_R32(EFUSEAR);
cnt++;
} while (!(temp & EFUSE_READ_OK) && (cnt < EFUSE_Check_Cnt));
if (cnt == EFUSE_Check_Cnt) {
efuse_data = EFUSE_READ_FAIL;
} else {
temp = RTL_R32(EFUSEAR);
temp = rtl8168_decode_efuse_cmd(tp, temp);
if (reg%2) {
temp >>= 8;
efuse_data = (u8)temp;
} else {
efuse_data = (u8)temp;
}
}
}
udelay(20);
return efuse_data;
}
static void
rtl8168_tally_counter_addr_fill(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if (!tp->tally_paddr)
return;
RTL_W32(CounterAddrHigh, (u64)tp->tally_paddr >> 32);
RTL_W32(CounterAddrLow, (u64)tp->tally_paddr & (DMA_BIT_MASK(32)));
}
static void
rtl8168_tally_counter_clear(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if (tp->mcfg == CFG_METHOD_1 || tp->mcfg == CFG_METHOD_2 ||
tp->mcfg == CFG_METHOD_3 )
return;
if (!tp->tally_paddr)
return;
RTL_W32(CounterAddrHigh, (u64)tp->tally_paddr >> 32);
RTL_W32(CounterAddrLow, ((u64)tp->tally_paddr & (DMA_BIT_MASK(32))) | CounterReset);
}
static int
rtl8168_is_ups_resume(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
return (mac_ocp_read(tp, 0xD408) & BIT_0);
}
static void
rtl8168_clear_ups_resume_bit(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
mac_ocp_write(tp, 0xD408, mac_ocp_read(tp, 0xD408) & ~(BIT_0));
}
static void
rtl8168_wait_phy_ups_resume(struct net_device *dev, u16 PhyState)
{
struct rtl8168_private *tp = netdev_priv(dev);
u16 TmpPhyState;
int i=0;
do {
TmpPhyState = mdio_read_phy_ocp(tp, 0x0A42, 0x10);
TmpPhyState &= 0x7;
mdelay(1);
i++;
} while ((i < 100) && (TmpPhyState != PhyState));
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,18)
WARN_ON_ONCE(i == 100);
#endif
}
void
EnableNowIsOob(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if ( tp->HwSuppNowIsOobVer == 1 ) {
RTL_W8(MCUCmd_reg, RTL_R8(MCUCmd_reg) | Now_is_oob);
}
}
void
DisableNowIsOob(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if ( tp->HwSuppNowIsOobVer == 1 ) {
RTL_W8(MCUCmd_reg, RTL_R8(MCUCmd_reg) & ~Now_is_oob);
}
}
static void
rtl8168_exit_oob(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u16 data16;
RTL_W32(RxConfig, RTL_R32(RxConfig) & ~(AcceptErr | AcceptRunt | AcceptBroadcast | AcceptMulticast | AcceptMyPhys | AcceptAllPhys));
switch (tp->mcfg) {
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_31:
case CFG_METHOD_32:
Dash2DisableTxRx(dev);
break;
}
if (tp->DASH) {
rtl8168_driver_stop(tp);
rtl8168_driver_start(tp);
#ifdef ENABLE_DASH_SUPPORT
DashHwInit(dev);
#endif
}
//Disable realwow function
switch (tp->mcfg) {
case CFG_METHOD_18:
case CFG_METHOD_19:
RTL_W32(MACOCP, 0xE5A90000);
RTL_W32(MACOCP, 0xF2100010);
break;
case CFG_METHOD_20:
RTL_W32(MACOCP, 0xE5A90000);
RTL_W32(MACOCP, 0xE4640000);
RTL_W32(MACOCP, 0xF2100010);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
RTL_W32(MACOCP, 0x605E0000);
RTL_W32(MACOCP, (0xE05E << 16) | (RTL_R32(MACOCP) & 0xFFFE));
RTL_W32(MACOCP, 0xE9720000);
RTL_W32(MACOCP, 0xF2140010);
break;
case CFG_METHOD_26:
RTL_W32(MACOCP, 0xE05E00FF);
RTL_W32(MACOCP, 0xE9720000);
mac_ocp_write(tp, 0xE428, 0x0010);
break;
}
#ifndef ENABLE_REALWOW_SUPPORT
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
rtl8168_eri_write(ioaddr, 0x174, 2, 0x0000, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xE428, 0x0010);
break;
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_28:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_eri_write(ioaddr, 0x174, 2, 0x00FF, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xE428, 0x0010);
break;
case CFG_METHOD_29:
case CFG_METHOD_30: {
u32 csi_tmp;
csi_tmp = rtl8168_eri_read(ioaddr, 0x174, 2, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_8);
csi_tmp |= (BIT_15);
rtl8168_eri_write(ioaddr, 0x174, 2, csi_tmp, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xE428, 0x0010);
}
break;
}
#endif //ENABLE_REALWOW_SUPPORT
#ifdef ENABLE_REALWOW_SUPPORT
realwow_hw_init(dev);
#endif
rtl8168_nic_reset(dev);
switch (tp->mcfg) {
case CFG_METHOD_20:
rtl8168_wait_ll_share_fifo_ready(dev);
data16 = mac_ocp_read(tp, 0xD4DE) | BIT_15;
mac_ocp_write(tp, 0xD4DE, data16);
rtl8168_wait_ll_share_fifo_ready(dev);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
DisableNowIsOob(tp);
data16 = mac_ocp_read(tp, 0xE8DE) & ~BIT_14;
mac_ocp_write(tp, 0xE8DE, data16);
rtl8168_wait_ll_share_fifo_ready(dev);
data16 = mac_ocp_read(tp, 0xE8DE) | BIT_15;
mac_ocp_write(tp, 0xE8DE, data16);
rtl8168_wait_ll_share_fifo_ready(dev);
break;
}
//wait ups resume (phy state 2)
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
if (rtl8168_is_ups_resume(dev)) {
unsigned long flags;
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_wait_phy_ups_resume(dev, 2);
spin_unlock_irqrestore(&tp->phy_lock, flags);
rtl8168_clear_ups_resume_bit(dev);
}
break;
};
}
void
rtl8168_hw_disable_mac_mcu_bps(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_enable_cfg9346_write(tp);
RTL_W8(Config5, RTL_R8(Config5) & ~BIT_0);
RTL_W8(Config2, RTL_R8(Config2) & ~BIT_7);
rtl8168_disable_cfg9346_write(tp);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mac_ocp_write(tp, 0xFC38, 0x0000);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mac_ocp_write(tp, 0xFC28, 0x0000);
mac_ocp_write(tp, 0xFC2A, 0x0000);
mac_ocp_write(tp, 0xFC2C, 0x0000);
mac_ocp_write(tp, 0xFC2E, 0x0000);
mac_ocp_write(tp, 0xFC30, 0x0000);
mac_ocp_write(tp, 0xFC32, 0x0000);
mac_ocp_write(tp, 0xFC34, 0x0000);
mac_ocp_write(tp, 0xFC36, 0x0000);
mdelay(3);
mac_ocp_write(tp, 0xFC26, 0x0000);
break;
}
}
static void
rtl8168_set_mac_mcu_8168g_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
mac_ocp_write(tp, 0xE43C, 0x0000);
mac_ocp_write(tp, 0xE43E, 0x0000);
mac_ocp_write(tp, 0xE434, 0x0004);
mac_ocp_write(tp, 0xE43C, 0x0004);
rtl8168_hw_disable_mac_mcu_bps(dev);
mac_ocp_write( tp, 0xF800, 0xE008 );
mac_ocp_write( tp, 0xF802, 0xE01B );
mac_ocp_write( tp, 0xF804, 0xE022 );
mac_ocp_write( tp, 0xF806, 0xE094 );
mac_ocp_write( tp, 0xF808, 0xE097 );
mac_ocp_write( tp, 0xF80A, 0xE09A );
mac_ocp_write( tp, 0xF80C, 0xE0B3 );
mac_ocp_write( tp, 0xF80E, 0xE0BA );
mac_ocp_write( tp, 0xF810, 0x49D2 );
mac_ocp_write( tp, 0xF812, 0xF10D );
mac_ocp_write( tp, 0xF814, 0x766C );
mac_ocp_write( tp, 0xF816, 0x49E2 );
mac_ocp_write( tp, 0xF818, 0xF00A );
mac_ocp_write( tp, 0xF81A, 0x1EC0 );
mac_ocp_write( tp, 0xF81C, 0x8EE1 );
mac_ocp_write( tp, 0xF81E, 0xC60A );
mac_ocp_write( tp, 0xF820, 0x77C0 );
mac_ocp_write( tp, 0xF822, 0x4870 );
mac_ocp_write( tp, 0xF824, 0x9FC0 );
mac_ocp_write( tp, 0xF826, 0x1EA0 );
mac_ocp_write( tp, 0xF828, 0xC707 );
mac_ocp_write( tp, 0xF82A, 0x8EE1 );
mac_ocp_write( tp, 0xF82C, 0x9D6C );
mac_ocp_write( tp, 0xF82E, 0xC603 );
mac_ocp_write( tp, 0xF830, 0xBE00 );
mac_ocp_write( tp, 0xF832, 0xB416 );
mac_ocp_write( tp, 0xF834, 0x0076 );
mac_ocp_write( tp, 0xF836, 0xE86C );
mac_ocp_write( tp, 0xF838, 0xC406 );
mac_ocp_write( tp, 0xF83A, 0x7580 );
mac_ocp_write( tp, 0xF83C, 0x4852 );
mac_ocp_write( tp, 0xF83E, 0x8D80 );
mac_ocp_write( tp, 0xF840, 0xC403 );
mac_ocp_write( tp, 0xF842, 0xBC00 );
mac_ocp_write( tp, 0xF844, 0xD3E0 );
mac_ocp_write( tp, 0xF846, 0x02C8 );
mac_ocp_write( tp, 0xF848, 0x8918 );
mac_ocp_write( tp, 0xF84A, 0xE815 );
mac_ocp_write( tp, 0xF84C, 0x1100 );
mac_ocp_write( tp, 0xF84E, 0xF011 );
mac_ocp_write( tp, 0xF850, 0xE812 );
mac_ocp_write( tp, 0xF852, 0x4990 );
mac_ocp_write( tp, 0xF854, 0xF002 );
mac_ocp_write( tp, 0xF856, 0xE817 );
mac_ocp_write( tp, 0xF858, 0xE80E );
mac_ocp_write( tp, 0xF85A, 0x4992 );
mac_ocp_write( tp, 0xF85C, 0xF002 );
mac_ocp_write( tp, 0xF85E, 0xE80E );
mac_ocp_write( tp, 0xF860, 0xE80A );
mac_ocp_write( tp, 0xF862, 0x4993 );
mac_ocp_write( tp, 0xF864, 0xF002 );
mac_ocp_write( tp, 0xF866, 0xE818 );
mac_ocp_write( tp, 0xF868, 0xE806 );
mac_ocp_write( tp, 0xF86A, 0x4991 );
mac_ocp_write( tp, 0xF86C, 0xF002 );
mac_ocp_write( tp, 0xF86E, 0xE838 );
mac_ocp_write( tp, 0xF870, 0xC25E );
mac_ocp_write( tp, 0xF872, 0xBA00 );
mac_ocp_write( tp, 0xF874, 0xC056 );
mac_ocp_write( tp, 0xF876, 0x7100 );
mac_ocp_write( tp, 0xF878, 0xFF80 );
mac_ocp_write( tp, 0xF87A, 0x7100 );
mac_ocp_write( tp, 0xF87C, 0x4892 );
mac_ocp_write( tp, 0xF87E, 0x4813 );
mac_ocp_write( tp, 0xF880, 0x8900 );
mac_ocp_write( tp, 0xF882, 0xE00A );
mac_ocp_write( tp, 0xF884, 0x7100 );
mac_ocp_write( tp, 0xF886, 0x4890 );
mac_ocp_write( tp, 0xF888, 0x4813 );
mac_ocp_write( tp, 0xF88A, 0x8900 );
mac_ocp_write( tp, 0xF88C, 0xC74B );
mac_ocp_write( tp, 0xF88E, 0x74F8 );
mac_ocp_write( tp, 0xF890, 0x48C2 );
mac_ocp_write( tp, 0xF892, 0x4841 );
mac_ocp_write( tp, 0xF894, 0x8CF8 );
mac_ocp_write( tp, 0xF896, 0xC746 );
mac_ocp_write( tp, 0xF898, 0x74FC );
mac_ocp_write( tp, 0xF89A, 0x49C0 );
mac_ocp_write( tp, 0xF89C, 0xF120 );
mac_ocp_write( tp, 0xF89E, 0x49C1 );
mac_ocp_write( tp, 0xF8A0, 0xF11E );
mac_ocp_write( tp, 0xF8A2, 0x74F8 );
mac_ocp_write( tp, 0xF8A4, 0x49C0 );
mac_ocp_write( tp, 0xF8A6, 0xF01B );
mac_ocp_write( tp, 0xF8A8, 0x49C6 );
mac_ocp_write( tp, 0xF8AA, 0xF119 );
mac_ocp_write( tp, 0xF8AC, 0x74F8 );
mac_ocp_write( tp, 0xF8AE, 0x49C4 );
mac_ocp_write( tp, 0xF8B0, 0xF013 );
mac_ocp_write( tp, 0xF8B2, 0xC536 );
mac_ocp_write( tp, 0xF8B4, 0x74B0 );
mac_ocp_write( tp, 0xF8B6, 0x49C1 );
mac_ocp_write( tp, 0xF8B8, 0xF1FD );
mac_ocp_write( tp, 0xF8BA, 0xC537 );
mac_ocp_write( tp, 0xF8BC, 0xC434 );
mac_ocp_write( tp, 0xF8BE, 0x9CA0 );
mac_ocp_write( tp, 0xF8C0, 0xC435 );
mac_ocp_write( tp, 0xF8C2, 0x1C13 );
mac_ocp_write( tp, 0xF8C4, 0x484F );
mac_ocp_write( tp, 0xF8C6, 0x9CA2 );
mac_ocp_write( tp, 0xF8C8, 0xC52B );
mac_ocp_write( tp, 0xF8CA, 0x74B0 );
mac_ocp_write( tp, 0xF8CC, 0x49C1 );
mac_ocp_write( tp, 0xF8CE, 0xF1FD );
mac_ocp_write( tp, 0xF8D0, 0x74F8 );
mac_ocp_write( tp, 0xF8D2, 0x48C4 );
mac_ocp_write( tp, 0xF8D4, 0x8CF8 );
mac_ocp_write( tp, 0xF8D6, 0x7100 );
mac_ocp_write( tp, 0xF8D8, 0x4893 );
mac_ocp_write( tp, 0xF8DA, 0x8900 );
mac_ocp_write( tp, 0xF8DC, 0xFF80 );
mac_ocp_write( tp, 0xF8DE, 0xC520 );
mac_ocp_write( tp, 0xF8E0, 0x74B0 );
mac_ocp_write( tp, 0xF8E2, 0x49C1 );
mac_ocp_write( tp, 0xF8E4, 0xF11C );
mac_ocp_write( tp, 0xF8E6, 0xC71E );
mac_ocp_write( tp, 0xF8E8, 0x74FC );
mac_ocp_write( tp, 0xF8EA, 0x49C1 );
mac_ocp_write( tp, 0xF8EC, 0xF118 );
mac_ocp_write( tp, 0xF8EE, 0x49C0 );
mac_ocp_write( tp, 0xF8F0, 0xF116 );
mac_ocp_write( tp, 0xF8F2, 0x74F8 );
mac_ocp_write( tp, 0xF8F4, 0x49C0 );
mac_ocp_write( tp, 0xF8F6, 0xF013 );
mac_ocp_write( tp, 0xF8F8, 0x48C3 );
mac_ocp_write( tp, 0xF8FA, 0x8CF8 );
mac_ocp_write( tp, 0xF8FC, 0xC516 );
mac_ocp_write( tp, 0xF8FE, 0x74A2 );
mac_ocp_write( tp, 0xF900, 0x49CE );
mac_ocp_write( tp, 0xF902, 0xF1FE );
mac_ocp_write( tp, 0xF904, 0xC411 );
mac_ocp_write( tp, 0xF906, 0x9CA0 );
mac_ocp_write( tp, 0xF908, 0xC411 );
mac_ocp_write( tp, 0xF90A, 0x1C13 );
mac_ocp_write( tp, 0xF90C, 0x484F );
mac_ocp_write( tp, 0xF90E, 0x9CA2 );
mac_ocp_write( tp, 0xF910, 0x74A2 );
mac_ocp_write( tp, 0xF912, 0x49CF );
mac_ocp_write( tp, 0xF914, 0xF1FE );
mac_ocp_write( tp, 0xF916, 0x7100 );
mac_ocp_write( tp, 0xF918, 0x4891 );
mac_ocp_write( tp, 0xF91A, 0x8900 );
mac_ocp_write( tp, 0xF91C, 0xFF80 );
mac_ocp_write( tp, 0xF91E, 0xE400 );
mac_ocp_write( tp, 0xF920, 0xD3E0 );
mac_ocp_write( tp, 0xF922, 0xE000 );
mac_ocp_write( tp, 0xF924, 0x0481 );
mac_ocp_write( tp, 0xF926, 0x0C81 );
mac_ocp_write( tp, 0xF928, 0xDE20 );
mac_ocp_write( tp, 0xF92A, 0x0000 );
mac_ocp_write( tp, 0xF92C, 0x0992 );
mac_ocp_write( tp, 0xF92E, 0x1B76 );
mac_ocp_write( tp, 0xF930, 0xC602 );
mac_ocp_write( tp, 0xF932, 0xBE00 );
mac_ocp_write( tp, 0xF934, 0x059C );
mac_ocp_write( tp, 0xF936, 0x1B76 );
mac_ocp_write( tp, 0xF938, 0xC602 );
mac_ocp_write( tp, 0xF93A, 0xBE00 );
mac_ocp_write( tp, 0xF93C, 0x065A );
mac_ocp_write( tp, 0xF93E, 0xB400 );
mac_ocp_write( tp, 0xF940, 0x18DE );
mac_ocp_write( tp, 0xF942, 0x2008 );
mac_ocp_write( tp, 0xF944, 0x4001 );
mac_ocp_write( tp, 0xF946, 0xF10F );
mac_ocp_write( tp, 0xF948, 0x7342 );
mac_ocp_write( tp, 0xF94A, 0x1880 );
mac_ocp_write( tp, 0xF94C, 0x2008 );
mac_ocp_write( tp, 0xF94E, 0x0009 );
mac_ocp_write( tp, 0xF950, 0x4018 );
mac_ocp_write( tp, 0xF952, 0xF109 );
mac_ocp_write( tp, 0xF954, 0x7340 );
mac_ocp_write( tp, 0xF956, 0x25BC );
mac_ocp_write( tp, 0xF958, 0x130F );
mac_ocp_write( tp, 0xF95A, 0xF105 );
mac_ocp_write( tp, 0xF95C, 0xC00A );
mac_ocp_write( tp, 0xF95E, 0x7300 );
mac_ocp_write( tp, 0xF960, 0x4831 );
mac_ocp_write( tp, 0xF962, 0x9B00 );
mac_ocp_write( tp, 0xF964, 0xB000 );
mac_ocp_write( tp, 0xF966, 0x7340 );
mac_ocp_write( tp, 0xF968, 0x8320 );
mac_ocp_write( tp, 0xF96A, 0xC302 );
mac_ocp_write( tp, 0xF96C, 0xBB00 );
mac_ocp_write( tp, 0xF96E, 0x0C12 );
mac_ocp_write( tp, 0xF970, 0xE860 );
mac_ocp_write( tp, 0xF972, 0xC406 );
mac_ocp_write( tp, 0xF974, 0x7580 );
mac_ocp_write( tp, 0xF976, 0x4851 );
mac_ocp_write( tp, 0xF978, 0x8D80 );
mac_ocp_write( tp, 0xF97A, 0xC403 );
mac_ocp_write( tp, 0xF97C, 0xBC00 );
mac_ocp_write( tp, 0xF97E, 0xD3E0 );
mac_ocp_write( tp, 0xF980, 0x02C8 );
mac_ocp_write( tp, 0xF982, 0xC406 );
mac_ocp_write( tp, 0xF984, 0x7580 );
mac_ocp_write( tp, 0xF986, 0x4850 );
mac_ocp_write( tp, 0xF988, 0x8D80 );
mac_ocp_write( tp, 0xF98A, 0xC403 );
mac_ocp_write( tp, 0xF98C, 0xBC00 );
mac_ocp_write( tp, 0xF98E, 0xD3E0 );
mac_ocp_write( tp, 0xF990, 0x0298 );
mac_ocp_write( tp, 0xDE30, 0x0080 );
mac_ocp_write( tp, 0xFC26, 0x8000 );
mac_ocp_write( tp, 0xFC28, 0x0075 );
mac_ocp_write( tp, 0xFC2A, 0x02B1 );
mac_ocp_write( tp, 0xFC2C, 0x0991 );
mac_ocp_write( tp, 0xFC2E, 0x059B );
mac_ocp_write( tp, 0xFC30, 0x0659 );
mac_ocp_write( tp, 0xFC32, 0x0000 );
mac_ocp_write( tp, 0xFC34, 0x02C7 );
mac_ocp_write( tp, 0xFC36, 0x0279 );
}
static void
rtl8168_set_mac_mcu_8168gu_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
rtl8168_hw_disable_mac_mcu_bps(dev);
mac_ocp_write( tp, 0xF800, 0xE008 );
mac_ocp_write( tp, 0xF802, 0xE011 );
mac_ocp_write( tp, 0xF804, 0xE015 );
mac_ocp_write( tp, 0xF806, 0xE018 );
mac_ocp_write( tp, 0xF808, 0xE01B );
mac_ocp_write( tp, 0xF80A, 0xE027 );
mac_ocp_write( tp, 0xF80C, 0xE043 );
mac_ocp_write( tp, 0xF80E, 0xE065 );
mac_ocp_write( tp, 0xF810, 0x49E2 );
mac_ocp_write( tp, 0xF812, 0xF005 );
mac_ocp_write( tp, 0xF814, 0x49EA );
mac_ocp_write( tp, 0xF816, 0xF003 );
mac_ocp_write( tp, 0xF818, 0xC404 );
mac_ocp_write( tp, 0xF81A, 0xBC00 );
mac_ocp_write( tp, 0xF81C, 0xC403 );
mac_ocp_write( tp, 0xF81E, 0xBC00 );
mac_ocp_write( tp, 0xF820, 0x0496 );
mac_ocp_write( tp, 0xF822, 0x051A );
mac_ocp_write( tp, 0xF824, 0x1D01 );
mac_ocp_write( tp, 0xF826, 0x8DE8 );
mac_ocp_write( tp, 0xF828, 0xC602 );
mac_ocp_write( tp, 0xF82A, 0xBE00 );
mac_ocp_write( tp, 0xF82C, 0x0206 );
mac_ocp_write( tp, 0xF82E, 0x1B76 );
mac_ocp_write( tp, 0xF830, 0xC202 );
mac_ocp_write( tp, 0xF832, 0xBA00 );
mac_ocp_write( tp, 0xF834, 0x058A );
mac_ocp_write( tp, 0xF836, 0x1B76 );
mac_ocp_write( tp, 0xF838, 0xC602 );
mac_ocp_write( tp, 0xF83A, 0xBE00 );
mac_ocp_write( tp, 0xF83C, 0x0648 );
mac_ocp_write( tp, 0xF83E, 0x74E6 );
mac_ocp_write( tp, 0xF840, 0x1B78 );
mac_ocp_write( tp, 0xF842, 0x46DC );
mac_ocp_write( tp, 0xF844, 0x1300 );
mac_ocp_write( tp, 0xF846, 0xF005 );
mac_ocp_write( tp, 0xF848, 0x74F8 );
mac_ocp_write( tp, 0xF84A, 0x48C3 );
mac_ocp_write( tp, 0xF84C, 0x48C4 );
mac_ocp_write( tp, 0xF84E, 0x8CF8 );
mac_ocp_write( tp, 0xF850, 0x64E7 );
mac_ocp_write( tp, 0xF852, 0xC302 );
mac_ocp_write( tp, 0xF854, 0xBB00 );
mac_ocp_write( tp, 0xF856, 0x068E );
mac_ocp_write( tp, 0xF858, 0x74E4 );
mac_ocp_write( tp, 0xF85A, 0x49C5 );
mac_ocp_write( tp, 0xF85C, 0xF106 );
mac_ocp_write( tp, 0xF85E, 0x49C6 );
mac_ocp_write( tp, 0xF860, 0xF107 );
mac_ocp_write( tp, 0xF862, 0x48C8 );
mac_ocp_write( tp, 0xF864, 0x48C9 );
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mac_ocp_write( tp, 0xFC34, 0x0285 );
}
static void
rtl8168_set_mac_mcu_8168gu_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
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}
static void
rtl8168_set_mac_mcu_8411b_1(struct net_device *dev)
{
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mac_ocp_write( tp, 0xFC34, 0x00A9 );
mac_ocp_write( tp, 0xFC36, 0x012D );
}
static void
rtl8168_set_mac_mcu_8168ep_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
rtl8168_hw_disable_mac_mcu_bps(dev);
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mac_ocp_write( tp, 0xF816, 0xF010 );
mac_ocp_write( tp, 0xF818, 0x1D02 );
mac_ocp_write( tp, 0xF81A, 0x8D40 );
mac_ocp_write( tp, 0xF81C, 0xC202 );
mac_ocp_write( tp, 0xF81E, 0xBA00 );
mac_ocp_write( tp, 0xF820, 0x2C3A );
mac_ocp_write( tp, 0xF822, 0xC0F0 );
mac_ocp_write( tp, 0xF824, 0xE8DE );
mac_ocp_write( tp, 0xF826, 0x2000 );
mac_ocp_write( tp, 0xF828, 0x8000 );
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mac_ocp_write( tp, 0xF830, 0x49D4 );
mac_ocp_write( tp, 0xF832, 0xF112 );
mac_ocp_write( tp, 0xF834, 0xE025 );
mac_ocp_write( tp, 0xF836, 0xC2F6 );
mac_ocp_write( tp, 0xF838, 0x7146 );
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static void
rtl8168_set_mac_mcu_8168h_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
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}
static void
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{
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if (tp->HwPkgDet == 0x0)
mac_ocp_write(tp, 0xFC38, 0x00FC);
else if(tp->HwPkgDet == 0xF)
mac_ocp_write(tp, 0xFC38, 0x00FF);
}
static void
rtl8168_set_mac_mcu_8168fp_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
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mac_ocp_write(tp, 0xF9E8, 0x38FB);
mac_ocp_write(tp, 0xF9EA, 0x3288);
mac_ocp_write(tp, 0xF9EC, 0x434B);
mac_ocp_write(tp, 0xF9EE, 0x2491);
mac_ocp_write(tp, 0xF9F0, 0x430B);
mac_ocp_write(tp, 0xF9F2, 0x1F0F);
mac_ocp_write(tp, 0xF9F4, 0x38FB);
mac_ocp_write(tp, 0xF9F6, 0x4313);
mac_ocp_write(tp, 0xF9F8, 0x2121);
mac_ocp_write(tp, 0xF9FA, 0x4353);
mac_ocp_write(tp, 0xF9FC, 0x2521);
mac_ocp_write(tp, 0xF9FE, 0x418A);
mac_ocp_write(tp, 0xFA00, 0x6282);
mac_ocp_write(tp, 0xFA02, 0x2527);
mac_ocp_write(tp, 0xFA04, 0x212F);
mac_ocp_write(tp, 0xFA06, 0x418A);
mac_ocp_write(tp, 0xFA08, 0xB007);
mac_ocp_write(tp, 0xFA0A, 0xB003);
mac_ocp_write(tp, 0xFA0C, 0xB002);
mac_ocp_write(tp, 0xFA0E, 0xFF80);
mac_ocp_write(tp, 0xFA10, 0x6183);
mac_ocp_write(tp, 0xFA12, 0x2496);
mac_ocp_write(tp, 0xFA14, 0x1100);
mac_ocp_write(tp, 0xFA16, 0xF1FD);
mac_ocp_write(tp, 0xFA18, 0xFF80);
mac_ocp_write(tp, 0xFA1A, 0x4800);
mac_ocp_write(tp, 0xFA1C, 0x4801);
mac_ocp_write(tp, 0xFA1E, 0xC213);
mac_ocp_write(tp, 0xFA20, 0xC313);
mac_ocp_write(tp, 0xFA22, 0xE815);
mac_ocp_write(tp, 0xFA24, 0x4860);
mac_ocp_write(tp, 0xFA26, 0x8EE0);
mac_ocp_write(tp, 0xFA28, 0xC210);
mac_ocp_write(tp, 0xFA2A, 0xC310);
mac_ocp_write(tp, 0xFA2C, 0xE822);
mac_ocp_write(tp, 0xFA2E, 0x481E);
mac_ocp_write(tp, 0xFA30, 0xC20C);
mac_ocp_write(tp, 0xFA32, 0xC30C);
mac_ocp_write(tp, 0xFA34, 0xE80C);
mac_ocp_write(tp, 0xFA36, 0xC206);
mac_ocp_write(tp, 0xFA38, 0x7358);
mac_ocp_write(tp, 0xFA3A, 0x483A);
mac_ocp_write(tp, 0xFA3C, 0x9B58);
mac_ocp_write(tp, 0xFA3E, 0xFF80);
mac_ocp_write(tp, 0xFA40, 0xE8E0);
mac_ocp_write(tp, 0xFA42, 0xE000);
mac_ocp_write(tp, 0xFA44, 0x1008);
mac_ocp_write(tp, 0xFA46, 0x0F00);
mac_ocp_write(tp, 0xFA48, 0x800C);
mac_ocp_write(tp, 0xFA4A, 0x0F00);
mac_ocp_write(tp, 0xFA4C, 0xB407);
mac_ocp_write(tp, 0xFA4E, 0xB406);
mac_ocp_write(tp, 0xFA50, 0xB403);
mac_ocp_write(tp, 0xFA52, 0xC7F7);
mac_ocp_write(tp, 0xFA54, 0x98E0);
mac_ocp_write(tp, 0xFA56, 0x99E2);
mac_ocp_write(tp, 0xFA58, 0x9AE4);
mac_ocp_write(tp, 0xFA5A, 0x21B2);
mac_ocp_write(tp, 0xFA5C, 0x4831);
mac_ocp_write(tp, 0xFA5E, 0x483F);
mac_ocp_write(tp, 0xFA60, 0x9BE6);
mac_ocp_write(tp, 0xFA62, 0x66E7);
mac_ocp_write(tp, 0xFA64, 0x49E6);
mac_ocp_write(tp, 0xFA66, 0xF1FE);
mac_ocp_write(tp, 0xFA68, 0xB003);
mac_ocp_write(tp, 0xFA6A, 0xB006);
mac_ocp_write(tp, 0xFA6C, 0xB007);
mac_ocp_write(tp, 0xFA6E, 0xFF80);
mac_ocp_write(tp, 0xFA70, 0xB407);
mac_ocp_write(tp, 0xFA72, 0xB406);
mac_ocp_write(tp, 0xFA74, 0xB403);
mac_ocp_write(tp, 0xFA76, 0xC7E5);
mac_ocp_write(tp, 0xFA78, 0x9AE4);
mac_ocp_write(tp, 0xFA7A, 0x21B2);
mac_ocp_write(tp, 0xFA7C, 0x4831);
mac_ocp_write(tp, 0xFA7E, 0x9BE6);
mac_ocp_write(tp, 0xFA80, 0x66E7);
mac_ocp_write(tp, 0xFA82, 0x49E6);
mac_ocp_write(tp, 0xFA84, 0xF1FE);
mac_ocp_write(tp, 0xFA86, 0x70E0);
mac_ocp_write(tp, 0xFA88, 0x71E2);
mac_ocp_write(tp, 0xFA8A, 0xB003);
mac_ocp_write(tp, 0xFA8C, 0xB006);
mac_ocp_write(tp, 0xFA8E, 0xB007);
mac_ocp_write(tp, 0xFA90, 0xFF80);
mac_ocp_write(tp, 0xFA92, 0x4882);
mac_ocp_write(tp, 0xFA94, 0xB406);
mac_ocp_write(tp, 0xFA96, 0xB405);
mac_ocp_write(tp, 0xFA98, 0xC71E);
mac_ocp_write(tp, 0xFA9A, 0x76E0);
mac_ocp_write(tp, 0xFA9C, 0x1D78);
mac_ocp_write(tp, 0xFA9E, 0x4175);
mac_ocp_write(tp, 0xFAA0, 0x1630);
mac_ocp_write(tp, 0xFAA2, 0xF10C);
mac_ocp_write(tp, 0xFAA4, 0xC715);
mac_ocp_write(tp, 0xFAA6, 0x76E0);
mac_ocp_write(tp, 0xFAA8, 0x4861);
mac_ocp_write(tp, 0xFAAA, 0x9EE0);
mac_ocp_write(tp, 0xFAAC, 0xC713);
mac_ocp_write(tp, 0xFAAE, 0x1EFF);
mac_ocp_write(tp, 0xFAB0, 0x9EE2);
mac_ocp_write(tp, 0xFAB2, 0x75E0);
mac_ocp_write(tp, 0xFAB4, 0x4850);
mac_ocp_write(tp, 0xFAB6, 0x9DE0);
mac_ocp_write(tp, 0xFAB8, 0xE005);
mac_ocp_write(tp, 0xFABA, 0xC70B);
mac_ocp_write(tp, 0xFABC, 0x76E0);
mac_ocp_write(tp, 0xFABE, 0x4865);
mac_ocp_write(tp, 0xFAC0, 0x9EE0);
mac_ocp_write(tp, 0xFAC2, 0xB005);
mac_ocp_write(tp, 0xFAC4, 0xB006);
mac_ocp_write(tp, 0xFAC6, 0xC708);
mac_ocp_write(tp, 0xFAC8, 0xC102);
mac_ocp_write(tp, 0xFACA, 0xB900);
mac_ocp_write(tp, 0xFACC, 0x279E);
mac_ocp_write(tp, 0xFACE, 0xEB16);
mac_ocp_write(tp, 0xFAD0, 0xEB00);
mac_ocp_write(tp, 0xFAD2, 0xE43C);
mac_ocp_write(tp, 0xFAD4, 0xDC00);
mac_ocp_write(tp, 0xFAD6, 0xD3EC);
mac_ocp_write(tp, 0xFAD8, 0xC602);
mac_ocp_write(tp, 0xFADA, 0xBE00);
mac_ocp_write(tp, 0xFADC, 0x0000);
mac_ocp_write(tp, 0xFADE, 0xC602);
mac_ocp_write(tp, 0xFAE0, 0xBE00);
mac_ocp_write(tp, 0xFAE2, 0x0000);
mac_ocp_write(tp, 0xFC26, 0x8000);
mac_ocp_write(tp, 0xFC28, 0x0000);
mac_ocp_write(tp, 0xFC2A, 0x04B4);
mac_ocp_write(tp, 0xFC2C, 0x0000);
mac_ocp_write(tp, 0xFC2E, 0x0000);
mac_ocp_write(tp, 0xFC30, 0x0000);
mac_ocp_write(tp, 0xFC32, 0x279C);
mac_ocp_write(tp, 0xFC34, 0x0000);
mac_ocp_write(tp, 0xFC36, 0x0000);
mac_ocp_write(tp, 0xFC38, 0x0022);
}
static void
rtl8168_hw_mac_mcu_config(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
if (tp->NotWrMcuPatchCode == TRUE) return;
switch (tp->mcfg) {
case CFG_METHOD_21:
rtl8168_set_mac_mcu_8168g_1(dev);
break;
case CFG_METHOD_24:
rtl8168_set_mac_mcu_8168gu_1(dev);
break;
case CFG_METHOD_25:
rtl8168_set_mac_mcu_8168gu_2(dev);
break;
case CFG_METHOD_26:
rtl8168_set_mac_mcu_8411b_1(dev);
break;
case CFG_METHOD_27:
rtl8168_set_mac_mcu_8168ep_1(dev);
break;
case CFG_METHOD_28:
rtl8168_set_mac_mcu_8168ep_2(dev);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
rtl8168_set_mac_mcu_8168h_1(dev);
break;
case CFG_METHOD_31:
if (tp->HwPkgDet == 0x00 || tp->HwPkgDet == 0x0F)
rtl8168_set_mac_mcu_8168fp_1(dev);
else if (tp->HwPkgDet == 0x06)
rtl8168_set_mac_mcu_8168fp_2(dev);
break;
case CFG_METHOD_32:
rtl8168_hw_disable_mac_mcu_bps(dev);
break;
}
}
static void
rtl8168_hw_init(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
unsigned long flags;
u32 csi_tmp;
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_enable_cfg9346_write(tp);
RTL_W8(Config5, RTL_R8(Config5) & ~BIT_0);
RTL_W8(Config2, RTL_R8(Config2) & ~BIT_7);
rtl8168_disable_cfg9346_write(tp);
RTL_W8(0xF1, RTL_R8(0xF1) & ~BIT_7);
break;
}
//Disable UPS
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mac_ocp_write(tp, 0xD400, mac_ocp_read( tp, 0xD400) & ~(BIT_0));
break;
}
//Disable DMA Aggregation
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mac_ocp_write(tp, 0xE63E, mac_ocp_read( tp, 0xE63E) & ~(BIT_3 | BIT_2 | BIT_1));
mac_ocp_write(tp, 0xE63E, mac_ocp_read( tp, 0xE63E) | (BIT_0));
mac_ocp_write(tp, 0xE63E, mac_ocp_read( tp, 0xE63E) & ~(BIT_0));
mac_ocp_write(tp, 0xC094, 0x0);
mac_ocp_write(tp, 0xC09E, 0x0);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
RTL_W8(DBG_reg, RTL_R8(DBG_reg) | BIT_1 | BIT_7);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
RTL_W8(0xF2, (RTL_R8(0xF2) & ~(BIT_2 | BIT_1 | BIT_0)));
break;
}
switch (tp->mcfg) {
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
if (aspm) {
RTL_W8(0x6E, RTL_R8(0x6E) | BIT_6);
rtl8168_eri_write(ioaddr, 0x1AE, 2, 0x0403, ERIAR_ExGMAC);
}
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_29:
case CFG_METHOD_30:
if (aspm) {
if ((mac_ocp_read(tp, 0xDC00) & BIT_3) || (RTL_R8(Config0) & 0x07)) {
RTL_W8(0x6E, RTL_R8(0x6E) | BIT_6);
rtl8168_eri_write(ioaddr, 0x1AE, 2, 0x0403, ERIAR_ExGMAC);
}
}
break;
}
if (tp->mcfg == CFG_METHOD_10 || tp->mcfg == CFG_METHOD_14 || tp->mcfg == CFG_METHOD_15)
RTL_W8(0xF3, RTL_R8(0xF3) | BIT_2);
rtl8168_hw_mac_mcu_config(dev);
/*disable ocp phy power saving*/
if (tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write_phy_ocp(tp, 0x0C41, 0x13, 0x0000);
mdio_write_phy_ocp(tp, 0x0C41, 0x13, 0x0500);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
//Set PCIE uncorrectable error status mask pcie 0x108
csi_tmp = rtl8168_csi_read(tp, 0x108);
csi_tmp |= BIT_20;
rtl8168_csi_write(tp, 0x108, csi_tmp);
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1AB, 1, ERIAR_ExGMAC);
csi_tmp |= ( BIT_2 | BIT_3 | BIT_4 | BIT_5 | BIT_6 | BIT_7 );
rtl8168_eri_write(ioaddr, 0x1AB, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
if (s0_magic_packet == 1)
rtl8168_enable_magic_packet(dev);
}
static void
rtl8168_hw_ephy_config(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u16 ephy_data;
if (tp->mcfg == CFG_METHOD_4) {
/*Set EPHY registers begin*/
/*Set EPHY register offset 0x02 bit 11 to 0 and bit 12 to 1*/
ephy_data = rtl8168_ephy_read(ioaddr, 0x02);
ephy_data &= ~BIT_11;
ephy_data |= BIT_12;
rtl8168_ephy_write(ioaddr, 0x02, ephy_data);
/*Set EPHY register offset 0x03 bit 1 to 1*/
ephy_data = rtl8168_ephy_read(ioaddr, 0x03);
ephy_data |= (1 << 1);
rtl8168_ephy_write(ioaddr, 0x03, ephy_data);
/*Set EPHY register offset 0x06 bit 7 to 0*/
ephy_data = rtl8168_ephy_read(ioaddr, 0x06);
ephy_data &= ~(1 << 7);
rtl8168_ephy_write(ioaddr, 0x06, ephy_data);
/*Set EPHY registers end*/
} else if (tp->mcfg == CFG_METHOD_5) {
/* set EPHY registers */
SetPCIePhyBit(tp, 0x01, BIT_0);
ClearAndSetPCIePhyBit(tp,
0x03,
BIT_10,
BIT_5
);
} else if (tp->mcfg == CFG_METHOD_9) {
/* set EPHY registers */
rtl8168_ephy_write(ioaddr, 0x01, 0x7C7F);
rtl8168_ephy_write(ioaddr, 0x02, 0x011F);
if (tp->eeprom_type != EEPROM_TYPE_NONE) {
ClearAndSetPCIePhyBit(tp,
0x03,
0xFFB0,
0x05B0
);
} else {
ClearAndSetPCIePhyBit(tp,
0x03,
0xFFF0,
0x05F0
);
}
rtl8168_ephy_write(ioaddr, 0x06, 0xB271);
rtl8168_ephy_write(ioaddr, 0x07, 0xCE00);
} else if (tp->mcfg == CFG_METHOD_10) {
/* set EPHY registers */
rtl8168_ephy_write(ioaddr, 0x01, 0x6C7F);
rtl8168_ephy_write(ioaddr, 0x02, 0x011F);
ClearAndSetPCIePhyBit(tp,
0x03,
0xFFF0,
0x01B0
);
rtl8168_ephy_write(ioaddr, 0x1A, 0x0546);
rtl8168_ephy_write(ioaddr, 0x1C, 0x80C4);
rtl8168_ephy_write(ioaddr, 0x1D, 0x78E5);
rtl8168_ephy_write(ioaddr, 0x0A, 0x8100);
} else if (tp->mcfg == CFG_METHOD_12) {
ephy_data = rtl8168_ephy_read(ioaddr, 0x0B);
rtl8168_ephy_write(ioaddr, 0x0B, ephy_data|0x48);
ephy_data = rtl8168_ephy_read(ioaddr, 0x19);
ephy_data &= ~0x20;
rtl8168_ephy_write(ioaddr, 0x19, ephy_data|0x50);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~0x100;
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data|0x20);
} else if (tp->mcfg == CFG_METHOD_14 || tp->mcfg == CFG_METHOD_15) {
/* set EPHY registers */
ephy_data = rtl8168_ephy_read(ioaddr, 0x00) & ~0x0200;
ephy_data |= 0x0100;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data |= 0x0004;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x06) & ~0x0002;
ephy_data |= 0x0001;
rtl8168_ephy_write(ioaddr, 0x06, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x06);
ephy_data |= 0x0030;
rtl8168_ephy_write(ioaddr, 0x06, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x07);
ephy_data |= 0x2000;
rtl8168_ephy_write(ioaddr, 0x07, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data |= 0x0020;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x03) & ~0x5800;
ephy_data |= 0x2000;
rtl8168_ephy_write(ioaddr, 0x03, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x03);
ephy_data |= 0x0001;
rtl8168_ephy_write(ioaddr, 0x03, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x01) & ~0x0800;
ephy_data |= 0x1000;
rtl8168_ephy_write(ioaddr, 0x01, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x07);
ephy_data |= 0x4000;
rtl8168_ephy_write(ioaddr, 0x07, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x1E);
ephy_data |= 0x2000;
rtl8168_ephy_write(ioaddr, 0x1E, ephy_data);
rtl8168_ephy_write(ioaddr, 0x19, 0xFE6C);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0A);
ephy_data |= 0x0040;
rtl8168_ephy_write(ioaddr, 0x0A, ephy_data);
} else if (tp->mcfg == CFG_METHOD_16 || tp->mcfg == CFG_METHOD_17) {
if (tp->mcfg == CFG_METHOD_16) {
rtl8168_ephy_write(ioaddr, 0x06, 0xF020);
rtl8168_ephy_write(ioaddr, 0x07, 0x01FF);
rtl8168_ephy_write(ioaddr, 0x00, 0x5027);
rtl8168_ephy_write(ioaddr, 0x01, 0x0003);
rtl8168_ephy_write(ioaddr, 0x02, 0x2D16);
rtl8168_ephy_write(ioaddr, 0x03, 0x6D49);
rtl8168_ephy_write(ioaddr, 0x08, 0x0006);
rtl8168_ephy_write(ioaddr, 0x0A, 0x00C8);
}
ephy_data = rtl8168_ephy_read(ioaddr, 0x09);
ephy_data |= BIT_7;
rtl8168_ephy_write(ioaddr, 0x09, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x19);
ephy_data |= (BIT_2 | BIT_5 | BIT_9);
rtl8168_ephy_write(ioaddr, 0x19, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data |= BIT_3;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~(BIT_13 | BIT_12 | BIT_11 | BIT_10 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4);
ephy_data |= BIT_9;
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data);
} else if (tp->mcfg == CFG_METHOD_18 || tp->mcfg == CFG_METHOD_19) {
if (tp->mcfg == CFG_METHOD_18) {
ephy_data = rtl8168_ephy_read(ioaddr, 0x06);
ephy_data |= BIT_5;
ephy_data &= ~(BIT_7 | BIT_6);
rtl8168_ephy_write(ioaddr, 0x06, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x08);
ephy_data |= BIT_1;
ephy_data &= ~BIT_0;
rtl8168_ephy_write(ioaddr, 0x08, ephy_data);
}
ephy_data = rtl8168_ephy_read(ioaddr, 0x09);
ephy_data |= BIT_7;
rtl8168_ephy_write(ioaddr, 0x09, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x19);
ephy_data |= (BIT_2 | BIT_5 | BIT_9);
rtl8168_ephy_write(ioaddr, 0x19, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data |= BIT_3;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~(BIT_13 | BIT_12 | BIT_11 | BIT_10 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4);
ephy_data |= BIT_9;
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data);
} else if (tp->mcfg == CFG_METHOD_20) {
ephy_data = rtl8168_ephy_read(ioaddr, 0x06);
ephy_data |= BIT_5;
ephy_data &= ~(BIT_7 | BIT_6);
rtl8168_ephy_write(ioaddr, 0x06, ephy_data);
rtl8168_ephy_write(ioaddr, 0x0f, 0x5200);
ephy_data = rtl8168_ephy_read(ioaddr, 0x19);
ephy_data |= (BIT_2 | BIT_5 | BIT_9);
rtl8168_ephy_write(ioaddr, 0x19, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data |= BIT_3;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~(BIT_13 | BIT_12 | BIT_11 | BIT_10 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4);
ephy_data |= BIT_9;
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data);
} else if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22) {
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data &= ~(BIT_3);
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~(BIT_13 | BIT_12 | BIT_11 | BIT_10 | BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4);
ephy_data |= (BIT_5 | BIT_11);
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x1E);
ephy_data |= (BIT_0);
rtl8168_ephy_write(ioaddr, 0x1E, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x19);
ephy_data &= ~(BIT_15);
rtl8168_ephy_write(ioaddr, 0x19, ephy_data);
} else if (tp->mcfg == CFG_METHOD_25) {
ephy_data = rtl8168_ephy_read(ioaddr, 0x00);
ephy_data &= ~BIT_3;
rtl8168_ephy_write(ioaddr, 0x00, ephy_data);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~(BIT_13 | BIT_12 | BIT_11 | BIT_10| BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4);
ephy_data |= (BIT_5 | BIT_11);
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data);
rtl8168_ephy_write(ioaddr, 0x19, 0x7C00);
rtl8168_ephy_write(ioaddr, 0x1E, 0x20EB);
rtl8168_ephy_write(ioaddr, 0x0D, 0x1666);
rtl8168_ephy_write(ioaddr, 0x00, 0x10A3);
rtl8168_ephy_write(ioaddr, 0x06, 0xF050);
SetPCIePhyBit(tp, 0x04, BIT_4);
ClearPCIePhyBit(tp, 0x1D, BIT_14);
} else if (tp->mcfg == CFG_METHOD_26) {
ClearPCIePhyBit(tp, 0x00, BIT_3);
ClearAndSetPCIePhyBit( tp,
0x0C,
(BIT_13 | BIT_12 | BIT_10 | BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_4),
(BIT_5 | BIT_11)
);
SetPCIePhyBit(tp, 0x1E, BIT_0);
ClearPCIePhyBit(tp, 0x19, BIT_15);
ClearPCIePhyBit(tp, 0x19, (BIT_5 | BIT_0));
SetPCIePhyBit(tp, 0x1E, BIT_13);
ClearPCIePhyBit(tp, 0x0D, BIT_8);
SetPCIePhyBit(tp, 0x0D, BIT_9);
SetPCIePhyBit(tp, 0x00, BIT_7);
SetPCIePhyBit(tp, 0x06, BIT_4);
SetPCIePhyBit(tp, 0x04, BIT_4);
SetPCIePhyBit(tp, 0x1D, BIT_14);
} else if (tp->mcfg == CFG_METHOD_23) {
rtl8168_ephy_write(ioaddr, 0x00, 0x10AB);
rtl8168_ephy_write(ioaddr, 0x06, 0xf030);
rtl8168_ephy_write(ioaddr, 0x08, 0x2006);
rtl8168_ephy_write(ioaddr, 0x0D, 0x1666);
ephy_data = rtl8168_ephy_read(ioaddr, 0x0C);
ephy_data &= ~(BIT_13 | BIT_12 | BIT_11 | BIT_10 | BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4);
rtl8168_ephy_write(ioaddr, 0x0C, ephy_data);
} else if (tp->mcfg == CFG_METHOD_27) {
rtl8168_ephy_write(ioaddr, 0x00, 0x10A3);
rtl8168_ephy_write(ioaddr, 0x19, 0xFC00);
rtl8168_ephy_write(ioaddr, 0x1E, 0x20EA);
} else if (tp->mcfg == CFG_METHOD_28) {
SetPCIePhyBit(tp, 0x00, BIT_7);
ClearAndSetPCIePhyBit(tp,
0x0D,
BIT_8,
BIT_9
);
ClearPCIePhyBit(tp, 0x19, (BIT_15 | BIT_5 | BIT_0));
SetPCIePhyBit(tp, 0x1E, BIT_13);
} else if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30) {
ClearPCIePhyBit(tp, 0x1E, BIT_11);
SetPCIePhyBit(tp, 0x1E, BIT_0);
SetPCIePhyBit(tp, 0x1D, BIT_11);
rtl8168_ephy_write(ioaddr, 0x05, 0x2089);
rtl8168_ephy_write(ioaddr, 0x06, 0x5881);
rtl8168_ephy_write(ioaddr, 0x04, 0x854A);
rtl8168_ephy_write(ioaddr, 0x01, 0x068B);
}
}
static int
rtl8168_check_hw_phy_mcu_code_ver(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
int ram_code_ver_match = 0;
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B60);
tp->hw_ram_code_ver = mdio_read(tp, 0x06);
mdio_write(tp, 0x1F, 0x0000);
break;
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B30);
tp->hw_ram_code_ver = mdio_read(tp, 0x06);
mdio_write(tp, 0x1F, 0x0000);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x801E);
tp->hw_ram_code_ver = mdio_read(tp, 0x14);
mdio_write(tp, 0x1F, 0x0000);
break;
default:
tp->hw_ram_code_ver = ~0;
break;
}
if ( tp->hw_ram_code_ver == tp->sw_ram_code_ver) {
ram_code_ver_match = 1;
tp->HwHasWrRamCodeToMicroP = TRUE;
}
return ram_code_ver_match;
}
static void
rtl8168_write_hw_phy_mcu_code_ver(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B60);
mdio_write(tp, 0x06, tp->sw_ram_code_ver);
mdio_write(tp, 0x1F, 0x0000);
tp->hw_ram_code_ver = tp->sw_ram_code_ver;
break;
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B30);
mdio_write(tp, 0x06, tp->sw_ram_code_ver);
mdio_write(tp, 0x1F, 0x0000);
tp->hw_ram_code_ver = tp->sw_ram_code_ver;
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x801E);
mdio_write(tp, 0x14, tp->sw_ram_code_ver);
mdio_write(tp, 0x1F, 0x0000);
tp->hw_ram_code_ver = tp->sw_ram_code_ver;
break;
}
}
static int
rtl8168_phy_ram_code_check(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u16 PhyRegValue;
u32 WaitCnt;
int retval = TRUE;
switch(tp->mcfg) {
case CFG_METHOD_21:
mdio_write(tp, 0x1f, 0x0A40);
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= ~(BIT_11);
mdio_write(tp, 0x10, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A00);
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= ~(BIT_12 | BIT_13 | BIT_14 | BIT_15);
mdio_write(tp, 0x10, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A43);
mdio_write(tp, 0x13, 0x8010);
PhyRegValue = mdio_read(tp, 0x14);
PhyRegValue &= ~(BIT_11);
mdio_write(tp, 0x14, PhyRegValue);
mdio_write(tp,0x1f, 0x0B82);
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue |= BIT_4;
mdio_write(tp,0x10, PhyRegValue);
mdio_write(tp,0x1f, 0x0B80);
WaitCnt = 0;
do {
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= 0x0040;
udelay(100);
WaitCnt++;
} while(PhyRegValue != 0x0040 && WaitCnt <1000);
if (WaitCnt == 1000) {
retval = FALSE;
}
mdio_write(tp, 0x1f, 0x0A40);
mdio_write(tp, 0x10, 0x0140);
mdio_write(tp, 0x1f, 0x0A4A);
PhyRegValue = mdio_read(tp, 0x13);
PhyRegValue &= ~(BIT_6);
PhyRegValue |= (BIT_7);
mdio_write(tp, 0x13, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A44);
PhyRegValue = mdio_read(tp, 0x14);
PhyRegValue |= (BIT_2);
mdio_write(tp, 0x14, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A50);
PhyRegValue = mdio_read(tp, 0x11);
PhyRegValue |= (BIT_11|BIT_12);
mdio_write(tp, 0x11, PhyRegValue);
mdio_write(tp, 0x1f, 0x0B82);
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= ~(BIT_4);
mdio_write(tp, 0x10, PhyRegValue);
mdio_write(tp,0x1f, 0x0A22);
WaitCnt = 0;
do {
PhyRegValue = mdio_read(tp, 0x12);
PhyRegValue &= 0x0010;
udelay(100);
WaitCnt++;
} while(PhyRegValue != 0x0010 && WaitCnt <1000);
if (WaitCnt == 1000) {
retval = FALSE;
}
mdio_write(tp, 0x1f, 0x0A40);
mdio_write(tp, 0x10, 0x1040);
mdio_write(tp, 0x1f, 0x0A4A);
PhyRegValue = mdio_read(tp, 0x13);
PhyRegValue &= ~(BIT_6|BIT_7);
mdio_write(tp, 0x13, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A44);
PhyRegValue = mdio_read(tp, 0x14);
PhyRegValue &= ~(BIT_2);
mdio_write(tp, 0x14, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A50);
PhyRegValue = mdio_read(tp, 0x11);
PhyRegValue &= ~(BIT_11|BIT_12);
mdio_write(tp, 0x11, PhyRegValue);
mdio_write(tp, 0x1f, 0x0A43);
mdio_write(tp, 0x13, 0x8010);
PhyRegValue = mdio_read(tp, 0x14);
PhyRegValue |= (BIT_11);
mdio_write(tp, 0x14, PhyRegValue);
mdio_write(tp,0x1f, 0x0B82);
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue |= BIT_4;
mdio_write(tp,0x10, PhyRegValue);
mdio_write(tp,0x1f, 0x0B80);
WaitCnt = 0;
do {
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= 0x0040;
udelay(100);
WaitCnt++;
} while(PhyRegValue != 0x0040 && WaitCnt <1000);
if ( WaitCnt == 1000) {
retval = FALSE;
}
mdio_write(tp, 0x1f, 0x0A20);
PhyRegValue = mdio_read(tp, 0x13);
if (PhyRegValue & BIT_11) {
if (PhyRegValue & BIT_10) {
retval = FALSE;
}
}
mdio_write(tp, 0x1f, 0x0B82);
PhyRegValue = mdio_read(tp, 0x10);
PhyRegValue &= ~(BIT_4);
mdio_write(tp, 0x10, PhyRegValue);
mdelay(2);
break;
default:
break;
}
mdio_write(tp, 0x1F, 0x0000);
return retval;
}
static void
rtl8168_set_phy_ram_code_check_fail_flag(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u16 TmpUshort;
switch(tp->mcfg) {
case CFG_METHOD_21:
TmpUshort = mac_ocp_read(tp, 0xD3C0);
TmpUshort |= BIT_0;
mac_ocp_write(tp, 0xD3C0, TmpUshort);
break;
}
}
static void
rtl8168_set_phy_mcu_8168e_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x1800);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x17, 0x0117);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1E, 0x002C);
mdio_write(tp, 0x1B, 0x5000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x16, 0x4104);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1E);
gphy_val &= 0x03FF;
if (gphy_val == 0x000C)
break;
}
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x07);
if ((gphy_val & BIT_5) == 0)
break;
}
gphy_val = mdio_read(tp, 0x07);
if (gphy_val & BIT_5) {
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x00a1);
mdio_write(tp, 0x17, 0x1000);
mdio_write(tp, 0x17, 0x0000);
mdio_write(tp, 0x17, 0x2000);
mdio_write(tp, 0x1e, 0x002f);
mdio_write(tp, 0x18, 0x9bfb);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x07, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
gphy_val = mdio_read(tp, 0x00);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0002);
gphy_val = mdio_read(tp, 0x08);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x08, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x000e);
mdio_write(tp, 0x19, 0x000a);
mdio_write(tp, 0x15, 0x0010);
mdio_write(tp, 0x19, 0x0008);
mdio_write(tp, 0x15, 0x0018);
mdio_write(tp, 0x19, 0x4801);
mdio_write(tp, 0x15, 0x0019);
mdio_write(tp, 0x19, 0x6801);
mdio_write(tp, 0x15, 0x001a);
mdio_write(tp, 0x19, 0x66a1);
mdio_write(tp, 0x15, 0x001f);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0020);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0021);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0022);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0023);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0024);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0025);
mdio_write(tp, 0x19, 0x64a1);
mdio_write(tp, 0x15, 0x0026);
mdio_write(tp, 0x19, 0x40ea);
mdio_write(tp, 0x15, 0x0027);
mdio_write(tp, 0x19, 0x4503);
mdio_write(tp, 0x15, 0x0028);
mdio_write(tp, 0x19, 0x9f00);
mdio_write(tp, 0x15, 0x0029);
mdio_write(tp, 0x19, 0xa631);
mdio_write(tp, 0x15, 0x002a);
mdio_write(tp, 0x19, 0x9717);
mdio_write(tp, 0x15, 0x002b);
mdio_write(tp, 0x19, 0x302c);
mdio_write(tp, 0x15, 0x002c);
mdio_write(tp, 0x19, 0x4802);
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mdio_write(tp, 0x06, 0x375a);
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mdio_write(tp, 0x06, 0x20e3);
mdio_write(tp, 0x06, 0x8ae7);
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mdio_write(tp, 0x06, 0x60ac);
mdio_write(tp, 0x06, 0x3a08);
mdio_write(tp, 0x06, 0xac3e);
mdio_write(tp, 0x06, 0x26ae);
mdio_write(tp, 0x06, 0x67af);
mdio_write(tp, 0x06, 0x8437);
mdio_write(tp, 0x06, 0xad37);
mdio_write(tp, 0x06, 0x61e0);
mdio_write(tp, 0x06, 0x8ae8);
mdio_write(tp, 0x06, 0x10e4);
mdio_write(tp, 0x06, 0x8ae8);
mdio_write(tp, 0x06, 0xe18a);
mdio_write(tp, 0x06, 0xe91b);
mdio_write(tp, 0x06, 0x109e);
mdio_write(tp, 0x06, 0x02ae);
mdio_write(tp, 0x06, 0x51d1);
mdio_write(tp, 0x06, 0x00bf);
mdio_write(tp, 0x06, 0x8441);
mdio_write(tp, 0x06, 0x022d);
mdio_write(tp, 0x06, 0xc1ee);
mdio_write(tp, 0x06, 0x8ae8);
mdio_write(tp, 0x06, 0x00ae);
mdio_write(tp, 0x06, 0x43ad);
mdio_write(tp, 0x06, 0x3627);
mdio_write(tp, 0x06, 0xe08a);
mdio_write(tp, 0x06, 0xeee1);
mdio_write(tp, 0x06, 0x8aef);
mdio_write(tp, 0x06, 0xef74);
mdio_write(tp, 0x06, 0xe08a);
mdio_write(tp, 0x06, 0xeae1);
mdio_write(tp, 0x06, 0x8aeb);
mdio_write(tp, 0x06, 0x1b74);
mdio_write(tp, 0x06, 0x9e2e);
mdio_write(tp, 0x06, 0x14e4);
mdio_write(tp, 0x06, 0x8aea);
mdio_write(tp, 0x06, 0xe58a);
mdio_write(tp, 0x06, 0xebef);
mdio_write(tp, 0x06, 0x74e0);
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mdio_write(tp, 0x06, 0xe18a);
mdio_write(tp, 0x06, 0xef1b);
mdio_write(tp, 0x06, 0x479e);
mdio_write(tp, 0x06, 0x0fae);
mdio_write(tp, 0x06, 0x19ee);
mdio_write(tp, 0x06, 0x8aea);
mdio_write(tp, 0x06, 0x00ee);
mdio_write(tp, 0x06, 0x8aeb);
mdio_write(tp, 0x06, 0x00ae);
mdio_write(tp, 0x06, 0x0fac);
mdio_write(tp, 0x06, 0x390c);
mdio_write(tp, 0x06, 0xd101);
mdio_write(tp, 0x06, 0xbf84);
mdio_write(tp, 0x06, 0x4102);
mdio_write(tp, 0x06, 0x2dc1);
mdio_write(tp, 0x06, 0xee8a);
mdio_write(tp, 0x06, 0xe800);
mdio_write(tp, 0x06, 0xe68a);
mdio_write(tp, 0x06, 0xe7ff);
mdio_write(tp, 0x06, 0xfdfc);
mdio_write(tp, 0x06, 0x0400);
mdio_write(tp, 0x06, 0xe234);
mdio_write(tp, 0x06, 0xcce2);
mdio_write(tp, 0x06, 0x0088);
mdio_write(tp, 0x06, 0xe200);
mdio_write(tp, 0x06, 0xa725);
mdio_write(tp, 0x06, 0xe50a);
mdio_write(tp, 0x06, 0x1de5);
mdio_write(tp, 0x06, 0x0a2c);
mdio_write(tp, 0x06, 0xe50a);
mdio_write(tp, 0x06, 0x6de5);
mdio_write(tp, 0x06, 0x0a1d);
mdio_write(tp, 0x06, 0xe50a);
mdio_write(tp, 0x06, 0x1ce5);
mdio_write(tp, 0x06, 0x0a2d);
mdio_write(tp, 0x06, 0xa755);
mdio_write(tp, 0x05, 0x8b64);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8b94);
mdio_write(tp, 0x06, 0x82cd);
mdio_write(tp, 0x05, 0x8b85);
mdio_write(tp, 0x06, 0x2000);
mdio_write(tp, 0x05, 0x8aee);
mdio_write(tp, 0x06, 0x03b8);
mdio_write(tp, 0x05, 0x8ae8);
mdio_write(tp, 0x06, 0x0002);
gphy_val = mdio_read(tp, 0x01);
gphy_val |= BIT_0;
mdio_write(tp, 0x01, gphy_val);
gphy_val = mdio_read(tp, 0x00);
gphy_val |= BIT_0;
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~(BIT_0);
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~(BIT_2);
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0028);
mdio_write(tp, 0x15, 0x0010);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0041);
mdio_write(tp, 0x15, 0x0802);
mdio_write(tp, 0x16, 0x2185);
mdio_write(tp, 0x1f, 0x0000);
}
static void
rtl8168_set_phy_mcu_8168e_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
if (rtl8168_efuse_read(tp, 0x22) == 0x0c) {
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x1800);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x17, 0x0117);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1E, 0x002C);
mdio_write(tp, 0x1B, 0x5000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x16, 0x4104);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1E);
gphy_val &= 0x03FF;
if (gphy_val==0x000C)
break;
}
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x07);
if ((gphy_val & BIT_5) == 0)
break;
}
gphy_val = mdio_read(tp, 0x07);
if (gphy_val & BIT_5) {
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x00a1);
mdio_write(tp, 0x17, 0x1000);
mdio_write(tp, 0x17, 0x0000);
mdio_write(tp, 0x17, 0x2000);
mdio_write(tp, 0x1e, 0x002f);
mdio_write(tp, 0x18, 0x9bfb);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x07, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
gphy_val = mdio_read(tp, 0x00);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0002);
gphy_val = mdio_read(tp, 0x08);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x08, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x000e);
mdio_write(tp, 0x19, 0x000a);
mdio_write(tp, 0x15, 0x0010);
mdio_write(tp, 0x19, 0x0008);
mdio_write(tp, 0x15, 0x0018);
mdio_write(tp, 0x19, 0x4801);
mdio_write(tp, 0x15, 0x0019);
mdio_write(tp, 0x19, 0x6801);
mdio_write(tp, 0x15, 0x001a);
mdio_write(tp, 0x19, 0x66a1);
mdio_write(tp, 0x15, 0x001f);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0020);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0021);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0022);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0023);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0024);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0025);
mdio_write(tp, 0x19, 0x64a1);
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mdio_write(tp, 0x19, 0x40ea);
mdio_write(tp, 0x15, 0x0027);
mdio_write(tp, 0x19, 0x4503);
mdio_write(tp, 0x15, 0x0028);
mdio_write(tp, 0x19, 0x9f00);
mdio_write(tp, 0x15, 0x0029);
mdio_write(tp, 0x19, 0xa631);
mdio_write(tp, 0x15, 0x002a);
mdio_write(tp, 0x19, 0x9717);
mdio_write(tp, 0x15, 0x002b);
mdio_write(tp, 0x19, 0x302c);
mdio_write(tp, 0x15, 0x002c);
mdio_write(tp, 0x19, 0x4802);
mdio_write(tp, 0x15, 0x002d);
mdio_write(tp, 0x19, 0x58da);
mdio_write(tp, 0x15, 0x002e);
mdio_write(tp, 0x19, 0x400d);
mdio_write(tp, 0x15, 0x002f);
mdio_write(tp, 0x19, 0x4488);
mdio_write(tp, 0x15, 0x0030);
mdio_write(tp, 0x19, 0x9e00);
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mdio_write(tp, 0x19, 0x63c8);
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mdio_write(tp, 0x15, 0x0034);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0035);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0036);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0037);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0038);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0039);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x003a);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x003b);
mdio_write(tp, 0x19, 0x63e8);
mdio_write(tp, 0x15, 0x003c);
mdio_write(tp, 0x19, 0x7d00);
mdio_write(tp, 0x15, 0x003d);
mdio_write(tp, 0x19, 0x59d4);
mdio_write(tp, 0x15, 0x003e);
mdio_write(tp, 0x19, 0x63f8);
mdio_write(tp, 0x15, 0x0040);
mdio_write(tp, 0x19, 0x64a1);
mdio_write(tp, 0x15, 0x0041);
mdio_write(tp, 0x19, 0x30de);
mdio_write(tp, 0x15, 0x0044);
mdio_write(tp, 0x19, 0x480f);
mdio_write(tp, 0x15, 0x0045);
mdio_write(tp, 0x19, 0x6800);
mdio_write(tp, 0x15, 0x0046);
mdio_write(tp, 0x19, 0x6680);
mdio_write(tp, 0x15, 0x0047);
mdio_write(tp, 0x19, 0x7c10);
mdio_write(tp, 0x15, 0x0048);
mdio_write(tp, 0x19, 0x63c8);
mdio_write(tp, 0x15, 0x0049);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x004a);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x004b);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x004c);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x004d);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x004e);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x004f);
mdio_write(tp, 0x19, 0x40ea);
mdio_write(tp, 0x15, 0x0050);
mdio_write(tp, 0x19, 0x4503);
mdio_write(tp, 0x15, 0x0051);
mdio_write(tp, 0x19, 0x58ca);
mdio_write(tp, 0x15, 0x0052);
mdio_write(tp, 0x19, 0x63c8);
mdio_write(tp, 0x15, 0x0053);
mdio_write(tp, 0x19, 0x63d8);
mdio_write(tp, 0x15, 0x0054);
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mdio_write(tp, 0x15, 0x0055);
mdio_write(tp, 0x19, 0x9f00);
mdio_write(tp, 0x15, 0x0056);
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mdio_write(tp, 0x15, 0x00a1);
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mdio_write(tp, 0x06, 0xcce2);
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mdio_write(tp, 0x06, 0xe020);
mdio_write(tp, 0x06, 0x55e2);
mdio_write(tp, 0x06, 0xd600);
mdio_write(tp, 0x06, 0xe24a);
gphy_val = mdio_read(tp, 0x01);
gphy_val |= BIT_0;
mdio_write(tp, 0x01, gphy_val);
gphy_val = mdio_read(tp, 0x00);
gphy_val |= BIT_0;
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x17, 0x2179);
mdio_write(tp, 0x1f, 0x0001);
mdio_write(tp, 0x10, 0xf274);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0042);
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mdio_write(tp, 0x15, 0x0f00);
mdio_write(tp, 0x16, 0x7408);
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mdio_write(tp, 0x15, 0x0f00);
mdio_write(tp, 0x15, 0x0f01);
mdio_write(tp, 0x16, 0x4000);
mdio_write(tp, 0x15, 0x0e01);
mdio_write(tp, 0x15, 0x0f01);
mdio_write(tp, 0x15, 0x0f02);
mdio_write(tp, 0x16, 0x9400);
mdio_write(tp, 0x15, 0x0e02);
mdio_write(tp, 0x15, 0x0f02);
mdio_write(tp, 0x15, 0x0f03);
mdio_write(tp, 0x16, 0x7408);
mdio_write(tp, 0x15, 0x0e03);
mdio_write(tp, 0x15, 0x0f03);
mdio_write(tp, 0x15, 0x0f04);
mdio_write(tp, 0x16, 0x4008);
mdio_write(tp, 0x15, 0x0e04);
mdio_write(tp, 0x15, 0x0f04);
mdio_write(tp, 0x15, 0x0f05);
mdio_write(tp, 0x16, 0x9400);
mdio_write(tp, 0x15, 0x0e05);
mdio_write(tp, 0x15, 0x0f05);
mdio_write(tp, 0x15, 0x0f06);
mdio_write(tp, 0x16, 0x0803);
mdio_write(tp, 0x15, 0x0e06);
mdio_write(tp, 0x15, 0x0f06);
mdio_write(tp, 0x15, 0x0d00);
mdio_write(tp, 0x15, 0x0100);
mdio_write(tp, 0x1f, 0x0001);
mdio_write(tp, 0x10, 0xf074);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x17, 0x2149);
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~(BIT_0);
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~(BIT_2);
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val |= BIT_14;
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1e, 0x0020);
gphy_val = mdio_read(tp, 0x1b);
gphy_val |= BIT_7;
mdio_write(tp, 0x1b, gphy_val);
mdio_write(tp, 0x1e, 0x0041);
mdio_write(tp, 0x15, 0x0e02);
mdio_write(tp, 0x1e, 0x0028);
gphy_val = mdio_read(tp, 0x19);
gphy_val |= BIT_15;
mdio_write(tp, 0x19, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
} else {
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x1800);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x17, 0x0117);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1E, 0x002C);
mdio_write(tp, 0x1B, 0x5000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x16, 0x4104);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1E);
gphy_val &= 0x03FF;
if (gphy_val==0x000C)
break;
}
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x07);
if ((gphy_val & BIT_5) == 0)
break;
}
gphy_val = mdio_read(tp, 0x07);
if (gphy_val & BIT_5) {
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x00a1);
mdio_write(tp, 0x17, 0x1000);
mdio_write(tp, 0x17, 0x0000);
mdio_write(tp, 0x17, 0x2000);
mdio_write(tp, 0x1e, 0x002f);
mdio_write(tp, 0x18, 0x9bfb);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x07, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
gphy_val = mdio_read(tp, 0x00);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0002);
gphy_val = mdio_read(tp, 0x08);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x08, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x000e);
mdio_write(tp, 0x19, 0x000a);
mdio_write(tp, 0x15, 0x0010);
mdio_write(tp, 0x19, 0x0008);
mdio_write(tp, 0x15, 0x0018);
mdio_write(tp, 0x19, 0x4801);
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mdio_write(tp, 0x19, 0x0000);
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mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0023);
mdio_write(tp, 0x19, 0x0000);
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mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x06, 0xa725);
mdio_write(tp, 0x06, 0xe50a);
mdio_write(tp, 0x06, 0x1de5);
mdio_write(tp, 0x06, 0x0a2c);
mdio_write(tp, 0x06, 0xe50a);
mdio_write(tp, 0x06, 0x6de5);
mdio_write(tp, 0x06, 0x0a1d);
mdio_write(tp, 0x06, 0xe50a);
mdio_write(tp, 0x06, 0x1ce5);
mdio_write(tp, 0x06, 0x0a2d);
mdio_write(tp, 0x06, 0xa755);
mdio_write(tp, 0x06, 0x00e2);
mdio_write(tp, 0x06, 0x3488);
mdio_write(tp, 0x06, 0xe200);
mdio_write(tp, 0x06, 0xcce2);
mdio_write(tp, 0x06, 0x0055);
mdio_write(tp, 0x06, 0xe020);
mdio_write(tp, 0x06, 0x55e2);
mdio_write(tp, 0x06, 0xd600);
mdio_write(tp, 0x06, 0xe24a);
gphy_val = mdio_read(tp, 0x01);
gphy_val |= BIT_0;
mdio_write(tp, 0x01, gphy_val);
gphy_val = mdio_read(tp, 0x00);
gphy_val |= BIT_0;
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~(BIT_0);
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~(BIT_2);
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
}
}
static void
rtl8168_set_phy_mcu_8168evl_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x1800);
gphy_val = mdio_read(tp, 0x15);
gphy_val &= ~(BIT_12);
mdio_write(tp, 0x15, gphy_val);
mdelay(20);
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
if ((gphy_val & BIT_11) == 0x0000) {
gphy_val |= BIT_0;
mdio_write(tp, 0x17, gphy_val);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x17);
if (gphy_val & BIT_11)
break;
}
}
gphy_val = mdio_read(tp, 0x17);
gphy_val |= BIT_0;
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1E, 0x002C);
mdio_write(tp, 0x1B, 0x5000);
mdio_write(tp, 0x1E, 0x002d);
mdio_write(tp, 0x19, 0x0004);
mdio_write(tp, 0x1f, 0x0002);
mdio_write(tp, 0x1f, 0x0000);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1E);
if ((gphy_val & 0x03FF) == 0x0014)
break;
}
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x07);
if ((gphy_val & BIT_5) == 0)
break;
}
gphy_val = mdio_read(tp, 0x07);
if (gphy_val & BIT_5) {
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x00a1);
mdio_write(tp, 0x17, 0x1000);
mdio_write(tp, 0x17, 0x0000);
mdio_write(tp, 0x17, 0x2000);
mdio_write(tp, 0x1e, 0x002f);
mdio_write(tp, 0x18, 0x9bfb);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x07, 0x0000);
mdio_write(tp, 0x1f, 0x0002);
mdio_write(tp, 0x1f, 0x0000);
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
gphy_val = mdio_read(tp, 0x00);
gphy_val &= ~(BIT_7);
mdio_write(tp, 0x00, gphy_val);
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x0000);
mdio_write(tp, 0x19, 0x407d);
mdio_write(tp, 0x15, 0x0001);
mdio_write(tp, 0x19, 0x440f);
mdio_write(tp, 0x15, 0x0002);
mdio_write(tp, 0x19, 0x7c03);
mdio_write(tp, 0x15, 0x0003);
mdio_write(tp, 0x19, 0x6c03);
mdio_write(tp, 0x15, 0x0004);
mdio_write(tp, 0x19, 0xc4d5);
mdio_write(tp, 0x15, 0x0005);
mdio_write(tp, 0x19, 0x00ff);
mdio_write(tp, 0x15, 0x0006);
mdio_write(tp, 0x19, 0x74f0);
mdio_write(tp, 0x15, 0x0007);
mdio_write(tp, 0x19, 0x4880);
mdio_write(tp, 0x15, 0x0008);
mdio_write(tp, 0x19, 0x4c00);
mdio_write(tp, 0x15, 0x0009);
mdio_write(tp, 0x19, 0x4800);
mdio_write(tp, 0x15, 0x000a);
mdio_write(tp, 0x19, 0x5000);
mdio_write(tp, 0x15, 0x000b);
mdio_write(tp, 0x19, 0x4400);
mdio_write(tp, 0x15, 0x000c);
mdio_write(tp, 0x19, 0x7801);
mdio_write(tp, 0x15, 0x000d);
mdio_write(tp, 0x19, 0x4000);
mdio_write(tp, 0x15, 0x000e);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x000f);
mdio_write(tp, 0x19, 0x7010);
mdio_write(tp, 0x15, 0x0010);
mdio_write(tp, 0x19, 0x6804);
mdio_write(tp, 0x15, 0x0011);
mdio_write(tp, 0x19, 0x64a0);
mdio_write(tp, 0x15, 0x0012);
mdio_write(tp, 0x19, 0x63da);
mdio_write(tp, 0x15, 0x0013);
mdio_write(tp, 0x19, 0x63d8);
mdio_write(tp, 0x15, 0x0014);
mdio_write(tp, 0x19, 0x6f05);
mdio_write(tp, 0x15, 0x0015);
mdio_write(tp, 0x19, 0x5420);
mdio_write(tp, 0x15, 0x0016);
mdio_write(tp, 0x19, 0x58ce);
mdio_write(tp, 0x15, 0x0017);
mdio_write(tp, 0x19, 0x5cf3);
mdio_write(tp, 0x15, 0x0018);
mdio_write(tp, 0x19, 0xb600);
mdio_write(tp, 0x15, 0x0019);
mdio_write(tp, 0x19, 0xc659);
mdio_write(tp, 0x15, 0x001a);
mdio_write(tp, 0x19, 0x0018);
mdio_write(tp, 0x15, 0x001b);
mdio_write(tp, 0x19, 0xc403);
mdio_write(tp, 0x15, 0x001c);
mdio_write(tp, 0x19, 0x0016);
mdio_write(tp, 0x15, 0x001d);
mdio_write(tp, 0x19, 0xaa05);
mdio_write(tp, 0x15, 0x001e);
mdio_write(tp, 0x19, 0xc503);
mdio_write(tp, 0x15, 0x001f);
mdio_write(tp, 0x19, 0x0003);
mdio_write(tp, 0x15, 0x0020);
mdio_write(tp, 0x19, 0x89f8);
mdio_write(tp, 0x15, 0x0021);
mdio_write(tp, 0x19, 0x32ae);
mdio_write(tp, 0x15, 0x0022);
mdio_write(tp, 0x19, 0x7c03);
mdio_write(tp, 0x15, 0x0023);
mdio_write(tp, 0x19, 0x6c03);
mdio_write(tp, 0x15, 0x0024);
mdio_write(tp, 0x19, 0x7c03);
mdio_write(tp, 0x15, 0x0025);
mdio_write(tp, 0x19, 0x6801);
mdio_write(tp, 0x15, 0x0026);
mdio_write(tp, 0x19, 0x66a0);
mdio_write(tp, 0x15, 0x0027);
mdio_write(tp, 0x19, 0xa300);
mdio_write(tp, 0x15, 0x0028);
mdio_write(tp, 0x19, 0x64a0);
mdio_write(tp, 0x15, 0x0029);
mdio_write(tp, 0x19, 0x76f0);
mdio_write(tp, 0x15, 0x002a);
mdio_write(tp, 0x19, 0x7670);
mdio_write(tp, 0x15, 0x002b);
mdio_write(tp, 0x19, 0x7630);
mdio_write(tp, 0x15, 0x002c);
mdio_write(tp, 0x19, 0x31a6);
mdio_write(tp, 0x15, 0x002d);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x002e);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x002f);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0030);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0031);
mdio_write(tp, 0x19, 0x0000);
mdio_write(tp, 0x15, 0x0032);
mdio_write(tp, 0x19, 0x4801);
mdio_write(tp, 0x15, 0x0033);
mdio_write(tp, 0x19, 0x6803);
mdio_write(tp, 0x15, 0x0034);
mdio_write(tp, 0x19, 0x66a1);
mdio_write(tp, 0x15, 0x0035);
mdio_write(tp, 0x19, 0x7c03);
mdio_write(tp, 0x15, 0x0036);
mdio_write(tp, 0x19, 0x6c03);
mdio_write(tp, 0x15, 0x0037);
mdio_write(tp, 0x19, 0xa300);
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mdio_write(tp, 0x06, 0xad36);
mdio_write(tp, 0x06, 0x085a);
mdio_write(tp, 0x06, 0x309f);
mdio_write(tp, 0x06, 0x04d1);
mdio_write(tp, 0x06, 0x01ae);
mdio_write(tp, 0x06, 0x02d1);
mdio_write(tp, 0x06, 0x00bf);
mdio_write(tp, 0x06, 0x82dc);
mdio_write(tp, 0x06, 0x0232);
mdio_write(tp, 0x06, 0x0aef);
mdio_write(tp, 0x06, 0x96fe);
mdio_write(tp, 0x06, 0xfdfc);
mdio_write(tp, 0x06, 0x0400);
mdio_write(tp, 0x06, 0xe140);
mdio_write(tp, 0x06, 0x77e1);
mdio_write(tp, 0x06, 0x4010);
mdio_write(tp, 0x06, 0xe150);
mdio_write(tp, 0x06, 0x32e1);
mdio_write(tp, 0x06, 0x5030);
mdio_write(tp, 0x06, 0xe144);
mdio_write(tp, 0x06, 0x74e1);
mdio_write(tp, 0x06, 0x44bb);
mdio_write(tp, 0x06, 0xe2d2);
mdio_write(tp, 0x06, 0x40e0);
mdio_write(tp, 0x06, 0x2cfc);
mdio_write(tp, 0x06, 0xe2cc);
mdio_write(tp, 0x06, 0xcce2);
mdio_write(tp, 0x06, 0x00cc);
mdio_write(tp, 0x06, 0xe000);
mdio_write(tp, 0x06, 0x99e0);
mdio_write(tp, 0x06, 0x3688);
mdio_write(tp, 0x06, 0xe036);
mdio_write(tp, 0x06, 0x99e1);
mdio_write(tp, 0x06, 0x40dd);
mdio_write(tp, 0x06, 0xe022);
mdio_write(tp, 0x05, 0xe142);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x05, 0xe140);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~(BIT_0);
gphy_val |= BIT_2;
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0002);
mdio_write(tp, 0x1f, 0x0000);
}
static void
rtl8168_set_phy_mcu_8168evl_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
unsigned int gphy_val,i;
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x1800);
gphy_val = mdio_read(tp, 0x15);
gphy_val &= ~(BIT_12);
mdio_write(tp, 0x15, gphy_val);
mdio_write(tp, 0x00, 0x4800);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x002f);
for (i = 0; i < 1000; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1c);
if ((gphy_val & 0x0080) == 0x0080)
break;
}
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x1800);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x17);
if (!(gphy_val & 0x0001))
break;
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x00AF);
mdio_write(tp, 0x19, 0x4060);
mdio_write(tp, 0x15, 0x00B0);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x00B1);
mdio_write(tp, 0x19, 0x7e00);
mdio_write(tp, 0x15, 0x00B2);
mdio_write(tp, 0x19, 0x72B0);
mdio_write(tp, 0x15, 0x00B3);
mdio_write(tp, 0x19, 0x7F00);
mdio_write(tp, 0x15, 0x00B4);
mdio_write(tp, 0x19, 0x73B0);
mdio_write(tp, 0x15, 0x0101);
mdio_write(tp, 0x19, 0x0005);
mdio_write(tp, 0x15, 0x0103);
mdio_write(tp, 0x19, 0x0003);
mdio_write(tp, 0x15, 0x0105);
mdio_write(tp, 0x19, 0x30FD);
mdio_write(tp, 0x15, 0x0106);
mdio_write(tp, 0x19, 0x9DF7);
mdio_write(tp, 0x15, 0x0107);
mdio_write(tp, 0x19, 0x30C6);
mdio_write(tp, 0x15, 0x0098);
mdio_write(tp, 0x19, 0x7c0b);
mdio_write(tp, 0x15, 0x0099);
mdio_write(tp, 0x19, 0x6c0b);
mdio_write(tp, 0x15, 0x00eb);
mdio_write(tp, 0x19, 0x6c0b);
mdio_write(tp, 0x15, 0x00f8);
mdio_write(tp, 0x19, 0x6f0b);
mdio_write(tp, 0x15, 0x00fe);
mdio_write(tp, 0x19, 0x6f0f);
mdio_write(tp, 0x15, 0x00db);
mdio_write(tp, 0x19, 0x6f09);
mdio_write(tp, 0x15, 0x00dc);
mdio_write(tp, 0x19, 0xaefd);
mdio_write(tp, 0x15, 0x00dd);
mdio_write(tp, 0x19, 0x6f0b);
mdio_write(tp, 0x15, 0x00de);
mdio_write(tp, 0x19, 0xc60b);
mdio_write(tp, 0x15, 0x00df);
mdio_write(tp, 0x19, 0x00fa);
mdio_write(tp, 0x15, 0x00e0);
mdio_write(tp, 0x19, 0x30e1);
mdio_write(tp, 0x15, 0x020c);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x020e);
mdio_write(tp, 0x19, 0x9813);
mdio_write(tp, 0x15, 0x020f);
mdio_write(tp, 0x19, 0x7801);
mdio_write(tp, 0x15, 0x0210);
mdio_write(tp, 0x19, 0x930f);
mdio_write(tp, 0x15, 0x0211);
mdio_write(tp, 0x19, 0x9206);
mdio_write(tp, 0x15, 0x0212);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0213);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0214);
mdio_write(tp, 0x19, 0x588f);
mdio_write(tp, 0x15, 0x0215);
mdio_write(tp, 0x19, 0x5520);
mdio_write(tp, 0x15, 0x0216);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x0217);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0218);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0219);
mdio_write(tp, 0x19, 0x588d);
mdio_write(tp, 0x15, 0x021a);
mdio_write(tp, 0x19, 0x5540);
mdio_write(tp, 0x15, 0x021b);
mdio_write(tp, 0x19, 0x9e03);
mdio_write(tp, 0x15, 0x021c);
mdio_write(tp, 0x19, 0x7c40);
mdio_write(tp, 0x15, 0x021d);
mdio_write(tp, 0x19, 0x6840);
mdio_write(tp, 0x15, 0x021e);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x021f);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0220);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x0221);
mdio_write(tp, 0x19, 0x9e03);
mdio_write(tp, 0x15, 0x0222);
mdio_write(tp, 0x19, 0x7c40);
mdio_write(tp, 0x15, 0x0223);
mdio_write(tp, 0x19, 0x6840);
mdio_write(tp, 0x15, 0x0224);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0225);
mdio_write(tp, 0x19, 0x3231);
mdio_write(tp, 0x15, 0x0000);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0300);
mdio_write(tp, 0x1f, 0x0002);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x17, 0x2160);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0040);
mdio_write(tp, 0x18, 0x0004);
if (pdev->subsystem_vendor == 0x144d &&
pdev->subsystem_device == 0xc0a6) {
mdio_write(tp, 0x18, 0x0724);
mdio_write(tp, 0x19, 0xfe00);
mdio_write(tp, 0x18, 0x0734);
mdio_write(tp, 0x19, 0xfd00);
mdio_write(tp, 0x18, 0x1824);
mdio_write(tp, 0x19, 0xfc00);
mdio_write(tp, 0x18, 0x1834);
mdio_write(tp, 0x19, 0xfd00);
}
mdio_write(tp, 0x18, 0x09d4);
mdio_write(tp, 0x19, 0x4000);
mdio_write(tp, 0x18, 0x09e4);
mdio_write(tp, 0x19, 0x0800);
mdio_write(tp, 0x18, 0x09f4);
mdio_write(tp, 0x19, 0xff00);
mdio_write(tp, 0x18, 0x0a04);
mdio_write(tp, 0x19, 0x4000);
mdio_write(tp, 0x18, 0x0a14);
mdio_write(tp, 0x19, 0x0c00);
mdio_write(tp, 0x18, 0x0a24);
mdio_write(tp, 0x19, 0xff00);
mdio_write(tp, 0x18, 0x0a74);
mdio_write(tp, 0x19, 0xf600);
mdio_write(tp, 0x18, 0x1a24);
mdio_write(tp, 0x19, 0x7d00);
mdio_write(tp, 0x18, 0x1a64);
mdio_write(tp, 0x19, 0x0500);
mdio_write(tp, 0x18, 0x1a74);
mdio_write(tp, 0x19, 0x9500);
mdio_write(tp, 0x18, 0x1a84);
mdio_write(tp, 0x19, 0x8000);
mdio_write(tp, 0x18, 0x1a94);
mdio_write(tp, 0x19, 0x7d00);
mdio_write(tp, 0x18, 0x1aa4);
mdio_write(tp, 0x19, 0x9600);
mdio_write(tp, 0x18, 0x1ac4);
mdio_write(tp, 0x19, 0x4000);
mdio_write(tp, 0x18, 0x1ad4);
mdio_write(tp, 0x19, 0x0800);
mdio_write(tp, 0x18, 0x1af4);
mdio_write(tp, 0x19, 0xc400);
mdio_write(tp, 0x18, 0x1b04);
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mdio_write(tp, 0x18, 0x1b14);
mdio_write(tp, 0x19, 0x0800);
mdio_write(tp, 0x18, 0x1b24);
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mdio_write(tp, 0x18, 0x1b94);
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mdio_write(tp, 0x06, 0x0201);
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mdio_write(tp, 0x06, 0x8a1e);
mdio_write(tp, 0x06, 0x01e1);
mdio_write(tp, 0x06, 0x8b8b);
mdio_write(tp, 0x06, 0x1e01);
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mdio_write(tp, 0x06, 0x8c1e);
mdio_write(tp, 0x06, 0x01e1);
mdio_write(tp, 0x06, 0x8b8d);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8e1e);
mdio_write(tp, 0x06, 0x01a0);
mdio_write(tp, 0x06, 0x00c7);
mdio_write(tp, 0x06, 0xaebb);
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mdio_write(tp, 0x06, 0x23d1);
mdio_write(tp, 0x06, 0x02bf);
mdio_write(tp, 0x06, 0x85a1);
mdio_write(tp, 0x06, 0x0237);
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gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x05, 0xe140);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0042);
mdio_write(tp, 0x18, 0x2300);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
if (tp->RequiredSecLanDonglePatch) {
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~BIT_2;
mdio_write(tp, 0x17, gphy_val);
}
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x9200);
}
static void
rtl8168_set_phy_mcu_8168f_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp,0x00, 0x1800);
gphy_val = mdio_read(tp, 0x15);
gphy_val &= ~(BIT_12);
mdio_write(tp,0x15, gphy_val);
mdio_write(tp,0x00, 0x4800);
mdio_write(tp,0x1f, 0x0007);
mdio_write(tp,0x1e, 0x002f);
for (i = 0; i < 1000; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1c);
if (gphy_val & 0x0080)
break;
}
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp,0x00, 0x1800);
mdio_write(tp,0x1f, 0x0007);
mdio_write(tp,0x1e, 0x0023);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x18);
if (!(gphy_val & 0x0001))
break;
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
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mdio_write(tp, 0x15, 0x0099);
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mdio_write(tp, 0x19, 0x6c0b);
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mdio_write(tp, 0x06, 0xe0e0);
mdio_write(tp, 0x06, 0x28e1);
mdio_write(tp, 0x06, 0xe029);
mdio_write(tp, 0x06, 0xf72c);
mdio_write(tp, 0x06, 0xe4e0);
mdio_write(tp, 0x06, 0x28e5);
mdio_write(tp, 0x06, 0xe029);
mdio_write(tp, 0x06, 0xf62c);
mdio_write(tp, 0x06, 0xe4e0);
mdio_write(tp, 0x06, 0x28e5);
mdio_write(tp, 0x06, 0xe029);
mdio_write(tp, 0x06, 0xfc04);
mdio_write(tp, 0x06, 0x00e1);
mdio_write(tp, 0x06, 0x4077);
mdio_write(tp, 0x06, 0xe140);
mdio_write(tp, 0x06, 0x52e0);
mdio_write(tp, 0x06, 0xeed9);
mdio_write(tp, 0x06, 0xe04c);
mdio_write(tp, 0x06, 0xbbe0);
mdio_write(tp, 0x06, 0x2a00);
mdio_write(tp, 0x05, 0xe142);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp,0x06, gphy_val);
mdio_write(tp, 0x05, 0xe140);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp,0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp,0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val |= BIT_1;
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~BIT_2;
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x09, 0xA20F);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1f, 0x0003);
mdio_write(tp, 0x01, 0x328A);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x9200);
}
static void
rtl8168_set_phy_mcu_8168f_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp,0x00, 0x1800);
gphy_val = mdio_read(tp, 0x15);
gphy_val &= ~(BIT_12);
mdio_write(tp,0x15, gphy_val);
mdio_write(tp,0x00, 0x9800);
mdio_write(tp,0x1f, 0x0007);
mdio_write(tp,0x1e, 0x002f);
for (i = 0; i < 1000; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1c);
if (gphy_val & 0x0080)
break;
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x0098);
mdio_write(tp, 0x19, 0x7c0b);
mdio_write(tp, 0x15, 0x0099);
mdio_write(tp, 0x19, 0x6c0b);
mdio_write(tp, 0x15, 0x00eb);
mdio_write(tp, 0x19, 0x6c0b);
mdio_write(tp, 0x15, 0x00f8);
mdio_write(tp, 0x19, 0x6f0b);
mdio_write(tp, 0x15, 0x00fe);
mdio_write(tp, 0x19, 0x6f0f);
mdio_write(tp, 0x15, 0x00db);
mdio_write(tp, 0x19, 0x6f09);
mdio_write(tp, 0x15, 0x00dc);
mdio_write(tp, 0x19, 0xaefd);
mdio_write(tp, 0x15, 0x00dd);
mdio_write(tp, 0x19, 0x6f0b);
mdio_write(tp, 0x15, 0x00de);
mdio_write(tp, 0x19, 0xc60b);
mdio_write(tp, 0x15, 0x00df);
mdio_write(tp, 0x19, 0x00fa);
mdio_write(tp, 0x15, 0x00e0);
mdio_write(tp, 0x19, 0x30e1);
mdio_write(tp, 0x15, 0x020c);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x020e);
mdio_write(tp, 0x19, 0x9813);
mdio_write(tp, 0x15, 0x020f);
mdio_write(tp, 0x19, 0x7801);
mdio_write(tp, 0x15, 0x0210);
mdio_write(tp, 0x19, 0x930f);
mdio_write(tp, 0x15, 0x0211);
mdio_write(tp, 0x19, 0x9206);
mdio_write(tp, 0x15, 0x0212);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0213);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0214);
mdio_write(tp, 0x19, 0x588f);
mdio_write(tp, 0x15, 0x0215);
mdio_write(tp, 0x19, 0x5520);
mdio_write(tp, 0x15, 0x0216);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x0217);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0218);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0219);
mdio_write(tp, 0x19, 0x588d);
mdio_write(tp, 0x15, 0x021a);
mdio_write(tp, 0x19, 0x5540);
mdio_write(tp, 0x15, 0x021b);
mdio_write(tp, 0x19, 0x9e03);
mdio_write(tp, 0x15, 0x021c);
mdio_write(tp, 0x19, 0x7c40);
mdio_write(tp, 0x15, 0x021d);
mdio_write(tp, 0x19, 0x6840);
mdio_write(tp, 0x15, 0x021e);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x021f);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0220);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x0221);
mdio_write(tp, 0x19, 0x9e03);
mdio_write(tp, 0x15, 0x0222);
mdio_write(tp, 0x19, 0x7c40);
mdio_write(tp, 0x15, 0x0223);
mdio_write(tp, 0x19, 0x6840);
mdio_write(tp, 0x15, 0x0224);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0225);
mdio_write(tp, 0x19, 0x3231);
mdio_write(tp, 0x15, 0x0000);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0300);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
mdio_write(tp, 0x05, 0x8000);
mdio_write(tp, 0x06, 0x0280);
mdio_write(tp, 0x06, 0x48f7);
mdio_write(tp, 0x06, 0x00e0);
mdio_write(tp, 0x06, 0xfff7);
mdio_write(tp, 0x06, 0xa080);
mdio_write(tp, 0x06, 0x02ae);
mdio_write(tp, 0x06, 0xf602);
mdio_write(tp, 0x06, 0x011b);
mdio_write(tp, 0x06, 0x0201);
mdio_write(tp, 0x06, 0x2802);
mdio_write(tp, 0x06, 0x0135);
mdio_write(tp, 0x06, 0x0201);
mdio_write(tp, 0x06, 0x4502);
mdio_write(tp, 0x06, 0x015f);
mdio_write(tp, 0x06, 0x0280);
mdio_write(tp, 0x06, 0x6b02);
mdio_write(tp, 0x06, 0x80e5);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x88e1);
mdio_write(tp, 0x06, 0x8b89);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8a1e);
mdio_write(tp, 0x06, 0x01e1);
mdio_write(tp, 0x06, 0x8b8b);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8c1e);
mdio_write(tp, 0x06, 0x01e1);
mdio_write(tp, 0x06, 0x8b8d);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8e1e);
mdio_write(tp, 0x06, 0x01a0);
mdio_write(tp, 0x06, 0x00c7);
mdio_write(tp, 0x06, 0xaebb);
mdio_write(tp, 0x06, 0xbf8b);
mdio_write(tp, 0x06, 0x88ec);
mdio_write(tp, 0x06, 0x0019);
mdio_write(tp, 0x06, 0xa98b);
mdio_write(tp, 0x06, 0x90f9);
mdio_write(tp, 0x06, 0xeeff);
mdio_write(tp, 0x06, 0xf600);
mdio_write(tp, 0x06, 0xeeff);
mdio_write(tp, 0x06, 0xf7fe);
mdio_write(tp, 0x06, 0xd100);
mdio_write(tp, 0x06, 0xbf81);
mdio_write(tp, 0x06, 0x9802);
mdio_write(tp, 0x06, 0x39f3);
mdio_write(tp, 0x06, 0xd101);
mdio_write(tp, 0x06, 0xbf81);
mdio_write(tp, 0x06, 0x9b02);
mdio_write(tp, 0x06, 0x39f3);
mdio_write(tp, 0x06, 0x04f8);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x8dad);
mdio_write(tp, 0x06, 0x2014);
mdio_write(tp, 0x06, 0xee8b);
mdio_write(tp, 0x06, 0x8d00);
mdio_write(tp, 0x06, 0xe08a);
mdio_write(tp, 0x06, 0x5a78);
mdio_write(tp, 0x06, 0x039e);
mdio_write(tp, 0x06, 0x0902);
mdio_write(tp, 0x06, 0x05fc);
mdio_write(tp, 0x06, 0x0280);
mdio_write(tp, 0x06, 0x8802);
mdio_write(tp, 0x06, 0x32dd);
mdio_write(tp, 0x06, 0xfc04);
mdio_write(tp, 0x06, 0xf8f9);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x81ac);
mdio_write(tp, 0x06, 0x261a);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x81ac);
mdio_write(tp, 0x06, 0x2114);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x85ac);
mdio_write(tp, 0x06, 0x200e);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x85ac);
mdio_write(tp, 0x06, 0x2308);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x87ac);
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mdio_write(tp, 0x06, 0x021a);
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mdio_write(tp, 0x06, 0xe41d);
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mdio_write(tp, 0x06, 0x0222);
mdio_write(tp, 0x06, 0x7202);
mdio_write(tp, 0x06, 0x1ae7);
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mdio_write(tp, 0x06, 0x04f8);
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mdio_write(tp, 0x06, 0x8ead);
mdio_write(tp, 0x06, 0x210b);
mdio_write(tp, 0x06, 0xf621);
mdio_write(tp, 0x06, 0xe48b);
mdio_write(tp, 0x06, 0x8e02);
mdio_write(tp, 0x06, 0x0445);
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mdio_write(tp, 0x06, 0x8b8e);
mdio_write(tp, 0x06, 0x0235);
mdio_write(tp, 0x06, 0xd4e0);
mdio_write(tp, 0x06, 0x8b8e);
mdio_write(tp, 0x06, 0xad23);
mdio_write(tp, 0x06, 0x08f6);
mdio_write(tp, 0x06, 0x23e4);
mdio_write(tp, 0x06, 0x8b8e);
mdio_write(tp, 0x06, 0x0231);
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mdio_write(tp, 0x06, 0x8b8e);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x8ead);
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mdio_write(tp, 0x06, 0xe48b);
mdio_write(tp, 0x06, 0x8ee0);
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mdio_write(tp, 0x06, 0x08f6);
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mdio_write(tp, 0x06, 0xe140);
mdio_write(tp, 0x06, 0xbbe0);
mdio_write(tp, 0x06, 0x2a00);
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gphy_val = mdio_read(tp, 0x06);
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mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x05, 0xe140);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val |= BIT_1;
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~BIT_2;
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x00, 0x9200);
}
static void
rtl8168_set_phy_mcu_8411_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp,0x00, 0x1800);
gphy_val = mdio_read(tp, 0x15);
gphy_val &= ~(BIT_12);
mdio_write(tp,0x15, gphy_val);
mdio_write(tp,0x00, 0x4800);
mdio_write(tp,0x1f, 0x0007);
mdio_write(tp,0x1e, 0x002f);
for (i = 0; i < 1000; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x1c);
if (gphy_val & 0x0080)
break;
}
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp,0x00, 0x1800);
mdio_write(tp,0x1f, 0x0007);
mdio_write(tp,0x1e, 0x0023);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x18);
if (!(gphy_val & 0x0001))
break;
}
mdio_write(tp,0x1f, 0x0005);
mdio_write(tp,0x05, 0xfff6);
mdio_write(tp,0x06, 0x0080);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x0023);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0307);
mdio_write(tp, 0x15, 0x0098);
mdio_write(tp, 0x19, 0x7c0b);
mdio_write(tp, 0x15, 0x0099);
mdio_write(tp, 0x19, 0x6c0b);
mdio_write(tp, 0x15, 0x00eb);
mdio_write(tp, 0x19, 0x6c0b);
mdio_write(tp, 0x15, 0x00f8);
mdio_write(tp, 0x19, 0x6f0b);
mdio_write(tp, 0x15, 0x00fe);
mdio_write(tp, 0x19, 0x6f0f);
mdio_write(tp, 0x15, 0x00db);
mdio_write(tp, 0x19, 0x6f09);
mdio_write(tp, 0x15, 0x00dc);
mdio_write(tp, 0x19, 0xaefd);
mdio_write(tp, 0x15, 0x00dd);
mdio_write(tp, 0x19, 0x6f0b);
mdio_write(tp, 0x15, 0x00de);
mdio_write(tp, 0x19, 0xc60b);
mdio_write(tp, 0x15, 0x00df);
mdio_write(tp, 0x19, 0x00fa);
mdio_write(tp, 0x15, 0x00e0);
mdio_write(tp, 0x19, 0x30e1);
mdio_write(tp, 0x15, 0x020c);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x020e);
mdio_write(tp, 0x19, 0x9813);
mdio_write(tp, 0x15, 0x020f);
mdio_write(tp, 0x19, 0x7801);
mdio_write(tp, 0x15, 0x0210);
mdio_write(tp, 0x19, 0x930f);
mdio_write(tp, 0x15, 0x0211);
mdio_write(tp, 0x19, 0x9206);
mdio_write(tp, 0x15, 0x0212);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0213);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0214);
mdio_write(tp, 0x19, 0x588f);
mdio_write(tp, 0x15, 0x0215);
mdio_write(tp, 0x19, 0x5520);
mdio_write(tp, 0x15, 0x0216);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x0217);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0218);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0219);
mdio_write(tp, 0x19, 0x588d);
mdio_write(tp, 0x15, 0x021a);
mdio_write(tp, 0x19, 0x5540);
mdio_write(tp, 0x15, 0x021b);
mdio_write(tp, 0x19, 0x9e03);
mdio_write(tp, 0x15, 0x021c);
mdio_write(tp, 0x19, 0x7c40);
mdio_write(tp, 0x15, 0x021d);
mdio_write(tp, 0x19, 0x6840);
mdio_write(tp, 0x15, 0x021e);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x021f);
mdio_write(tp, 0x19, 0x4002);
mdio_write(tp, 0x15, 0x0220);
mdio_write(tp, 0x19, 0x3224);
mdio_write(tp, 0x15, 0x0221);
mdio_write(tp, 0x19, 0x9e03);
mdio_write(tp, 0x15, 0x0222);
mdio_write(tp, 0x19, 0x7c40);
mdio_write(tp, 0x15, 0x0223);
mdio_write(tp, 0x19, 0x6840);
mdio_write(tp, 0x15, 0x0224);
mdio_write(tp, 0x19, 0x7800);
mdio_write(tp, 0x15, 0x0225);
mdio_write(tp, 0x19, 0x3231);
mdio_write(tp, 0x15, 0x0000);
mdio_write(tp, 0x16, 0x0306);
mdio_write(tp, 0x16, 0x0300);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
mdio_write(tp, 0x05, 0x8000);
mdio_write(tp, 0x06, 0x0280);
mdio_write(tp, 0x06, 0x48f7);
mdio_write(tp, 0x06, 0x00e0);
mdio_write(tp, 0x06, 0xfff7);
mdio_write(tp, 0x06, 0xa080);
mdio_write(tp, 0x06, 0x02ae);
mdio_write(tp, 0x06, 0xf602);
mdio_write(tp, 0x06, 0x011e);
mdio_write(tp, 0x06, 0x0201);
mdio_write(tp, 0x06, 0x2b02);
mdio_write(tp, 0x06, 0x8077);
mdio_write(tp, 0x06, 0x0201);
mdio_write(tp, 0x06, 0x4802);
mdio_write(tp, 0x06, 0x0162);
mdio_write(tp, 0x06, 0x0280);
mdio_write(tp, 0x06, 0x9402);
mdio_write(tp, 0x06, 0x810e);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x88e1);
mdio_write(tp, 0x06, 0x8b89);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8a1e);
mdio_write(tp, 0x06, 0x01e1);
mdio_write(tp, 0x06, 0x8b8b);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8c1e);
mdio_write(tp, 0x06, 0x01e1);
mdio_write(tp, 0x06, 0x8b8d);
mdio_write(tp, 0x06, 0x1e01);
mdio_write(tp, 0x06, 0xe18b);
mdio_write(tp, 0x06, 0x8e1e);
mdio_write(tp, 0x06, 0x01a0);
mdio_write(tp, 0x06, 0x00c7);
mdio_write(tp, 0x06, 0xaebb);
mdio_write(tp, 0x06, 0xd481);
mdio_write(tp, 0x06, 0xd4e4);
mdio_write(tp, 0x06, 0x8b92);
mdio_write(tp, 0x06, 0xe58b);
mdio_write(tp, 0x06, 0x9302);
mdio_write(tp, 0x06, 0x2e5a);
mdio_write(tp, 0x06, 0xbf8b);
mdio_write(tp, 0x06, 0x88ec);
mdio_write(tp, 0x06, 0x0019);
mdio_write(tp, 0x06, 0xa98b);
mdio_write(tp, 0x06, 0x90f9);
mdio_write(tp, 0x06, 0xeeff);
mdio_write(tp, 0x06, 0xf600);
mdio_write(tp, 0x06, 0xeeff);
mdio_write(tp, 0x06, 0xf7fc);
mdio_write(tp, 0x06, 0xd100);
mdio_write(tp, 0x06, 0xbf83);
mdio_write(tp, 0x06, 0x3c02);
mdio_write(tp, 0x06, 0x3a21);
mdio_write(tp, 0x06, 0xd101);
mdio_write(tp, 0x06, 0xbf83);
mdio_write(tp, 0x06, 0x3f02);
mdio_write(tp, 0x06, 0x3a21);
mdio_write(tp, 0x06, 0x04f8);
mdio_write(tp, 0x06, 0xe08b);
mdio_write(tp, 0x06, 0x8aad);
mdio_write(tp, 0x06, 0x2014);
mdio_write(tp, 0x06, 0xee8b);
mdio_write(tp, 0x06, 0x8a00);
mdio_write(tp, 0x06, 0x0220);
mdio_write(tp, 0x06, 0x8be0);
mdio_write(tp, 0x06, 0xe426);
mdio_write(tp, 0x06, 0xe1e4);
mdio_write(tp, 0x06, 0x27ee);
mdio_write(tp, 0x06, 0xe426);
mdio_write(tp, 0x06, 0x23e5);
mdio_write(tp, 0x06, 0xe427);
mdio_write(tp, 0x06, 0xfc04);
mdio_write(tp, 0x06, 0xf8e0);
mdio_write(tp, 0x06, 0x8b8d);
mdio_write(tp, 0x06, 0xad20);
mdio_write(tp, 0x06, 0x14ee);
mdio_write(tp, 0x06, 0x8b8d);
mdio_write(tp, 0x06, 0x00e0);
mdio_write(tp, 0x06, 0x8a5a);
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mdio_write(tp, 0x06, 0x9e09);
mdio_write(tp, 0x06, 0x0206);
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mdio_write(tp, 0x06, 0xac20);
mdio_write(tp, 0x06, 0x0ee0);
mdio_write(tp, 0x06, 0x8b85);
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mdio_write(tp, 0x06, 0x08e0);
mdio_write(tp, 0x06, 0x8b87);
mdio_write(tp, 0x06, 0xac24);
mdio_write(tp, 0x06, 0x02ae);
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mdio_write(tp, 0x06, 0x1c04);
mdio_write(tp, 0x06, 0xeee4);
mdio_write(tp, 0x06, 0x1d04);
mdio_write(tp, 0x06, 0xe2e0);
mdio_write(tp, 0x06, 0x7ce3);
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mdio_write(tp, 0x06, 0x8b8e);
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mdio_write(tp, 0x06, 0xfebf);
mdio_write(tp, 0x06, 0x1c5e);
mdio_write(tp, 0x06, 0x0239);
mdio_write(tp, 0x06, 0xf4ac);
mdio_write(tp, 0x06, 0x280b);
mdio_write(tp, 0x06, 0xbf1c);
mdio_write(tp, 0x06, 0x5b02);
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mdio_write(tp, 0x06, 0xe0e0);
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mdio_write(tp, 0x06, 0xe4e0);
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mdio_write(tp, 0x06, 0xe029);
mdio_write(tp, 0x06, 0xfc04);
mdio_write(tp, 0x06, 0x00e1);
mdio_write(tp, 0x06, 0x4077);
mdio_write(tp, 0x06, 0xe140);
mdio_write(tp, 0x06, 0xbbe0);
mdio_write(tp, 0x06, 0x2a00);
mdio_write(tp, 0x05, 0xe142);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp,0x06, gphy_val);
mdio_write(tp, 0x05, 0xe140);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp,0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp,0x1f, 0x0005);
for (i = 0; i < 200; i++) {
udelay(100);
gphy_val = mdio_read(tp, 0x00);
if (gphy_val & BIT_7)
break;
}
mdio_write(tp,0x1f, 0x0007);
mdio_write(tp,0x1e, 0x0023);
gphy_val = mdio_read(tp, 0x17);
gphy_val |= BIT_1;
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~BIT_2;
mdio_write(tp,0x17, gphy_val);
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x09, 0xA20F);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1f, 0x0003);
mdio_write(tp, 0x01, 0x328A);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp,0x1f, 0x0000);
mdio_write(tp,0x00, 0x9200);
}
static void
rtl8168_set_phy_mcu_8168g_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp, 0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x10);
gphy_val |= BIT_4;
mdio_write(tp, 0x10, gphy_val);
mdio_write(tp, 0x1f, 0x0B80);
for (i = 0; i < 10; i++) {
if (mdio_read(tp, 0x10) & 0x0040)
break;
mdelay(10);
}
mdio_write(tp, 0x1f, 0x0A43);
mdio_write(tp, 0x13, 0x8146);
mdio_write(tp, 0x14, 0x2300);
mdio_write(tp, 0x13, 0xB820);
mdio_write(tp, 0x14, 0x0210);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0xB820);
mdio_write(tp, 0x14, 0x0290);
mdio_write(tp, 0x13, 0xA012);
mdio_write(tp, 0x14, 0x0000);
mdio_write(tp, 0x13, 0xA014);
mdio_write(tp, 0x14, 0x2c04);
mdio_write(tp, 0x14, 0x2c0c);
mdio_write(tp, 0x14, 0x2c6c);
mdio_write(tp, 0x14, 0x2d0d);
mdio_write(tp, 0x14, 0x31ce);
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mdio_write(tp, 0x14, 0xd708);
mdio_write(tp, 0x14, 0x3108);
mdio_write(tp, 0x14, 0x106d);
mdio_write(tp, 0x14, 0x1560);
mdio_write(tp, 0x14, 0x15a9);
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mdio_write(tp, 0x14, 0xd708);
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mdio_write(tp, 0x14, 0x0c19);
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mdio_write(tp, 0x14, 0xd709);
mdio_write(tp, 0x14, 0x42ec);
mdio_write(tp, 0x14, 0x606d);
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}
static void
rtl8168_set_phy_mcu_8168gu_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
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i = 0;
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gphy_val = mdio_read(tp, 0x10);
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udelay(50);
udelay(50);
i++;
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gphy_val = mdio_read(tp, 0x10);
gphy_val &= ~(BIT_4);
mdio_write(tp, 0x10, gphy_val);
}
static void
rtl8168_set_phy_mcu_8411b_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp,0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x10);
gphy_val |= BIT_4;
mdio_write(tp,0x10, gphy_val);
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i = 0;
do {
gphy_val = mdio_read(tp, 0x10);
gphy_val &= 0x0040;
udelay(50);
udelay(50);
i++;
} while(gphy_val != 0x0040 && i <1000);
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mdio_write(tp, 0x14, 0x2c07);
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gphy_val &= ~(BIT_0);
mdio_write(tp,0x17, gphy_val);
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gphy_val = mdio_read(tp, 0x10);
gphy_val &= ~(BIT_4);
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}
static void
rtl8168_set_phy_mcu_8168h_1(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp, 0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x10);
gphy_val |= BIT_4;
mdio_write(tp, 0x10, gphy_val);
mdio_write(tp, 0x1f, 0x0B80);
i = 0;
do {
gphy_val = mdio_read(tp, 0x10);
gphy_val &= 0x0040;
udelay(50);
udelay(50);
i++;
} while(gphy_val != 0x0040 && i <1000);
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mdio_write(tp, 0x14, 0x18d1);
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mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x0000);
mdio_write(tp, 0x14, 0x0000);
mdio_write(tp, 0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~(BIT_0);
mdio_write(tp, 0x17, gphy_val);
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gphy_val = mdio_read(tp, 0x10);
gphy_val &= ~(BIT_4);
mdio_write(tp, 0x10, gphy_val);
}
static void
rtl8168_set_phy_mcu_8168h_2(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int gphy_val,i;
mdio_write(tp, 0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x10);
gphy_val |= BIT_4;
mdio_write(tp, 0x10, gphy_val);
mdio_write(tp, 0x1f, 0x0B80);
i = 0;
do {
gphy_val = mdio_read(tp, 0x10);
gphy_val &= 0x0040;
udelay(50);
udelay(50);
i++;
} while(gphy_val != 0x0040 && i <1000);
mdio_write(tp, 0x1f, 0x0A43);
mdio_write(tp, 0x13, 0x8028);
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mdio_write(tp, 0x14, 0x0fff);
mdio_write(tp, 0x13, 0xA000);
mdio_write(tp, 0x14, 0x136b);
mdio_write(tp, 0x13, 0xB820);
mdio_write(tp, 0x14, 0x0210);
mdio_write(tp,0x1F, 0x0A43);
mdio_write(tp,0x13, 0x0000);
mdio_write(tp,0x14, 0x0000);
mdio_write(tp,0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x17);
gphy_val &= ~(BIT_0);
mdio_write(tp,0x17, gphy_val);
mdio_write(tp,0x1f, 0x0A43);
mdio_write(tp,0x13, 0x8028);
mdio_write(tp,0x14, 0x0000);
mdio_write(tp, 0x1f, 0x0B82);
gphy_val = mdio_read(tp, 0x10);
gphy_val &= ~(BIT_4);
mdio_write(tp, 0x10, gphy_val);
if (tp->RequiredSecLanDonglePatch) {
mdio_write(tp, 0x1F, 0x0A43);
gphy_val = mdio_read(tp, 0x11);
gphy_val &= ~BIT_6;
mdio_write(tp, 0x11, gphy_val);
}
}
static void
rtl8168_init_hw_phy_mcu(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u8 require_disable_phy_disable_mode = FALSE;
if (tp->NotWrRamCodeToMicroP == TRUE) return;
if (rtl8168_check_hw_phy_mcu_code_ver(dev)) return;
if (FALSE == rtl8168_phy_ram_code_check(dev)) {
rtl8168_set_phy_ram_code_check_fail_flag(dev);
return;
}
if (HW_SUPPORT_CHECK_PHY_DISABLE_MODE(tp) && rtl8168_is_in_phy_disable_mode(dev))
require_disable_phy_disable_mode = TRUE;
if (require_disable_phy_disable_mode)
rtl8168_disable_phy_disable_mode(dev);
switch (tp->mcfg) {
case CFG_METHOD_14:
rtl8168_set_phy_mcu_8168e_1(dev);
break;
case CFG_METHOD_15:
rtl8168_set_phy_mcu_8168e_2(dev);
break;
case CFG_METHOD_16:
rtl8168_set_phy_mcu_8168evl_1(dev);
break;
case CFG_METHOD_17:
rtl8168_set_phy_mcu_8168evl_2(dev);
break;
case CFG_METHOD_18:
rtl8168_set_phy_mcu_8168f_1(dev);
break;
case CFG_METHOD_19:
rtl8168_set_phy_mcu_8168f_2(dev);
break;
case CFG_METHOD_20:
rtl8168_set_phy_mcu_8411_1(dev);
break;
case CFG_METHOD_21:
rtl8168_set_phy_mcu_8168g_1(dev);
break;
case CFG_METHOD_25:
rtl8168_set_phy_mcu_8168gu_2(dev);
break;
case CFG_METHOD_26:
rtl8168_set_phy_mcu_8411b_1(dev);
break;
case CFG_METHOD_29:
rtl8168_set_phy_mcu_8168h_1(dev);
break;
case CFG_METHOD_30:
rtl8168_set_phy_mcu_8168h_2(dev);
break;
}
if (require_disable_phy_disable_mode)
rtl8168_enable_phy_disable_mode(dev);
rtl8168_write_hw_phy_mcu_code_ver(dev);
mdio_write(tp,0x1F, 0x0000);
tp->HwHasWrRamCodeToMicroP = TRUE;
}
static void
rtl8168_hw_phy_config(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
u16 gphy_val;
unsigned int i;
unsigned long flags;
tp->phy_reset_enable(dev);
if (HW_DASH_SUPPORT_TYPE_3(tp) && tp->HwPkgDet == 0x06) return;
spin_lock_irqsave(&tp->phy_lock, flags);
rtl8168_init_hw_phy_mcu(dev);
if (tp->mcfg == CFG_METHOD_1) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0B, 0x94B0);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x12, 0x6096);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0xF8A0);
} else if (tp->mcfg == CFG_METHOD_2) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0B, 0x94B0);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x12, 0x6096);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_3) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0B, 0x94B0);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x12, 0x6096);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_4) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x12, 0x2300);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x16, 0x000A);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x12, 0xC096);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x00, 0x88DE);
mdio_write(tp, 0x01, 0x82B1);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x08, 0x9E30);
mdio_write(tp, 0x09, 0x01F0);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0A, 0x5500);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x03, 0x7002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0C, 0x00C8);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | (1 << 5));
mdio_write(tp, 0x0D, mdio_read(tp, 0x0D) & ~(1 << 5));
} else if (tp->mcfg == CFG_METHOD_5) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x12, 0x2300);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x16, 0x0F0A);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x00, 0x88DE);
mdio_write(tp, 0x01, 0x82B1);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0C, 0x7EB8);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x06, 0x0761);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x03, 0x802F);
mdio_write(tp, 0x02, 0x4F02);
mdio_write(tp, 0x01, 0x0409);
mdio_write(tp, 0x00, 0xF099);
mdio_write(tp, 0x04, 0x9800);
mdio_write(tp, 0x04, 0x9000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x16, mdio_read(tp, 0x16) | (1 << 0));
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | (1 << 5));
mdio_write(tp, 0x0D, mdio_read(tp, 0x0D) & ~(1 << 5));
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x1D, 0x3D98);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_6) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x12, 0x2300);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x16, 0x0F0A);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x00, 0x88DE);
mdio_write(tp, 0x01, 0x82B1);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0C, 0x7EB8);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x06, 0x5461);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x06, 0x5461);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x16, mdio_read(tp, 0x16) | (1 << 0));
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | (1 << 5));
mdio_write(tp, 0x0D, mdio_read(tp, 0x0D) & ~(1 << 5));
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x1D, 0x3D98);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1f, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_7) {
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | (1 << 5));
mdio_write(tp, 0x0D, mdio_read(tp, 0x0D) & ~(1 << 5));
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x1D, 0x3D98);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x14, 0xCAA3);
mdio_write(tp, 0x1C, 0x000A);
mdio_write(tp, 0x18, 0x65D0);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x17, 0xB580);
mdio_write(tp, 0x18, 0xFF54);
mdio_write(tp, 0x19, 0x3954);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0D, 0x310C);
mdio_write(tp, 0x0E, 0x310C);
mdio_write(tp, 0x0F, 0x311C);
mdio_write(tp, 0x06, 0x0761);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x18, 0xFF55);
mdio_write(tp, 0x19, 0x3955);
mdio_write(tp, 0x18, 0xFF54);
mdio_write(tp, 0x19, 0x3954);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_8) {
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | (1 << 5));
mdio_write(tp, 0x0D, mdio_read(tp, 0x0D) & ~(1 << 5));
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x14, 0xCAA3);
mdio_write(tp, 0x1C, 0x000A);
mdio_write(tp, 0x18, 0x65D0);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x17, 0xB580);
mdio_write(tp, 0x18, 0xFF54);
mdio_write(tp, 0x19, 0x3954);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0D, 0x310C);
mdio_write(tp, 0x0E, 0x310C);
mdio_write(tp, 0x0F, 0x311C);
mdio_write(tp, 0x06, 0x0761);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x18, 0xFF55);
mdio_write(tp, 0x19, 0x3955);
mdio_write(tp, 0x18, 0xFF54);
mdio_write(tp, 0x19, 0x3954);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x16, mdio_read(tp, 0x16) | (1 << 0));
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_9) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x06, 0x4064);
mdio_write(tp, 0x07, 0x2863);
mdio_write(tp, 0x08, 0x059C);
mdio_write(tp, 0x09, 0x26B4);
mdio_write(tp, 0x0A, 0x6A19);
mdio_write(tp, 0x0B, 0xDCC8);
mdio_write(tp, 0x10, 0xF06D);
mdio_write(tp, 0x14, 0x7F68);
mdio_write(tp, 0x18, 0x7FD9);
mdio_write(tp, 0x1C, 0xF0FF);
mdio_write(tp, 0x1D, 0x3D9C);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x12, 0xF49F);
mdio_write(tp, 0x13, 0x070B);
mdio_write(tp, 0x1A, 0x05AD);
mdio_write(tp, 0x14, 0x94C0);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x0B) & 0xFF00;
gphy_val |= 0x10;
mdio_write(tp, 0x0B, gphy_val);
gphy_val = mdio_read(tp, 0x0C) & 0x00FF;
gphy_val |= 0xA200;
mdio_write(tp, 0x0C, gphy_val);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x06, 0x5561);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8332);
mdio_write(tp, 0x06, 0x5561);
if (rtl8168_efuse_read(tp, 0x01) == 0xb1) {
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x05, 0x669A);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8330);
mdio_write(tp, 0x06, 0x669A);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x0D);
if ((gphy_val & 0x00FF) != 0x006C) {
gphy_val &= 0xFF00;
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x0D, gphy_val | 0x0065);
mdio_write(tp, 0x0D, gphy_val | 0x0066);
mdio_write(tp, 0x0D, gphy_val | 0x0067);
mdio_write(tp, 0x0D, gphy_val | 0x0068);
mdio_write(tp, 0x0D, gphy_val | 0x0069);
mdio_write(tp, 0x0D, gphy_val | 0x006A);
mdio_write(tp, 0x0D, gphy_val | 0x006B);
mdio_write(tp, 0x0D, gphy_val | 0x006C);
}
} else {
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x05, 0x6662);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8330);
mdio_write(tp, 0x06, 0x6662);
}
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x0D);
gphy_val |= BIT_9;
gphy_val |= BIT_8;
mdio_write(tp, 0x0D, gphy_val);
gphy_val = mdio_read(tp, 0x0F);
gphy_val |= BIT_4;
mdio_write(tp, 0x0F, gphy_val);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x02);
gphy_val &= ~BIT_10;
gphy_val &= ~BIT_9;
gphy_val |= BIT_8;
mdio_write(tp, 0x02, gphy_val);
gphy_val = mdio_read(tp, 0x03);
gphy_val &= ~BIT_15;
gphy_val &= ~BIT_14;
gphy_val &= ~BIT_13;
mdio_write(tp, 0x03, gphy_val);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x001B);
if (mdio_read(tp, 0x06) == 0xBF00) {
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
mdio_write(tp, 0x05, 0x8000);
mdio_write(tp, 0x06, 0xf8f9);
mdio_write(tp, 0x06, 0xfaef);
mdio_write(tp, 0x06, 0x59ee);
mdio_write(tp, 0x06, 0xf8ea);
mdio_write(tp, 0x06, 0x00ee);
mdio_write(tp, 0x06, 0xf8eb);
mdio_write(tp, 0x06, 0x00e0);
mdio_write(tp, 0x06, 0xf87c);
mdio_write(tp, 0x06, 0xe1f8);
mdio_write(tp, 0x06, 0x7d59);
mdio_write(tp, 0x06, 0x0fef);
mdio_write(tp, 0x06, 0x0139);
mdio_write(tp, 0x06, 0x029e);
mdio_write(tp, 0x06, 0x06ef);
mdio_write(tp, 0x06, 0x1039);
mdio_write(tp, 0x06, 0x089f);
mdio_write(tp, 0x06, 0x2aee);
mdio_write(tp, 0x06, 0xf8ea);
mdio_write(tp, 0x06, 0x00ee);
mdio_write(tp, 0x06, 0xf8eb);
mdio_write(tp, 0x06, 0x01e0);
mdio_write(tp, 0x06, 0xf87c);
mdio_write(tp, 0x06, 0xe1f8);
mdio_write(tp, 0x06, 0x7d58);
mdio_write(tp, 0x06, 0x409e);
mdio_write(tp, 0x06, 0x0f39);
mdio_write(tp, 0x06, 0x46aa);
mdio_write(tp, 0x06, 0x0bbf);
mdio_write(tp, 0x06, 0x8290);
mdio_write(tp, 0x06, 0xd682);
mdio_write(tp, 0x06, 0x9802);
mdio_write(tp, 0x06, 0x014f);
mdio_write(tp, 0x06, 0xae09);
mdio_write(tp, 0x06, 0xbf82);
mdio_write(tp, 0x06, 0x98d6);
mdio_write(tp, 0x06, 0x82a0);
mdio_write(tp, 0x06, 0x0201);
mdio_write(tp, 0x06, 0x4fef);
mdio_write(tp, 0x06, 0x95fe);
mdio_write(tp, 0x06, 0xfdfc);
mdio_write(tp, 0x06, 0x05f8);
mdio_write(tp, 0x06, 0xf9fa);
mdio_write(tp, 0x06, 0xeef8);
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mdio_write(tp, 0x0D, gphy_val | 0x0067);
mdio_write(tp, 0x0D, gphy_val | 0x0068);
mdio_write(tp, 0x0D, gphy_val | 0x0069);
mdio_write(tp, 0x0D, gphy_val | 0x006A);
mdio_write(tp, 0x0D, gphy_val | 0x006B);
mdio_write(tp, 0x0D, gphy_val | 0x006C);
}
} else {
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x05, 0x2642);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8330);
mdio_write(tp, 0x06, 0x2642);
}
if (rtl8168_efuse_read(tp, 0x30) == 0x98) {
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) & ~BIT_1);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x01, mdio_read(tp, 0x01) | BIT_9);
} else if (rtl8168_efuse_read(tp, 0x30) == 0x90) {
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x01, mdio_read(tp, 0x01) & ~BIT_9);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x16, 0x5101);
}
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x02);
gphy_val &= ~BIT_10;
gphy_val &= ~BIT_9;
gphy_val |= BIT_8;
mdio_write(tp, 0x02, gphy_val);
gphy_val = mdio_read(tp, 0x03);
gphy_val &= ~BIT_15;
gphy_val &= ~BIT_14;
gphy_val &= ~BIT_13;
mdio_write(tp, 0x03, gphy_val);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x0F);
gphy_val |= BIT_4;
gphy_val |= BIT_2;
gphy_val |= BIT_1;
gphy_val |= BIT_0;
mdio_write(tp, 0x0F, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x001B);
if (mdio_read(tp, 0x06) == 0xB300) {
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x0080);
mdio_write(tp, 0x05, 0x8000);
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mdio_write(tp, 0x06, 0xfaee);
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mdio_write(tp, 0x06, 0x00ee);
mdio_write(tp, 0x06, 0xf8eb);
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mdio_write(tp, 0x06, 0xf87c);
mdio_write(tp, 0x06, 0xe3f8);
mdio_write(tp, 0x06, 0x7da5);
mdio_write(tp, 0x06, 0x1111);
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mdio_write(tp, 0x06, 0x0281);
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mdio_write(tp, 0x06, 0x4444);
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mdio_write(tp, 0x06, 0x4da5);
mdio_write(tp, 0x06, 0xaaaa);
mdio_write(tp, 0x06, 0x02ae);
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mdio_write(tp, 0x06, 0xee83);
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mdio_write(tp, 0x05, 0x83d6);
mdio_write(tp, 0x06, 0x824f);
mdio_write(tp, 0x02, 0x2010);
mdio_write(tp, 0x03, 0xdc00);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x0b, 0x0600);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0xfff6);
mdio_write(tp, 0x06, 0x00fc);
mdio_write(tp, 0x1f, 0x0000);
}
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x0D, 0xF880);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_11) {
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x10, 0x0008);
mdio_write(tp, 0x0D, 0x006C);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0B, 0xA4D8);
mdio_write(tp, 0x09, 0x281C);
mdio_write(tp, 0x07, 0x2883);
mdio_write(tp, 0x0A, 0x6B35);
mdio_write(tp, 0x1D, 0x3DA4);
mdio_write(tp, 0x1C, 0xEFFD);
mdio_write(tp, 0x14, 0x7F52);
mdio_write(tp, 0x18, 0x7FC6);
mdio_write(tp, 0x08, 0x0601);
mdio_write(tp, 0x06, 0x4063);
mdio_write(tp, 0x10, 0xF074);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x13, 0x0789);
mdio_write(tp, 0x12, 0xF4BD);
mdio_write(tp, 0x1A, 0x04FD);
mdio_write(tp, 0x14, 0x84B0);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x00, 0x9200);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x01, 0x0340);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x04, 0x4000);
mdio_write(tp, 0x03, 0x1D21);
mdio_write(tp, 0x02, 0x0C32);
mdio_write(tp, 0x01, 0x0200);
mdio_write(tp, 0x00, 0x5554);
mdio_write(tp, 0x04, 0x4800);
mdio_write(tp, 0x04, 0x4000);
mdio_write(tp, 0x04, 0xF000);
mdio_write(tp, 0x03, 0xDF01);
mdio_write(tp, 0x02, 0xDF20);
mdio_write(tp, 0x01, 0x101A);
mdio_write(tp, 0x00, 0xA0FF);
mdio_write(tp, 0x04, 0xF800);
mdio_write(tp, 0x04, 0xF000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0023);
mdio_write(tp, 0x16, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
gphy_val = mdio_read(tp, 0x0D);
gphy_val |= BIT_5;
mdio_write(tp, 0x0D, gphy_val);
} else if (tp->mcfg == CFG_METHOD_12 || tp->mcfg == CFG_METHOD_13) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x17, 0x0CC0);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002D);
mdio_write(tp, 0x18, 0x0040);
mdio_write(tp, 0x1F, 0x0000);
gphy_val = mdio_read(tp, 0x0D);
gphy_val |= BIT_5;
mdio_write(tp, 0x0D, gphy_val);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x0C);
gphy_val |= BIT_10;
mdio_write(tp, 0x0C, gphy_val);
} else if (tp->mcfg == CFG_METHOD_14 || tp->mcfg == CFG_METHOD_15) {
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0023);
gphy_val = mdio_read(tp, 0x17) | BIT_1;
if (tp->RequiredSecLanDonglePatch)
gphy_val &= ~(BIT_2);
else
gphy_val |= (BIT_2);
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8b80);
mdio_write(tp, 0x06, 0xc896);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0B, 0x6C20);
mdio_write(tp, 0x07, 0x2872);
mdio_write(tp, 0x1C, 0xEFFF);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x14, 0x6420);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0002);
gphy_val = mdio_read(tp, 0x08) & 0x00FF;
mdio_write(tp, 0x08, gphy_val | 0x8000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002D);
gphy_val = mdio_read(tp, 0x18);
mdio_write(tp, 0x18, gphy_val | 0x0010);
mdio_write(tp, 0x1F, 0x0000);
gphy_val = mdio_read(tp, 0x14);
mdio_write(tp, 0x14, gphy_val | 0x8000);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x00, 0x080B);
mdio_write(tp, 0x0B, 0x09D7);
mdio_write(tp, 0x1F, 0x0000);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x15, 0x1006);
}
}
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x19, 0x7F46);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8AD2);
mdio_write(tp, 0x06, 0x6810);
mdio_write(tp, 0x05, 0x8AD4);
mdio_write(tp, 0x06, 0x8002);
mdio_write(tp, 0x05, 0x8ADE);
mdio_write(tp, 0x06, 0x8025);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002F);
mdio_write(tp, 0x15, 0x1919);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002D);
gphy_val = mdio_read(tp, 0x18);
mdio_write(tp, 0x18, gphy_val | 0x0040);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
mdio_write(tp, 0x06, gphy_val | 0x0001);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x00AC);
mdio_write(tp, 0x18, 0x0006);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_16) {
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B80);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_2 | BIT_1;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x002D);
gphy_val = mdio_read(tp, 0x18);
gphy_val |= BIT_4;
mdio_write(tp, 0x18, gphy_val);
mdio_write(tp, 0x1f, 0x0002);
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x14);
gphy_val |= BIT_15;
mdio_write(tp, 0x14, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x15, 0x1006);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0B, 0x6C14);
mdio_write(tp, 0x14, 0x7F3D);
mdio_write(tp, 0x1C, 0xFAFE);
mdio_write(tp, 0x08, 0x07C5);
mdio_write(tp, 0x10, 0xF090);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x14, 0x641A);
mdio_write(tp, 0x1A, 0x0606);
mdio_write(tp, 0x12, 0xF480);
mdio_write(tp, 0x13, 0x0747);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0004);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0078);
mdio_write(tp, 0x15, 0xA408);
mdio_write(tp, 0x17, 0x5100);
mdio_write(tp, 0x19, 0x0008);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x0D, 0x0207);
mdio_write(tp, 0x02, 0x5FD0);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0004);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x00A1);
gphy_val = mdio_read(tp, 0x1A);
gphy_val &= ~BIT_2;
mdio_write(tp, 0x1A, gphy_val);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0004);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002D);
gphy_val = mdio_read(tp, 0x16);
gphy_val |= BIT_5;
mdio_write(tp, 0x16, gphy_val);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0004);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x00AC);
mdio_write(tp, 0x18, 0x0006);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x09, 0xA20F);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B5B);
mdio_write(tp, 0x06, 0x9222);
mdio_write(tp, 0x05, 0x8B6D);
mdio_write(tp, 0x06, 0x8000);
mdio_write(tp, 0x05, 0x8B76);
mdio_write(tp, 0x06, 0x8000);
mdio_write(tp, 0x1F, 0x0000);
if (pdev->subsystem_vendor == 0x1043 &&
pdev->subsystem_device == 0x13F7) {
static const u16 evl_phy_value[] = {
0x8B56, 0x8B5F, 0x8B68, 0x8B71,
0x8B7A, 0x8A7B, 0x8A7E, 0x8A81,
0x8A84, 0x8A87
};
mdio_write(tp, 0x1F, 0x0005);
for (i = 0; i < ARRAY_SIZE(evl_phy_value); i++) {
mdio_write(tp, 0x05, evl_phy_value[i]);
gphy_val = (0xAA << 8) | (mdio_read(tp, 0x06) & 0xFF);
mdio_write(tp, 0x06, gphy_val);
}
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0078);
mdio_write(tp, 0x17, 0x51AA);
mdio_write(tp, 0x1F, 0x0000);
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8B54);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8B5D);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8A7C);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A7F);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_8);
mdio_write(tp, 0x05, 0x8A82);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A88);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
gphy_val = mdio_read(tp, 0x06) | BIT_14 | BIT_15;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
} else if (tp->mcfg == CFG_METHOD_17) {
if (pdev->subsystem_vendor == 0x144d &&
pdev->subsystem_device == 0xc0a6) {
mdio_write(tp, 0x1F, 0x0001);
mdio_write(tp, 0x0e, 0x6b7f);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_4;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
} else {
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B80);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_2 | BIT_1;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val &= ~BIT_4;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
}
mdio_write(tp, 0x1f, 0x0004);
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x002D);
gphy_val = mdio_read(tp, 0x18);
gphy_val |= BIT_4;
mdio_write(tp, 0x18, gphy_val);
mdio_write(tp, 0x1f, 0x0002);
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x14);
gphy_val |= BIT_15;
mdio_write(tp, 0x14, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0004);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x00AC);
mdio_write(tp, 0x18, 0x0006);
mdio_write(tp, 0x1F, 0x0002);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x09, 0xA20F);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
gphy_val = mdio_read(tp, 0x06) | BIT_14 | BIT_15;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B5B);
mdio_write(tp, 0x06, 0x9222);
mdio_write(tp, 0x05, 0x8B6D);
mdio_write(tp, 0x06, 0x8000);
mdio_write(tp, 0x05, 0x8B76);
mdio_write(tp, 0x06, 0x8000);
mdio_write(tp, 0x1F, 0x0000);
if (pdev->subsystem_vendor == 0x1043 &&
pdev->subsystem_device == 0x13F7) {
static const u16 evl_phy_value[] = {
0x8B56, 0x8B5F, 0x8B68, 0x8B71,
0x8B7A, 0x8A7B, 0x8A7E, 0x8A81,
0x8A84, 0x8A87
};
mdio_write(tp, 0x1F, 0x0005);
for (i = 0; i < ARRAY_SIZE(evl_phy_value); i++) {
mdio_write(tp, 0x05, evl_phy_value[i]);
gphy_val = (0xAA << 8) | (mdio_read(tp, 0x06) & 0xFF);
mdio_write(tp, 0x06, gphy_val);
}
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0078);
mdio_write(tp, 0x17, 0x51AA);
mdio_write(tp, 0x1F, 0x0000);
}
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8B54);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8B5D);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8A7C);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A7F);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_8);
mdio_write(tp, 0x05, 0x8A82);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A88);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x1f, 0x0000);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x15);
gphy_val |= BIT_12;
mdio_write(tp, 0x15, gphy_val);
}
}
} else if (tp->mcfg == CFG_METHOD_18) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8b80);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_2 | BIT_1;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x002D);
gphy_val = mdio_read(tp, 0x18);
gphy_val |= BIT_4;
mdio_write(tp, 0x18, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x14);
gphy_val |= BIT_15;
mdio_write(tp, 0x14, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_14;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x09, 0xA20F);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B55);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8B5E);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8B67);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8B70);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0078);
mdio_write(tp, 0x17, 0x0000);
mdio_write(tp, 0x19, 0x00FB);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B79);
mdio_write(tp, 0x06, 0xAA00);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1f, 0x0003);
mdio_write(tp, 0x01, 0x328A);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8B54);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8B5D);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8A7C);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A7F);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_8);
mdio_write(tp, 0x05, 0x8A82);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A88);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x1f, 0x0000);
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8b85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_15);
mdio_write(tp, 0x1f, 0x0000);
}
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x15);
gphy_val |= BIT_12;
mdio_write(tp, 0x15, gphy_val);
}
}
} else if (tp->mcfg == CFG_METHOD_19) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8b80);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_2 | BIT_1;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x002D);
gphy_val = mdio_read(tp, 0x18);
gphy_val |= BIT_4;
mdio_write(tp, 0x18, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x14);
gphy_val |= BIT_15;
mdio_write(tp, 0x14, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8B54);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8B5D);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8A7C);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A7F);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_8);
mdio_write(tp, 0x05, 0x8A82);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A88);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x1f, 0x0000);
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8b85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_15);
mdio_write(tp, 0x1f, 0x0000);
}
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x15);
gphy_val |= BIT_12;
mdio_write(tp, 0x15, gphy_val);
}
}
} else if (tp->mcfg == CFG_METHOD_20) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8b80);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_2 | BIT_1;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
}
mdio_write(tp, 0x1f, 0x0007);
mdio_write(tp, 0x1e, 0x002D);
gphy_val = mdio_read(tp, 0x18);
gphy_val |= BIT_4;
mdio_write(tp, 0x18, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x14);
gphy_val |= BIT_15;
mdio_write(tp, 0x14, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B86);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_0;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B85);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_14;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1f, 0x0000);
mdio_write(tp, 0x1F, 0x0003);
mdio_write(tp, 0x09, 0xA20F);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B55);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8B5E);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8B67);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x05, 0x8B70);
mdio_write(tp, 0x06, 0x0000);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x0078);
mdio_write(tp, 0x17, 0x0000);
mdio_write(tp, 0x19, 0x00FB);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B79);
mdio_write(tp, 0x06, 0xAA00);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8B54);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8B5D);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_11);
mdio_write(tp, 0x05, 0x8A7C);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A7F);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_8);
mdio_write(tp, 0x05, 0x8A82);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x05, 0x8A88);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) & ~BIT_8);
mdio_write(tp, 0x1f, 0x0000);
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0005);
mdio_write(tp, 0x05, 0x8b85);
mdio_write(tp, 0x06, mdio_read(tp, 0x06) | BIT_15);
mdio_write(tp, 0x1f, 0x0000);
}
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1f, 0x0000);
gphy_val = mdio_read(tp, 0x15);
gphy_val |= BIT_12;
mdio_write(tp, 0x15, gphy_val);
}
}
} else if (tp->mcfg == CFG_METHOD_21) {
mdio_write(tp, 0x1F, 0x0A46);
gphy_val = mdio_read(tp, 0x10);
mdio_write(tp, 0x1F, 0x0BCC);
if (gphy_val & BIT_8)
ClearEthPhyBit(tp, 0x12, BIT_15);
else
SetEthPhyBit(tp, 0x12, BIT_15);
mdio_write(tp, 0x1F, 0x0A46);
gphy_val = mdio_read(tp, 0x13);
mdio_write(tp, 0x1F, 0x0C41);
if (gphy_val & BIT_8)
SetEthPhyBit(tp, 0x15, BIT_1);
else
ClearEthPhyBit(tp, 0x15, BIT_1);
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_2 | BIT_3);
mdio_write(tp, 0x1F, 0x0BCC);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~BIT_8);
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_7);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_6);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8084);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~(BIT_14 | BIT_13));
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_12);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_1);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_0);
mdio_write(tp, 0x1F, 0x0A4B);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_2);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8012);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | BIT_15);
mdio_write(tp, 0x1F, 0x0C42);
gphy_val = mdio_read(tp, 0x11);
gphy_val |= BIT_14;
gphy_val &= ~BIT_13;
mdio_write(tp, 0x11, gphy_val);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x809A);
mdio_write(tp, 0x14, 0x8022);
mdio_write(tp, 0x13, 0x80A0);
gphy_val = mdio_read(tp, 0x14) & 0x00FF;
gphy_val |= 0x1000;
mdio_write(tp, 0x14, gphy_val);
mdio_write(tp, 0x13, 0x8088);
mdio_write(tp, 0x14, 0x9222);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_2);
}
}
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_22) {
//do nothing
} else if (tp->mcfg == CFG_METHOD_23) {
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | (BIT_3 | BIT_2));
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0BCC);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~BIT_8);
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_7);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_6);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8084);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~(BIT_14 | BIT_13));
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_12);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_1);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_0);
mdio_write(tp, 0x1F, 0x0A4B);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_2);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8012);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | BIT_15);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0C42);
ClearAndSetEthPhyBit(tp,
0x11,
BIT_13,
BIT_14
);
mdio_write(tp, 0x1F, 0x0000);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_2);
}
}
} else if (tp->mcfg == CFG_METHOD_24) {
mdio_write(tp, 0x1F, 0x0BCC);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~BIT_8);
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_7);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_6);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8084);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~(BIT_14 | BIT_13));
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_12);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_1);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_0);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8012);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | BIT_15);
mdio_write(tp, 0x1F, 0x0C42);
gphy_val = mdio_read(tp, 0x11);
gphy_val |= BIT_14;
gphy_val &= ~BIT_13;
mdio_write(tp, 0x11, gphy_val);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_2);
}
}
} else if (tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26) {
mdio_write(tp, 0x1F, 0x0BCC);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~BIT_8);
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_7);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_6);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8084);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~(BIT_14 | BIT_13));
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_12);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_1);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_0);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8012);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | BIT_15);
mdio_write(tp, 0x1F, 0x0BCE);
mdio_write(tp, 0x12, 0x8860);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x80F3);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x8B00);
mdio_write(tp, 0x13, 0x80F0);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x3A00);
mdio_write(tp, 0x13, 0x80EF);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x0500);
mdio_write(tp, 0x13, 0x80F6);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x6E00);
mdio_write(tp, 0x13, 0x80EC);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x6800);
mdio_write(tp, 0x13, 0x80ED);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x7C00);
mdio_write(tp, 0x13, 0x80F2);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xF400);
mdio_write(tp, 0x13, 0x80F4);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x8500);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8110);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xA800);
mdio_write(tp, 0x13, 0x810F);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x1D00);
mdio_write(tp, 0x13, 0x8111);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xF500);
mdio_write(tp, 0x13, 0x8113);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x6100);
mdio_write(tp, 0x13, 0x8115);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x9200);
mdio_write(tp, 0x13, 0x810E);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x0400);
mdio_write(tp, 0x13, 0x810C);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x7C00);
mdio_write(tp, 0x13, 0x810B);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x5A00);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x80D1);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xFF00);
mdio_write(tp, 0x13, 0x80CD);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x9E00);
mdio_write(tp, 0x13, 0x80D3);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x0E00);
mdio_write(tp, 0x13, 0x80D5);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xCA00);
mdio_write(tp, 0x13, 0x80D7);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x8400);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_2);
}
}
} else if (tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28) {
mdio_write(tp, 0x1F, 0x0BCC);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~BIT_8);
mdio_write(tp, 0x1F, 0x0A44);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_7);
mdio_write(tp, 0x11, mdio_read(tp, 0x11) | BIT_6);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8084);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) & ~(BIT_14 | BIT_13));
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_12);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_1);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_0);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8012);
mdio_write(tp, 0x14, mdio_read(tp, 0x14) | BIT_15);
mdio_write(tp, 0x1F, 0x0C42);
mdio_write(tp, 0x11, (mdio_read(tp, 0x11) & ~BIT_13) | BIT_14);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x80F3);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x8B00);
mdio_write(tp, 0x13, 0x80F0);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x3A00);
mdio_write(tp, 0x13, 0x80EF);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x0500);
mdio_write(tp, 0x13, 0x80F6);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x6E00);
mdio_write(tp, 0x13, 0x80EC);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x6800);
mdio_write(tp, 0x13, 0x80ED);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x7C00);
mdio_write(tp, 0x13, 0x80F2);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xF400);
mdio_write(tp, 0x13, 0x80F4);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x8500);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8110);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xA800);
mdio_write(tp, 0x13, 0x810F);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x1D00);
mdio_write(tp, 0x13, 0x8111);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xF500);
mdio_write(tp, 0x13, 0x8113);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x6100);
mdio_write(tp, 0x13, 0x8115);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x9200);
mdio_write(tp, 0x13, 0x810E);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x0400);
mdio_write(tp, 0x13, 0x810C);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x7C00);
mdio_write(tp, 0x13, 0x810B);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x5A00);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x80D1);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xFF00);
mdio_write(tp, 0x13, 0x80CD);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x9E00);
mdio_write(tp, 0x13, 0x80D3);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x0E00);
mdio_write(tp, 0x13, 0x80D5);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0xCA00);
mdio_write(tp, 0x13, 0x80D7);
mdio_write(tp, 0x14, (mdio_read(tp, 0x14) & ~0xFF00) | 0x8400);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x10, mdio_read(tp, 0x10) | BIT_2);
}
}
} else if (tp->mcfg == CFG_METHOD_29) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x809b);
ClearAndSetEthPhyBit( tp,
0x14,
0xF800 ,
0x8000
);
mdio_write(tp, 0x13, 0x80A2);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x8000
);
mdio_write(tp, 0x13, 0x80A4);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x8500
);
mdio_write(tp, 0x13, 0x809C);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0xbd00
);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x80AD);
ClearAndSetEthPhyBit( tp,
0x14,
0xF800 ,
0x7000
);
mdio_write(tp, 0x13, 0x80B4);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x5000
);
mdio_write(tp, 0x13, 0x80AC);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x4000
);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x808E);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x1200
);
mdio_write(tp, 0x13, 0x8090);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0xE500
);
mdio_write(tp, 0x13, 0x8092);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x9F00
);
mdio_write(tp, 0x1F, 0x0000);
if (tp->HwHasWrRamCodeToMicroP) {
u16 dout_tapbin;
dout_tapbin = 0x0000;
mdio_write( tp, 0x1F, 0x0A46 );
gphy_val = mdio_read( tp, 0x13 );
gphy_val &= (BIT_1|BIT_0);
gphy_val <<= 2;
dout_tapbin |= gphy_val;
gphy_val = mdio_read( tp, 0x12 );
gphy_val &= (BIT_15|BIT_14);
gphy_val >>= 14;
dout_tapbin |= gphy_val;
dout_tapbin = ~( dout_tapbin^BIT_3 );
dout_tapbin <<= 12;
dout_tapbin &= 0xF000;
mdio_write( tp, 0x1F, 0x0A43 );
mdio_write( tp, 0x13, 0x827A );
ClearAndSetEthPhyBit( tp,
0x14,
BIT_15|BIT_14|BIT_13|BIT_12,
dout_tapbin
);
mdio_write( tp, 0x13, 0x827B );
ClearAndSetEthPhyBit( tp,
0x14,
BIT_15|BIT_14|BIT_13|BIT_12,
dout_tapbin
);
mdio_write( tp, 0x13, 0x827C );
ClearAndSetEthPhyBit( tp,
0x14,
BIT_15|BIT_14|BIT_13|BIT_12,
dout_tapbin
);
mdio_write( tp, 0x13, 0x827D );
ClearAndSetEthPhyBit( tp,
0x14,
BIT_15|BIT_14|BIT_13|BIT_12,
dout_tapbin
);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8011);
SetEthPhyBit(tp, 0x14, BIT_11);
mdio_write(tp, 0x1F, 0x0A42);
SetEthPhyBit(tp, 0x16, BIT_1);
}
mdio_write(tp, 0x1F, 0x0A44);
SetEthPhyBit( tp, 0x11, BIT_11 );
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0BCA);
ClearAndSetEthPhyBit( tp,
0x17,
(BIT_13 | BIT_12) ,
BIT_14
);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x803F);
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x13, 0x8047);
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x13, 0x804F);
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x13, 0x8057);
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x13, 0x805F);
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x13, 0x8067 );
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x13, 0x806F );
ClearEthPhyBit( tp, 0x14, (BIT_13 | BIT_12));
mdio_write(tp, 0x1F, 0x0000);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
SetEthPhyBit( tp, 0x10, BIT_2 );
mdio_write(tp, 0x1F, 0x0000);
}
}
} else if (tp->mcfg == CFG_METHOD_30) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x808A);
ClearAndSetEthPhyBit( tp,
0x14,
BIT_5 | BIT_4 | BIT_3 | BIT_2 | BIT_1 | BIT_0,
0x0A );
if (tp->HwHasWrRamCodeToMicroP) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8011);
SetEthPhyBit(tp, 0x14, BIT_11);
mdio_write(tp, 0x1F, 0x0A42);
SetEthPhyBit(tp, 0x16, BIT_1);
}
mdio_write(tp, 0x1F, 0x0A44);
SetEthPhyBit( tp, 0x11, BIT_11 );
mdio_write(tp, 0x1F, 0x0000);
if (tp->RequireAdcBiasPatch) {
mdio_write(tp, 0x1F, 0x0BCF);
mdio_write(tp, 0x16, tp->AdcBiasPatchIoffset);
mdio_write(tp, 0x1F, 0x0000);
}
{
u16 rlen;
mdio_write(tp, 0x1F, 0x0BCD);
gphy_val = mdio_read( tp, 0x16 );
gphy_val &= 0x000F;
if ( gphy_val > 3 ) {
rlen = gphy_val - 3;
} else {
rlen = 0;
}
gphy_val = rlen | (rlen<<4) | (rlen<<8) | (rlen<<12);
mdio_write(tp, 0x1F, 0x0BCD);
mdio_write(tp, 0x17, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
}
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
SetEthPhyBit( tp, 0x10, BIT_2 );
mdio_write(tp, 0x1F, 0x0000);
}
}
} else if (tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x808E);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x4000
);
mdio_write(tp, 0x13, 0x8090);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0xCC00
);
mdio_write(tp, 0x13, 0x8092);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0xB000
);
mdio_write(tp, 0x13, 0x8088);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x8000
);
mdio_write(tp, 0x13, 0x808B);
ClearAndSetEthPhyBit( tp,
0x14,
0x3F00 ,
0x0B00
);
mdio_write(tp, 0x13, 0x808D);
ClearAndSetEthPhyBit( tp,
0x14,
0x1F00 ,
0x0600
);
mdio_write(tp, 0x13, 0x808C);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0xB000
);
mdio_write(tp, 0x13, 0x80A0);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x2000
);
mdio_write(tp, 0x13, 0x80A2);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x5000
);
mdio_write(tp, 0x13, 0x809B);
ClearAndSetEthPhyBit( tp,
0x14,
0xF800 ,
0xB000
);
mdio_write(tp, 0x13, 0x809A);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x4B00
);
mdio_write(tp, 0x13, 0x809D);
ClearAndSetEthPhyBit( tp,
0x14,
0x3F00 ,
0x0800
);
mdio_write(tp, 0x13, 0x80A1);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x7000
);
mdio_write(tp, 0x13, 0x809F);
ClearAndSetEthPhyBit( tp,
0x14,
0x1F00 ,
0x0300
);
mdio_write(tp, 0x13, 0x809E);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x8800
);
mdio_write(tp, 0x13, 0x80B2);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x2200
);
mdio_write(tp, 0x13, 0x80AD);
ClearAndSetEthPhyBit( tp,
0x14,
0xF800 ,
0x9800
);
mdio_write(tp, 0x13, 0x80AF);
ClearAndSetEthPhyBit( tp,
0x14,
0x3F00 ,
0x0800
);
mdio_write(tp, 0x13, 0x80B3);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x6F00
);
mdio_write(tp, 0x13, 0x80B1);
ClearAndSetEthPhyBit( tp,
0x14,
0x1F00 ,
0x0300
);
mdio_write(tp, 0x13, 0x80B0);
ClearAndSetEthPhyBit( tp,
0x14,
0xFF00 ,
0x9300
);
mdio_write(tp, 0x1F, 0x0000);
if (tp->HwHasWrRamCodeToMicroP) {
mdio_write(tp, 0x1F, 0x0A43);
mdio_write(tp, 0x13, 0x8011);
SetEthPhyBit(tp, 0x14, BIT_11);
mdio_write(tp, 0x1F, 0x0A42);
SetEthPhyBit(tp, 0x16, BIT_1);
}
mdio_write(tp, 0x1F, 0x0A44);
SetEthPhyBit( tp, 0x11, BIT_11 );
mdio_write(tp, 0x1F, 0x0000);
if (aspm) {
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
mdio_write(tp, 0x1F, 0x0A43);
SetEthPhyBit( tp, 0x10, BIT_2 );
}
}
}
#ifdef ENABLE_FIBER_SUPPORT
if (HW_FIBER_MODE_ENABLED(tp))
rtl8168_hw_fiber_phy_config(dev);
#endif //ENABLE_FIBER_SUPPORT
//EthPhyPPSW
if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_24 || tp->mcfg == CFG_METHOD_25 ||
tp->mcfg == CFG_METHOD_26) {
//disable EthPhyPPSW
mdio_write(tp, 0x1F, 0x0BCD);
mdio_write(tp, 0x14, 0x5065);
mdio_write(tp, 0x14, 0xD065);
mdio_write(tp, 0x1F, 0x0BC8);
mdio_write(tp, 0x11, 0x5655);
mdio_write(tp, 0x1F, 0x0BCD);
mdio_write(tp, 0x14, 0x1065);
mdio_write(tp, 0x14, 0x9065);
mdio_write(tp, 0x14, 0x1065);
mdio_write(tp, 0x1F, 0x0000);
} else if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30) {
//enable EthPhyPPSW
mdio_write(tp, 0x1F, 0x0A44);
SetEthPhyBit( tp, 0x11, BIT_7 );
mdio_write(tp, 0x1F, 0x0000);
}
/*ocp phy power saving*/
if (tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
if (aspm) {
mdio_write_phy_ocp(tp, 0x0C41, 0x13, 0x0000);
mdio_write_phy_ocp(tp, 0x0C41, 0x13, 0x0050);
}
}
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
if (tp->HwHasWrRamCodeToMicroP == TRUE) {
if (eee_enable == 1)
rtl8168_enable_EEE(tp);
else
rtl8168_disable_EEE(tp);
}
}
static inline void rtl8168_delete_esd_timer(struct net_device *dev, struct timer_list *timer)
{
del_timer_sync(timer);
}
static inline void rtl8168_request_esd_timer(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct timer_list *timer = &tp->esd_timer;
setup_timer(timer, rtl8168_esd_timer, (unsigned long)dev);
mod_timer(timer, jiffies + RTL8168_ESD_TIMEOUT);
}
static inline void rtl8168_delete_link_timer(struct net_device *dev, struct timer_list *timer)
{
del_timer_sync(timer);
}
static inline void rtl8168_request_link_timer(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct timer_list *timer = &tp->link_timer;
setup_timer(timer, rtl8168_link_timer, (unsigned long)dev);
mod_timer(timer, jiffies + RTL8168_LINK_TIMEOUT);
}
#ifdef CONFIG_NET_POLL_CONTROLLER
/*
* Polling 'interrupt' - used by things like netconsole to send skbs
* without having to re-enable interrupts. It's not called while
* the interrupt routine is executing.
*/
static void
rtl8168_netpoll(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
disable_irq(pdev->irq);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,19)
rtl8168_interrupt(pdev->irq, dev, NULL);
#else
rtl8168_interrupt(pdev->irq, dev);
#endif
enable_irq(pdev->irq);
}
#endif
static void
rtl8168_get_bios_setting(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->bios_setting = RTL_R32(0x8c);
break;
}
}
static void
rtl8168_set_bios_setting(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W32(0x8C, tp->bios_setting);
break;
}
}
static void
rtl8168_init_software_variable(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
rtl8168_get_bios_setting(dev);
switch (tp->mcfg) {
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
tp->HwSuppDashVer = 1;
break;
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
tp->HwSuppDashVer = 2;
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->HwSuppDashVer = 3;
break;
default:
tp->HwSuppDashVer = 0;
break;
}
switch (tp->mcfg) {
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->HwPkgDet = mac_ocp_read(tp, 0xDC00);
tp->HwPkgDet = (tp->HwPkgDet >> 3) & 0x0F;
break;
}
if (HW_DASH_SUPPORT_TYPE_3(tp) && tp->HwPkgDet == 0x06)
eee_enable = 0;
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->HwSuppNowIsOobVer = 1;
break;
}
#ifdef ENABLE_REALWOW_SUPPORT
get_realwow_hw_version(dev);
#endif //ENABLE_REALWOW_SUPPORT
if (HW_DASH_SUPPORT_DASH(tp) && rtl8168_check_dash(tp))
tp->DASH = 1;
else
tp->DASH = 0;
if (tp->DASH) {
if (HW_DASH_SUPPORT_TYPE_3(tp)) {
u64 CmacMemPhysAddress;
void __iomem *cmac_ioaddr = NULL;
//map CMAC IO space
CmacMemPhysAddress = rtl8168_csi_other_fun_read(tp, 0, 0x18);
if (!(CmacMemPhysAddress & BIT_0)) {
if (CmacMemPhysAddress & BIT_2)
CmacMemPhysAddress |= rtl8168_csi_other_fun_read(tp, 0, 0x1C) << 16;
CmacMemPhysAddress &= 0xFFFFFFF0;
/* ioremap MMIO region */
cmac_ioaddr = ioremap(CmacMemPhysAddress, R8168_REGS_SIZE);
}
if (cmac_ioaddr == NULL) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp))
dev_err(&pdev->dev, "cannot remap CMAC MMIO, aborting\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
}
if (cmac_ioaddr == NULL) {
tp->DASH = 0;
} else {
tp->mapped_cmac_ioaddr = cmac_ioaddr;
}
}
}
#ifdef ENABLE_DASH_SUPPORT
#ifdef ENABLE_DASH_PRINTER_SUPPORT
if (tp->DASH) {
if (HW_DASH_SUPPORT_TYPE_3(tp) && tp->HwPkgDet == 0x0F)
tp->dash_printer_enabled = 1;
else if (HW_DASH_SUPPORT_TYPE_2(tp))
tp->dash_printer_enabled = 1;
}
#endif //ENABLE_DASH_PRINTER_SUPPORT
#endif //ENABLE_DASH_SUPPORT
if (HW_DASH_SUPPORT_TYPE_2(tp))
tp->cmac_ioaddr = tp->mmio_addr;
else if (HW_DASH_SUPPORT_TYPE_3(tp))
tp->cmac_ioaddr = tp->mapped_cmac_ioaddr;
switch (tp->mcfg) {
case CFG_METHOD_1:
tp->intr_mask = RxDescUnavail | RxFIFOOver | TxDescUnavail | TxOK | RxOK | SWInt;
tp->timer_intr_mask = PCSTimeout | RxFIFOOver;
break;
case CFG_METHOD_2:
case CFG_METHOD_3:
case CFG_METHOD_4:
tp->intr_mask = RxDescUnavail | TxDescUnavail | TxOK | RxOK | SWInt;
tp->timer_intr_mask = PCSTimeout;
break;
default:
tp->intr_mask = RxDescUnavail | TxOK | RxOK | SWInt;
tp->timer_intr_mask = PCSTimeout;
break;
}
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH) {
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
tp->timer_intr_mask |= ( ISRIMR_DASH_INTR_EN | ISRIMR_DASH_INTR_CMAC_RESET);
tp->intr_mask |= ( ISRIMR_DASH_INTR_EN | ISRIMR_DASH_INTR_CMAC_RESET);
} else {
tp->timer_intr_mask |= ( ISRIMR_DP_DASH_OK | ISRIMR_DP_HOST_OK | ISRIMR_DP_REQSYS_OK );
tp->intr_mask |= ( ISRIMR_DP_DASH_OK | ISRIMR_DP_HOST_OK | ISRIMR_DP_REQSYS_OK );
}
}
#endif
if (aspm) {
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->org_pci_offset_99 = rtl8168_csi_fun0_read_byte(tp, 0x99);
tp->org_pci_offset_99 &= ~(BIT_5|BIT_6);
break;
}
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
tp->org_pci_offset_180 = rtl8168_csi_fun0_read_byte(tp, 0x180);
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->org_pci_offset_180 = rtl8168_csi_fun0_read_byte(tp, 0x214);
break;
}
}
pci_read_config_byte(pdev, 0x80, &tp->org_pci_offset_80);
pci_read_config_byte(pdev, 0x81, &tp->org_pci_offset_81);
switch (tp->mcfg) {
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
if ((tp->features & RTL_FEATURE_MSI) && (tp->org_pci_offset_80 & BIT_1))
tp->use_timer_interrrupt = FALSE;
else
tp->use_timer_interrrupt = TRUE;
break;
default:
tp->use_timer_interrrupt = TRUE;
break;
}
if (timer_count == 0 || tp->mcfg == CFG_METHOD_DEFAULT)
tp->use_timer_interrrupt = FALSE;
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
tp->ShortPacketSwChecksum = TRUE;
break;
case CFG_METHOD_16:
case CFG_METHOD_17:
tp->ShortPacketSwChecksum = TRUE;
tp->UseSwPaddingShortPkt = TRUE;
break;
}
switch (tp->mcfg) {
case CFG_METHOD_30: {
u16 ioffset_p3, ioffset_p2, ioffset_p1, ioffset_p0;
u16 TmpUshort;
mac_ocp_write( tp, 0xDD02, 0x807D);
TmpUshort = mac_ocp_read( tp, 0xDD02 );
ioffset_p3 = ( (TmpUshort & BIT_7) >>7 );
ioffset_p3 <<= 3;
TmpUshort = mac_ocp_read( tp, 0xDD00 );
ioffset_p3 |= ((TmpUshort & (BIT_15 | BIT_14 | BIT_13))>>13);
ioffset_p2 = ((TmpUshort & (BIT_12|BIT_11|BIT_10|BIT_9))>>9);
ioffset_p1 = ((TmpUshort & (BIT_8|BIT_7|BIT_6|BIT_5))>>5);
ioffset_p0 = ( (TmpUshort & BIT_4) >>4 );
ioffset_p0 <<= 3;
ioffset_p0 |= (TmpUshort & (BIT_2| BIT_1 | BIT_0));
if ((ioffset_p3 == 0x0F) && (ioffset_p2 == 0x0F) && (ioffset_p1 == 0x0F) && (ioffset_p0 == 0x0F)) {
tp->RequireAdcBiasPatch = FALSE;
} else {
tp->RequireAdcBiasPatch = TRUE;
tp->AdcBiasPatchIoffset = (ioffset_p3<<12)|(ioffset_p2<<8)|(ioffset_p1<<4)|(ioffset_p0);
}
}
break;
}
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32: {
u16 rg_saw_cnt;
mdio_write(tp, 0x1F, 0x0C42);
rg_saw_cnt = mdio_read(tp, 0x13);
rg_saw_cnt &= ~(BIT_15|BIT_14);
mdio_write(tp, 0x1F, 0x0000);
if ( rg_saw_cnt > 0) {
tp->SwrCnt1msIni = 16000000/rg_saw_cnt;
tp->SwrCnt1msIni &= 0x0FFF;
tp->RequireAdjustUpsTxLinkPulseTiming = TRUE;
}
}
break;
}
#ifdef ENABLE_FIBER_SUPPORT
switch(tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
if ((pdev->subsystem_vendor == 0x1170 && pdev->subsystem_device == 0x0612) ||
(pdev->subsystem_vendor == 0x1028 && pdev->subsystem_device == 0x080C))
tp->HwFiberModeVer = FIBER_MODE_RTL8168H_RTL8211FS;
break;
}
if (HW_FIBER_MODE_ENABLED(tp))
tp->HwFiberStat = rtl8168_hw_fiber_get_connect_status(dev);
if (tp->HwFiberStat != FIBER_STAT_CONNECT)
tp->HwFiberModeVer = FIBER_MODE_NIC_ONLY;
#endif //ENABLE_FIBER_SUPPORT
if (pdev->subsystem_vendor == 0x144d) {
if (pdev->subsystem_device == 0xc098 ||
pdev->subsystem_device == 0xc0b1 ||
pdev->subsystem_device == 0xc0b8)
hwoptimize |= HW_PATCH_SAMSUNG_LAN_DONGLE;
}
if (hwoptimize & HW_PATCH_SAMSUNG_LAN_DONGLE) {
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_30:
tp->RequiredSecLanDonglePatch = TRUE;
break;
}
}
#ifdef ENABLE_FIBER_SUPPORT
if (tp->HwFiberModeVer == FIBER_MODE_RTL8168H_RTL8211FS)
tp->RequiredSecLanDonglePatch = TRUE;
#endif //ENABLE_FIBER_SUPPORT
switch (tp->mcfg) {
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->HwSuppMagicPktVer = WAKEUP_MAGIC_PACKET_V2;
break;
case CFG_METHOD_DEFAULT:
tp->HwSuppMagicPktVer = WAKEUP_MAGIC_PACKET_NOT_SUPPORT;
break;
default:
tp->HwSuppMagicPktVer = WAKEUP_MAGIC_PACKET_V1;
break;
}
switch (tp->mcfg) {
case CFG_METHOD_16:
case CFG_METHOD_17:
tp->HwSuppCheckPhyDisableModeVer = 1;
break;
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_29:
case CFG_METHOD_30:
tp->HwSuppCheckPhyDisableModeVer = 2;
break;
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->HwSuppCheckPhyDisableModeVer = 3;
break;
}
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_14;
break;
case CFG_METHOD_16:
case CFG_METHOD_17:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_16;
break;
case CFG_METHOD_18:
case CFG_METHOD_19:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_18;
break;
case CFG_METHOD_20:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_20;
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_21;
break;
case CFG_METHOD_23:
case CFG_METHOD_27:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_23;
break;
case CFG_METHOD_24:
case CFG_METHOD_25:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_24;
break;
case CFG_METHOD_26:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_26;
break;
case CFG_METHOD_28:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_28;
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_29;
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
tp->sw_ram_code_ver = NIC_RAMCODE_VERSION_CFG_METHOD_31;
break;
}
if (tp->HwIcVerUnknown) {
tp->NotWrRamCodeToMicroP = TRUE;
tp->NotWrMcuPatchCode = TRUE;
}
rtl8168_get_hw_wol(dev);
rtl8168_link_option((u8*)&autoneg_mode, (u16*)&speed_mode, (u8*)&duplex_mode);
tp->autoneg = autoneg_mode;
tp->speed = speed_mode;
tp->duplex = duplex_mode;
tp->max_jumbo_frame_size = rtl_chip_info[tp->chipset].jumbo_frame_sz;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(4,10,0)
/* MTU range: 60 - hw-specific max */
dev->min_mtu = ETH_ZLEN;
dev->max_mtu = tp->max_jumbo_frame_size;
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(4,10,0)
}
static void
rtl8168_release_board(struct pci_dev *pdev,
struct net_device *dev,
void __iomem *ioaddr)
{
struct rtl8168_private *tp = netdev_priv(dev);
rtl8168_set_bios_setting(dev);
rtl8168_rar_set(tp, tp->org_mac_addr);
tp->wol_enabled = WOL_DISABLED;
if (!tp->DASH)
rtl8168_phy_power_down(dev);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH)
FreeAllocatedDashShareMemory(dev);
#endif
if (tp->mapped_cmac_ioaddr != NULL)
iounmap(tp->mapped_cmac_ioaddr);
iounmap(ioaddr);
free_netdev(dev);
}
static int r8168_get_mac_address_from_dtb(struct rtl8168_private *tp,
const char *node_name,
const char *property_name,
u8 *mac_addr)
{
struct device_node *np = of_find_node_by_path(node_name);
const char *mac_str = NULL;
int values[MAC_ADDR_LEN] = {0};
u8 mac_temp[MAC_ADDR_LEN] = {0};
int i, ret = 0;
if (!np)
return -EADDRNOTAVAIL;
/* If the property is present but contains an invalid value,
* then something is wrong. Log the error in that case.
*/
if (of_property_read_string(np, property_name, &mac_str)) {
ret = -EADDRNOTAVAIL;
goto err_out;
}
/* The DTB property is a string of the form xx:xx:xx:xx:xx:xx
* Convert to an array of bytes.
*/
if (sscanf(mac_str, "%x:%x:%x:%x:%x:%x", &values[0], &values[1],
&values[2], &values[3], &values[4], &values[5]) != 6) {
ret = -EINVAL;
goto err_out;
}
for (i = 0; i < MAC_ADDR_LEN; ++i)
mac_temp[i] = (unsigned char)values[i];
if (!is_valid_ether_addr(mac_temp)) {
ret = -EINVAL;
goto err_out;
}
memcpy(mac_addr, mac_temp, MAC_ADDR_LEN);
of_node_put(np);
return ret;
err_out:
netif_err(tp, probe, tp->dev, "bad mac address at %s/%s: %s.\n",
node_name, property_name,
mac_str ? mac_str : "missing");
of_node_put(np);
return ret;
}
/* MAC address search order is:
*
* 1. OTP
* 2. Device Tree
* 3. Random
*/
static int
rtl8168_get_mac_address(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int i;
u8 mac_addr[MAC_ADDR_LEN];
int ret = -EADDRNOTAVAIL;
for (i = 0; i < MAC_ADDR_LEN; i++)
mac_addr[i] = RTL_R8(MAC0 + i);
if (tp->mcfg == CFG_METHOD_18 ||
tp->mcfg == CFG_METHOD_19 ||
tp->mcfg == CFG_METHOD_20 ||
tp->mcfg == CFG_METHOD_21 ||
tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 ||
tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 ||
tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 ||
tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 ||
tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 ||
tp->mcfg == CFG_METHOD_32) {
*(u32*)&mac_addr[0] = rtl8168_eri_read(ioaddr, 0xE0, 4, ERIAR_ExGMAC);
*(u16*)&mac_addr[4] = rtl8168_eri_read(ioaddr, 0xE4, 2, ERIAR_ExGMAC);
} else {
if (tp->eeprom_type != EEPROM_TYPE_NONE) {
u16 *pUshort = (u16*)mac_addr;
/* Get MAC address from EEPROM */
if (tp->mcfg == CFG_METHOD_16 ||
tp->mcfg == CFG_METHOD_17 ||
tp->mcfg == CFG_METHOD_18 ||
tp->mcfg == CFG_METHOD_19 ||
tp->mcfg == CFG_METHOD_20 ||
tp->mcfg == CFG_METHOD_21 ||
tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 ||
tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 ||
tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 ||
tp->mcfg == CFG_METHOD_28 ||
tp->mcfg == CFG_METHOD_29 ||
tp->mcfg == CFG_METHOD_30 ||
tp->mcfg == CFG_METHOD_31 ||
tp->mcfg == CFG_METHOD_32) {
*pUshort++ = rtl_eeprom_read_sc(tp, 1);
*pUshort++ = rtl_eeprom_read_sc(tp, 2);
*pUshort = rtl_eeprom_read_sc(tp, 3);
} else {
*pUshort++ = rtl_eeprom_read_sc(tp, 7);
*pUshort++ = rtl_eeprom_read_sc(tp, 8);
*pUshort = rtl_eeprom_read_sc(tp, 9);
}
}
}
if (!is_valid_ether_addr(mac_addr)) {
netif_info(tp, probe, dev,
"Invalid ethernet address %pM, trying device tree node\n",
mac_addr);
/* Try device tree node first before assigning random address */
ret = r8168_get_mac_address_from_dtb(tp, "/chosen",
"nvidia,ethernet-mac",
mac_addr);
if (ret < 0) {
eth_hw_addr_random(dev);
ether_addr_copy(mac_addr, dev->dev_addr);
netif_info(tp, probe, dev,
"Assigning random ethernet address %pM\n",
mac_addr);
tp->random_mac = 1;
} else
netif_info(tp, probe, dev,
"Found valid ethernet address %pM from device tree\n",
mac_addr);
}
rtl8168_rar_set(tp, mac_addr);
for (i = 0; i < MAC_ADDR_LEN; i++) {
dev->dev_addr[i] = RTL_R8(MAC0 + i);
tp->org_mac_addr[i] = dev->dev_addr[i]; /* keep the original MAC address */
}
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,13)
memcpy(dev->perm_addr, dev->dev_addr, dev->addr_len);
#endif
// memcpy(dev->dev_addr, dev->dev_addr, dev->addr_len);
return 0;
}
/**
* rtl8168_set_mac_address - Change the Ethernet Address of the NIC
* @dev: network interface device structure
* @p: pointer to an address structure
*
* Return 0 on success, negative on failure
**/
static int
rtl8168_set_mac_address(struct net_device *dev,
void *p)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct sockaddr *addr = p;
unsigned long flags;
if (!is_valid_ether_addr(addr->sa_data))
return -EADDRNOTAVAIL;
spin_lock_irqsave(&tp->lock, flags);
memcpy(dev->dev_addr, addr->sa_data, dev->addr_len);
rtl8168_rar_set(tp, dev->dev_addr);
spin_unlock_irqrestore(&tp->lock, flags);
return 0;
}
/******************************************************************************
* rtl8168_rar_set - Puts an ethernet address into a receive address register.
*
* tp - The private data structure for driver
* addr - Address to put into receive address register
*****************************************************************************/
void
rtl8168_rar_set(struct rtl8168_private *tp,
uint8_t *addr)
{
void __iomem *ioaddr = tp->mmio_addr;
uint32_t rar_low = 0;
uint32_t rar_high = 0;
rar_low = ((uint32_t) addr[0] |
((uint32_t) addr[1] << 8) |
((uint32_t) addr[2] << 16) |
((uint32_t) addr[3] << 24));
rar_high = ((uint32_t) addr[4] |
((uint32_t) addr[5] << 8));
rtl8168_enable_cfg9346_write(tp);
RTL_W32(MAC0, rar_low);
RTL_W32(MAC4, rar_high);
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
RTL_W32(SecMAC0, rar_low);
RTL_W16(SecMAC4, (uint16_t)rar_high);
break;
}
if (tp->mcfg == CFG_METHOD_17) {
rtl8168_eri_write(ioaddr, 0xf0, 4, rar_low << 16, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xf4, 4, rar_low >> 16 | rar_high << 16, ERIAR_ExGMAC);
}
rtl8168_disable_cfg9346_write(tp);
}
#ifdef ETHTOOL_OPS_COMPAT
static int ethtool_get_settings(struct net_device *dev, void *useraddr)
{
struct ethtool_cmd cmd = { ETHTOOL_GSET };
int err;
if (!ethtool_ops->get_settings)
return -EOPNOTSUPP;
err = ethtool_ops->get_settings(dev, &cmd);
if (err < 0)
return err;
if (copy_to_user(useraddr, &cmd, sizeof(cmd)))
return -EFAULT;
return 0;
}
static int ethtool_set_settings(struct net_device *dev, void *useraddr)
{
struct ethtool_cmd cmd;
if (!ethtool_ops->set_settings)
return -EOPNOTSUPP;
if (copy_from_user(&cmd, useraddr, sizeof(cmd)))
return -EFAULT;
return ethtool_ops->set_settings(dev, &cmd);
}
static int ethtool_get_drvinfo(struct net_device *dev, void *useraddr)
{
struct ethtool_drvinfo info;
struct ethtool_ops *ops = ethtool_ops;
if (!ops->get_drvinfo)
return -EOPNOTSUPP;
memset(&info, 0, sizeof(info));
info.cmd = ETHTOOL_GDRVINFO;
ops->get_drvinfo(dev, &info);
if (ops->self_test_count)
info.testinfo_len = ops->self_test_count(dev);
if (ops->get_stats_count)
info.n_stats = ops->get_stats_count(dev);
if (ops->get_regs_len)
info.regdump_len = ops->get_regs_len(dev);
if (ops->get_eeprom_len)
info.eedump_len = ops->get_eeprom_len(dev);
if (copy_to_user(useraddr, &info, sizeof(info)))
return -EFAULT;
return 0;
}
static int ethtool_get_regs(struct net_device *dev, char *useraddr)
{
struct ethtool_regs regs;
struct ethtool_ops *ops = ethtool_ops;
void *regbuf;
int reglen, ret;
if (!ops->get_regs || !ops->get_regs_len)
return -EOPNOTSUPP;
if (copy_from_user(&regs, useraddr, sizeof(regs)))
return -EFAULT;
reglen = ops->get_regs_len(dev);
if (regs.len > reglen)
regs.len = reglen;
regbuf = kmalloc(reglen, GFP_USER);
if (!regbuf)
return -ENOMEM;
ops->get_regs(dev, &regs, regbuf);
ret = -EFAULT;
if (copy_to_user(useraddr, &regs, sizeof(regs)))
goto out;
useraddr += offsetof(struct ethtool_regs, data);
if (copy_to_user(useraddr, regbuf, reglen))
goto out;
ret = 0;
out:
kfree(regbuf);
return ret;
}
static int ethtool_get_wol(struct net_device *dev, char *useraddr)
{
struct ethtool_wolinfo wol = { ETHTOOL_GWOL };
if (!ethtool_ops->get_wol)
return -EOPNOTSUPP;
ethtool_ops->get_wol(dev, &wol);
if (copy_to_user(useraddr, &wol, sizeof(wol)))
return -EFAULT;
return 0;
}
static int ethtool_set_wol(struct net_device *dev, char *useraddr)
{
struct ethtool_wolinfo wol;
if (!ethtool_ops->set_wol)
return -EOPNOTSUPP;
if (copy_from_user(&wol, useraddr, sizeof(wol)))
return -EFAULT;
return ethtool_ops->set_wol(dev, &wol);
}
static int ethtool_get_msglevel(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata = { ETHTOOL_GMSGLVL };
if (!ethtool_ops->get_msglevel)
return -EOPNOTSUPP;
edata.data = ethtool_ops->get_msglevel(dev);
if (copy_to_user(useraddr, &edata, sizeof(edata)))
return -EFAULT;
return 0;
}
static int ethtool_set_msglevel(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata;
if (!ethtool_ops->set_msglevel)
return -EOPNOTSUPP;
if (copy_from_user(&edata, useraddr, sizeof(edata)))
return -EFAULT;
ethtool_ops->set_msglevel(dev, edata.data);
return 0;
}
static int ethtool_nway_reset(struct net_device *dev)
{
if (!ethtool_ops->nway_reset)
return -EOPNOTSUPP;
return ethtool_ops->nway_reset(dev);
}
static int ethtool_get_link(struct net_device *dev, void *useraddr)
{
struct ethtool_value edata = { ETHTOOL_GLINK };
if (!ethtool_ops->get_link)
return -EOPNOTSUPP;
edata.data = ethtool_ops->get_link(dev);
if (copy_to_user(useraddr, &edata, sizeof(edata)))
return -EFAULT;
return 0;
}
static int ethtool_get_eeprom(struct net_device *dev, void *useraddr)
{
struct ethtool_eeprom eeprom;
struct ethtool_ops *ops = ethtool_ops;
u8 *data;
int ret;
if (!ops->get_eeprom || !ops->get_eeprom_len)
return -EOPNOTSUPP;
if (copy_from_user(&eeprom, useraddr, sizeof(eeprom)))
return -EFAULT;
/* Check for wrap and zero */
if (eeprom.offset + eeprom.len <= eeprom.offset)
return -EINVAL;
/* Check for exceeding total eeprom len */
if (eeprom.offset + eeprom.len > ops->get_eeprom_len(dev))
return -EINVAL;
data = kmalloc(eeprom.len, GFP_USER);
if (!data)
return -ENOMEM;
ret = -EFAULT;
if (copy_from_user(data, useraddr + sizeof(eeprom), eeprom.len))
goto out;
ret = ops->get_eeprom(dev, &eeprom, data);
if (ret)
goto out;
ret = -EFAULT;
if (copy_to_user(useraddr, &eeprom, sizeof(eeprom)))
goto out;
if (copy_to_user(useraddr + sizeof(eeprom), data, eeprom.len))
goto out;
ret = 0;
out:
kfree(data);
return ret;
}
static int ethtool_set_eeprom(struct net_device *dev, void *useraddr)
{
struct ethtool_eeprom eeprom;
struct ethtool_ops *ops = ethtool_ops;
u8 *data;
int ret;
if (!ops->set_eeprom || !ops->get_eeprom_len)
return -EOPNOTSUPP;
if (copy_from_user(&eeprom, useraddr, sizeof(eeprom)))
return -EFAULT;
/* Check for wrap and zero */
if (eeprom.offset + eeprom.len <= eeprom.offset)
return -EINVAL;
/* Check for exceeding total eeprom len */
if (eeprom.offset + eeprom.len > ops->get_eeprom_len(dev))
return -EINVAL;
data = kmalloc(eeprom.len, GFP_USER);
if (!data)
return -ENOMEM;
ret = -EFAULT;
if (copy_from_user(data, useraddr + sizeof(eeprom), eeprom.len))
goto out;
ret = ops->set_eeprom(dev, &eeprom, data);
if (ret)
goto out;
if (copy_to_user(useraddr + sizeof(eeprom), data, eeprom.len))
ret = -EFAULT;
out:
kfree(data);
return ret;
}
static int ethtool_get_coalesce(struct net_device *dev, void *useraddr)
{
struct ethtool_coalesce coalesce = { ETHTOOL_GCOALESCE };
if (!ethtool_ops->get_coalesce)
return -EOPNOTSUPP;
ethtool_ops->get_coalesce(dev, &coalesce);
if (copy_to_user(useraddr, &coalesce, sizeof(coalesce)))
return -EFAULT;
return 0;
}
static int ethtool_set_coalesce(struct net_device *dev, void *useraddr)
{
struct ethtool_coalesce coalesce;
if (!ethtool_ops->get_coalesce)
return -EOPNOTSUPP;
if (copy_from_user(&coalesce, useraddr, sizeof(coalesce)))
return -EFAULT;
return ethtool_ops->set_coalesce(dev, &coalesce);
}
static int ethtool_get_ringparam(struct net_device *dev, void *useraddr)
{
struct ethtool_ringparam ringparam = { ETHTOOL_GRINGPARAM };
if (!ethtool_ops->get_ringparam)
return -EOPNOTSUPP;
ethtool_ops->get_ringparam(dev, &ringparam);
if (copy_to_user(useraddr, &ringparam, sizeof(ringparam)))
return -EFAULT;
return 0;
}
static int ethtool_set_ringparam(struct net_device *dev, void *useraddr)
{
struct ethtool_ringparam ringparam;
if (!ethtool_ops->get_ringparam)
return -EOPNOTSUPP;
if (copy_from_user(&ringparam, useraddr, sizeof(ringparam)))
return -EFAULT;
return ethtool_ops->set_ringparam(dev, &ringparam);
}
static int ethtool_get_pauseparam(struct net_device *dev, void *useraddr)
{
struct ethtool_pauseparam pauseparam = { ETHTOOL_GPAUSEPARAM };
if (!ethtool_ops->get_pauseparam)
return -EOPNOTSUPP;
ethtool_ops->get_pauseparam(dev, &pauseparam);
if (copy_to_user(useraddr, &pauseparam, sizeof(pauseparam)))
return -EFAULT;
return 0;
}
static int ethtool_set_pauseparam(struct net_device *dev, void *useraddr)
{
struct ethtool_pauseparam pauseparam;
if (!ethtool_ops->get_pauseparam)
return -EOPNOTSUPP;
if (copy_from_user(&pauseparam, useraddr, sizeof(pauseparam)))
return -EFAULT;
return ethtool_ops->set_pauseparam(dev, &pauseparam);
}
static int ethtool_get_rx_csum(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata = { ETHTOOL_GRXCSUM };
if (!ethtool_ops->get_rx_csum)
return -EOPNOTSUPP;
edata.data = ethtool_ops->get_rx_csum(dev);
if (copy_to_user(useraddr, &edata, sizeof(edata)))
return -EFAULT;
return 0;
}
static int ethtool_set_rx_csum(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata;
if (!ethtool_ops->set_rx_csum)
return -EOPNOTSUPP;
if (copy_from_user(&edata, useraddr, sizeof(edata)))
return -EFAULT;
ethtool_ops->set_rx_csum(dev, edata.data);
return 0;
}
static int ethtool_get_tx_csum(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata = { ETHTOOL_GTXCSUM };
if (!ethtool_ops->get_tx_csum)
return -EOPNOTSUPP;
edata.data = ethtool_ops->get_tx_csum(dev);
if (copy_to_user(useraddr, &edata, sizeof(edata)))
return -EFAULT;
return 0;
}
static int ethtool_set_tx_csum(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata;
if (!ethtool_ops->set_tx_csum)
return -EOPNOTSUPP;
if (copy_from_user(&edata, useraddr, sizeof(edata)))
return -EFAULT;
return ethtool_ops->set_tx_csum(dev, edata.data);
}
static int ethtool_get_sg(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata = { ETHTOOL_GSG };
if (!ethtool_ops->get_sg)
return -EOPNOTSUPP;
edata.data = ethtool_ops->get_sg(dev);
if (copy_to_user(useraddr, &edata, sizeof(edata)))
return -EFAULT;
return 0;
}
static int ethtool_set_sg(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata;
if (!ethtool_ops->set_sg)
return -EOPNOTSUPP;
if (copy_from_user(&edata, useraddr, sizeof(edata)))
return -EFAULT;
return ethtool_ops->set_sg(dev, edata.data);
}
static int ethtool_get_tso(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata = { ETHTOOL_GTSO };
if (!ethtool_ops->get_tso)
return -EOPNOTSUPP;
edata.data = ethtool_ops->get_tso(dev);
if (copy_to_user(useraddr, &edata, sizeof(edata)))
return -EFAULT;
return 0;
}
static int ethtool_set_tso(struct net_device *dev, char *useraddr)
{
struct ethtool_value edata;
if (!ethtool_ops->set_tso)
return -EOPNOTSUPP;
if (copy_from_user(&edata, useraddr, sizeof(edata)))
return -EFAULT;
return ethtool_ops->set_tso(dev, edata.data);
}
static int ethtool_self_test(struct net_device *dev, char *useraddr)
{
struct ethtool_test test;
struct ethtool_ops *ops = ethtool_ops;
u64 *data;
int ret;
if (!ops->self_test || !ops->self_test_count)
return -EOPNOTSUPP;
if (copy_from_user(&test, useraddr, sizeof(test)))
return -EFAULT;
test.len = ops->self_test_count(dev);
data = kmalloc(test.len * sizeof(u64), GFP_USER);
if (!data)
return -ENOMEM;
ops->self_test(dev, &test, data);
ret = -EFAULT;
if (copy_to_user(useraddr, &test, sizeof(test)))
goto out;
useraddr += sizeof(test);
if (copy_to_user(useraddr, data, test.len * sizeof(u64)))
goto out;
ret = 0;
out:
kfree(data);
return ret;
}
static int ethtool_get_strings(struct net_device *dev, void *useraddr)
{
struct ethtool_gstrings gstrings;
struct ethtool_ops *ops = ethtool_ops;
u8 *data;
int ret;
if (!ops->get_strings)
return -EOPNOTSUPP;
if (copy_from_user(&gstrings, useraddr, sizeof(gstrings)))
return -EFAULT;
switch (gstrings.string_set) {
case ETH_SS_TEST:
if (!ops->self_test_count)
return -EOPNOTSUPP;
gstrings.len = ops->self_test_count(dev);
break;
case ETH_SS_STATS:
if (!ops->get_stats_count)
return -EOPNOTSUPP;
gstrings.len = ops->get_stats_count(dev);
break;
default:
return -EINVAL;
}
data = kmalloc(gstrings.len * ETH_GSTRING_LEN, GFP_USER);
if (!data)
return -ENOMEM;
ops->get_strings(dev, gstrings.string_set, data);
ret = -EFAULT;
if (copy_to_user(useraddr, &gstrings, sizeof(gstrings)))
goto out;
useraddr += sizeof(gstrings);
if (copy_to_user(useraddr, data, gstrings.len * ETH_GSTRING_LEN))
goto out;
ret = 0;
out:
kfree(data);
return ret;
}
static int ethtool_phys_id(struct net_device *dev, void *useraddr)
{
struct ethtool_value id;
if (!ethtool_ops->phys_id)
return -EOPNOTSUPP;
if (copy_from_user(&id, useraddr, sizeof(id)))
return -EFAULT;
return ethtool_ops->phys_id(dev, id.data);
}
static int ethtool_get_stats(struct net_device *dev, void *useraddr)
{
struct ethtool_stats stats;
struct ethtool_ops *ops = ethtool_ops;
u64 *data;
int ret;
if (!ops->get_ethtool_stats || !ops->get_stats_count)
return -EOPNOTSUPP;
if (copy_from_user(&stats, useraddr, sizeof(stats)))
return -EFAULT;
stats.n_stats = ops->get_stats_count(dev);
data = kmalloc(stats.n_stats * sizeof(u64), GFP_USER);
if (!data)
return -ENOMEM;
ops->get_ethtool_stats(dev, &stats, data);
ret = -EFAULT;
if (copy_to_user(useraddr, &stats, sizeof(stats)))
goto out;
useraddr += sizeof(stats);
if (copy_to_user(useraddr, data, stats.n_stats * sizeof(u64)))
goto out;
ret = 0;
out:
kfree(data);
return ret;
}
static int ethtool_ioctl(struct ifreq *ifr)
{
struct net_device *dev = __dev_get_by_name(ifr->ifr_name);
void *useraddr = (void *) ifr->ifr_data;
u32 ethcmd;
/*
* XXX: This can be pushed down into the ethtool_* handlers that
* need it. Keep existing behaviour for the moment.
*/
if (!capable(CAP_NET_ADMIN))
return -EPERM;
if (!dev || !netif_device_present(dev))
return -ENODEV;
if (copy_from_user(&ethcmd, useraddr, sizeof (ethcmd)))
return -EFAULT;
switch (ethcmd) {
case ETHTOOL_GSET:
return ethtool_get_settings(dev, useraddr);
case ETHTOOL_SSET:
return ethtool_set_settings(dev, useraddr);
case ETHTOOL_GDRVINFO:
return ethtool_get_drvinfo(dev, useraddr);
case ETHTOOL_GREGS:
return ethtool_get_regs(dev, useraddr);
case ETHTOOL_GWOL:
return ethtool_get_wol(dev, useraddr);
case ETHTOOL_SWOL:
return ethtool_set_wol(dev, useraddr);
case ETHTOOL_GMSGLVL:
return ethtool_get_msglevel(dev, useraddr);
case ETHTOOL_SMSGLVL:
return ethtool_set_msglevel(dev, useraddr);
case ETHTOOL_NWAY_RST:
return ethtool_nway_reset(dev);
case ETHTOOL_GLINK:
return ethtool_get_link(dev, useraddr);
case ETHTOOL_GEEPROM:
return ethtool_get_eeprom(dev, useraddr);
case ETHTOOL_SEEPROM:
return ethtool_set_eeprom(dev, useraddr);
case ETHTOOL_GCOALESCE:
return ethtool_get_coalesce(dev, useraddr);
case ETHTOOL_SCOALESCE:
return ethtool_set_coalesce(dev, useraddr);
case ETHTOOL_GRINGPARAM:
return ethtool_get_ringparam(dev, useraddr);
case ETHTOOL_SRINGPARAM:
return ethtool_set_ringparam(dev, useraddr);
case ETHTOOL_GPAUSEPARAM:
return ethtool_get_pauseparam(dev, useraddr);
case ETHTOOL_SPAUSEPARAM:
return ethtool_set_pauseparam(dev, useraddr);
case ETHTOOL_GRXCSUM:
return ethtool_get_rx_csum(dev, useraddr);
case ETHTOOL_SRXCSUM:
return ethtool_set_rx_csum(dev, useraddr);
case ETHTOOL_GTXCSUM:
return ethtool_get_tx_csum(dev, useraddr);
case ETHTOOL_STXCSUM:
return ethtool_set_tx_csum(dev, useraddr);
case ETHTOOL_GSG:
return ethtool_get_sg(dev, useraddr);
case ETHTOOL_SSG:
return ethtool_set_sg(dev, useraddr);
case ETHTOOL_GTSO:
return ethtool_get_tso(dev, useraddr);
case ETHTOOL_STSO:
return ethtool_set_tso(dev, useraddr);
case ETHTOOL_TEST:
return ethtool_self_test(dev, useraddr);
case ETHTOOL_GSTRINGS:
return ethtool_get_strings(dev, useraddr);
case ETHTOOL_PHYS_ID:
return ethtool_phys_id(dev, useraddr);
case ETHTOOL_GSTATS:
return ethtool_get_stats(dev, useraddr);
default:
return -EOPNOTSUPP;
}
return -EOPNOTSUPP;
}
#endif //ETHTOOL_OPS_COMPAT
static int
rtl8168_do_ioctl(struct net_device *dev,
struct ifreq *ifr,
int cmd)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct mii_ioctl_data *data = if_mii(ifr);
int ret;
unsigned long flags;
ret = 0;
switch (cmd) {
case SIOCGMIIPHY:
data->phy_id = 32; /* Internal PHY */
break;
case SIOCGMIIREG:
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
data->val_out = mdio_read(tp, data->reg_num);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
case SIOCSMIIREG:
if (!capable(CAP_NET_ADMIN))
return -EPERM;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0000);
mdio_write(tp, data->reg_num, data->val_in);
spin_unlock_irqrestore(&tp->phy_lock, flags);
break;
#ifdef ETHTOOL_OPS_COMPAT
case SIOCETHTOOL:
ret = ethtool_ioctl(ifr);
break;
#endif
case SIOCDEVPRIVATE_RTLASF:
if (!netif_running(dev)) {
ret = -ENODEV;
break;
}
ret = rtl8168_asf_ioctl(dev, ifr);
break;
#ifdef ENABLE_DASH_SUPPORT
case SIOCDEVPRIVATE_RTLDASH:
if (!netif_running(dev)) {
ret = -ENODEV;
break;
}
if (!capable(CAP_NET_ADMIN)) {
ret = -EPERM;
break;
}
ret = rtl8168_dash_ioctl(dev, ifr);
break;
#endif
#ifdef ENABLE_REALWOW_SUPPORT
case SIOCDEVPRIVATE_RTLREALWOW:
if (!netif_running(dev)) {
ret = -ENODEV;
break;
}
ret = rtl8168_realwow_ioctl(dev, ifr);
break;
#endif
case SIOCRTLTOOL:
ret = rtltool_ioctl(tp, ifr);
break;
default:
ret = -EOPNOTSUPP;
break;
}
return ret;
}
static void
rtl8168_phy_power_up(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
spin_lock_irqsave(&tp->phy_lock, flags);
if (rtl8168_is_in_phy_disable_mode(dev)) {
spin_unlock_irqrestore(&tp->phy_lock, flags);
return;
}
mdio_write(tp, 0x1F, 0x0000);
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
case CFG_METHOD_4:
case CFG_METHOD_5:
case CFG_METHOD_6:
case CFG_METHOD_7:
case CFG_METHOD_8:
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
mdio_write(tp, 0x0E, 0x0000);
break;
}
mdio_write(tp, MII_BMCR, BMCR_ANENABLE);
//wait mdc/mdio ready
switch (tp->mcfg) {
case CFG_METHOD_23:
case CFG_METHOD_27:
case CFG_METHOD_28:
mdelay(10);
break;
}
//wait ups resume (phy state 3)
switch (tp->mcfg) {
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
rtl8168_wait_phy_ups_resume(dev, 3);
break;
};
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
static void
rtl8168_phy_power_down(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u32 csi_tmp;
unsigned long flags;
spin_lock_irqsave(&tp->phy_lock, flags);
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
csi_tmp = rtl8168_eri_read(ioaddr, 0x1AB, 1, ERIAR_ExGMAC);
csi_tmp &= ~( BIT_2 | BIT_3 | BIT_4 | BIT_5 | BIT_6 | BIT_7 );
rtl8168_eri_write(ioaddr, 0x1AB, 1, csi_tmp, ERIAR_ExGMAC);
break;
}
mdio_write(tp, 0x1F, 0x0000);
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
case CFG_METHOD_4:
case CFG_METHOD_5:
case CFG_METHOD_6:
case CFG_METHOD_7:
case CFG_METHOD_8:
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
mdio_write(tp, 0x0E, 0x0200);
mdio_write(tp, MII_BMCR, BMCR_PDOWN);
break;
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_29:
case CFG_METHOD_30:
mdio_write(tp, MII_BMCR, BMCR_ANENABLE | BMCR_PDOWN);
break;
case CFG_METHOD_21:
case CFG_METHOD_22:
mdio_write(tp, MII_BMCR, BMCR_ANENABLE | BMCR_PDOWN);
RTL_W8(0xD0, RTL_R8(0xD0) & ~BIT_6);
break;
case CFG_METHOD_23:
case CFG_METHOD_24:
mdio_write(tp, MII_BMCR, BMCR_ANENABLE | BMCR_PDOWN);
break;
default:
mdio_write(tp, MII_BMCR, BMCR_PDOWN);
break;
}
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
static int __devinit
rtl8168_init_board(struct pci_dev *pdev,
struct net_device **dev_out,
void __iomem **ioaddr_out)
{
void __iomem *ioaddr;
struct net_device *dev;
struct rtl8168_private *tp;
int rc = -ENOMEM, i, pm_cap;
assert(ioaddr_out != NULL);
/* dev zeroed in alloc_etherdev */
dev = alloc_etherdev(sizeof (*tp));
if (dev == NULL) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_drv(&debug))
dev_err(&pdev->dev, "unable to alloc new ethernet\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
goto err_out;
}
SET_MODULE_OWNER(dev);
SET_NETDEV_DEV(dev, &pdev->dev);
tp = netdev_priv(dev);
tp->dev = dev;
tp->msg_enable = netif_msg_init(debug.msg_enable, R8168_MSG_DEFAULT);
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,26)
if (!aspm || tp->mcfg == CFG_METHOD_9)
pci_disable_link_state(pdev, PCIE_LINK_STATE_L0S | PCIE_LINK_STATE_L1 |
PCIE_LINK_STATE_CLKPM);
else if (aspm)
/* RTL8111HS doesn't goto L1 if L0s is enabled, disable L0s. */
pci_disable_link_state(pdev, PCIE_LINK_STATE_L0S | PCIE_LINK_STATE_CLKPM |
PCIE_LINK_STATE_L1SS);
#endif
rc = pci_set_mwi(pdev);
if (rc < 0)
goto err_out_free_dev;
/* save power state before pci_enable_device overwrites it */
pm_cap = pci_find_capability(pdev, PCI_CAP_ID_PM);
if (pm_cap) {
u16 pwr_command;
pci_read_config_word(pdev, pm_cap + PCI_PM_CTRL, &pwr_command);
} else {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp)) {
dev_err(&pdev->dev, "PowerManagement capability not found.\n");
}
#else
printk("PowerManagement capability not found.\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
}
/* make sure PCI base addr 1 is MMIO */
if (!(pci_resource_flags(pdev, 2) & IORESOURCE_MEM)) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp))
dev_err(&pdev->dev, "region #1 not an MMIO resource, aborting\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
rc = -ENODEV;
goto err_out_mwi;
}
/* check for weird/broken PCI region reporting */
if (pci_resource_len(pdev, 2) < R8168_REGS_SIZE) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp))
dev_err(&pdev->dev, "Invalid PCI region size(s), aborting\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
rc = -ENODEV;
goto err_out_mwi;
}
if ((sizeof(dma_addr_t) > 4) &&
use_dac &&
!pci_set_dma_mask(pdev, DMA_BIT_MASK(64)) &&
!pci_set_consistent_dma_mask(pdev, DMA_BIT_MASK(64))) {
dev->features |= NETIF_F_HIGHDMA;
} else {
rc = pci_set_dma_mask(pdev, DMA_BIT_MASK(32));
if (rc < 0) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp))
dev_err(&pdev->dev, "DMA configuration failed.\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
goto err_out_mwi;
}
}
/* ioremap MMIO region */
ioaddr = ioremap(pci_resource_start(pdev, 2), R8168_REGS_SIZE);
if (ioaddr == NULL) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp))
dev_err(&pdev->dev, "cannot remap MMIO, aborting\n");
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
rc = -EIO;
goto err_out_mwi;
}
/* Identify chip attached to board */
rtl8168_get_mac_version(tp, ioaddr);
rtl8168_print_mac_version(tp);
for (i = ARRAY_SIZE(rtl_chip_info) - 1; i >= 0; i--) {
if (tp->mcfg == rtl_chip_info[i].mcfg)
break;
}
if (i < 0) {
/* Unknown chip: assume array element #0, original RTL-8168 */
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (netif_msg_probe(tp))
dev_printk(KERN_DEBUG, &pdev->dev, "unknown chip version, assuming %s\n", rtl_chip_info[0].name);
#else
printk("Realtek unknown chip version, assuming %s\n", rtl_chip_info[0].name);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,0)
i++;
}
tp->chipset = i;
*ioaddr_out = ioaddr;
*dev_out = dev;
out:
return rc;
err_out_mwi:
pci_clear_mwi(pdev);
err_out_free_dev:
free_netdev(dev);
err_out:
*ioaddr_out = NULL;
*dev_out = NULL;
goto out;
}
#define PCI_DEVICE_SERIAL_NUMBER (0x0164)
static void
rtl8168_esd_timer(unsigned long __opaque)
{
struct net_device *dev = (struct net_device *)__opaque;
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
struct timer_list *timer = &tp->esd_timer;
unsigned long timeout = RTL8168_ESD_TIMEOUT;
unsigned long flags;
u8 cmd;
u16 io_base_l;
u16 mem_base_l;
u16 mem_base_h;
u8 ilr;
u16 resv_0x1c_h;
u16 resv_0x1c_l;
u16 resv_0x20_l;
u16 resv_0x20_h;
u16 resv_0x24_l;
u16 resv_0x24_h;
u16 resv_0x2c_h;
u16 resv_0x2c_l;
u32 pci_sn_l;
u32 pci_sn_h;
unsigned int esd_flag = 0;
pci_read_config_byte(pdev, PCI_COMMAND, &cmd);
if (cmd != tp->pci_cfg_space.cmd) {
pci_write_config_byte(pdev, PCI_COMMAND, tp->pci_cfg_space.cmd);
esd_flag |= BIT_0;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_0, &io_base_l);
if (io_base_l != tp->pci_cfg_space.io_base_l) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_0, tp->pci_cfg_space.io_base_l);
esd_flag |= BIT_1;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_2, &mem_base_l);
if (mem_base_l != tp->pci_cfg_space.mem_base_l) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_2, tp->pci_cfg_space.mem_base_l);
esd_flag |= BIT_2;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_2 + 2, &mem_base_h);
if (mem_base_h!= tp->pci_cfg_space.mem_base_h) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_2 + 2, tp->pci_cfg_space.mem_base_h);
esd_flag |= BIT_3;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_3, &resv_0x1c_l);
if (resv_0x1c_l != tp->pci_cfg_space.resv_0x1c_l) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_3, tp->pci_cfg_space.resv_0x1c_l);
esd_flag |= BIT_4;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_3 + 2, &resv_0x1c_h);
if (resv_0x1c_h != tp->pci_cfg_space.resv_0x1c_h) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_3 + 2, tp->pci_cfg_space.resv_0x1c_h);
esd_flag |= BIT_5;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_4, &resv_0x20_l);
if (resv_0x20_l != tp->pci_cfg_space.resv_0x20_l) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_4, tp->pci_cfg_space.resv_0x20_l);
esd_flag |= BIT_6;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_4 + 2, &resv_0x20_h);
if (resv_0x20_h != tp->pci_cfg_space.resv_0x20_h) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_4 + 2, tp->pci_cfg_space.resv_0x20_h);
esd_flag |= BIT_7;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_5, &resv_0x24_l);
if (resv_0x24_l != tp->pci_cfg_space.resv_0x24_l) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_5, tp->pci_cfg_space.resv_0x24_l);
esd_flag |= BIT_8;
}
pci_read_config_word(pdev, PCI_BASE_ADDRESS_5 + 2, &resv_0x24_h);
if (resv_0x24_h != tp->pci_cfg_space.resv_0x24_h) {
pci_write_config_word(pdev, PCI_BASE_ADDRESS_5 + 2, tp->pci_cfg_space.resv_0x24_h);
esd_flag |= BIT_9;
}
pci_read_config_byte(pdev, PCI_INTERRUPT_LINE, &ilr);
if (ilr != tp->pci_cfg_space.ilr) {
pci_write_config_byte(pdev, PCI_INTERRUPT_LINE, tp->pci_cfg_space.ilr);
esd_flag |= BIT_10;
}
pci_read_config_word(pdev, PCI_SUBSYSTEM_VENDOR_ID, &resv_0x2c_l);
if (resv_0x2c_l != tp->pci_cfg_space.resv_0x2c_l) {
pci_write_config_word(pdev, PCI_SUBSYSTEM_VENDOR_ID, tp->pci_cfg_space.resv_0x2c_l);
esd_flag |= BIT_11;
}
pci_read_config_word(pdev, PCI_SUBSYSTEM_VENDOR_ID + 2, &resv_0x2c_h);
if (resv_0x2c_h != tp->pci_cfg_space.resv_0x2c_h) {
pci_write_config_word(pdev, PCI_SUBSYSTEM_VENDOR_ID + 2, tp->pci_cfg_space.resv_0x2c_h);
esd_flag |= BIT_12;
}
pci_sn_l = rtl8168_csi_read(tp, PCI_DEVICE_SERIAL_NUMBER);
if (pci_sn_l != tp->pci_cfg_space.pci_sn_l) {
rtl8168_csi_write(tp, PCI_DEVICE_SERIAL_NUMBER, tp->pci_cfg_space.pci_sn_l);
esd_flag |= BIT_13;
}
pci_sn_h = rtl8168_csi_read(tp, PCI_DEVICE_SERIAL_NUMBER + 4);
if (pci_sn_h != tp->pci_cfg_space.pci_sn_h) {
rtl8168_csi_write(tp, PCI_DEVICE_SERIAL_NUMBER + 4, tp->pci_cfg_space.pci_sn_h);
esd_flag |= BIT_14;
}
if (esd_flag != 0) {
spin_lock_irqsave(&tp->lock, flags);
tp->esd_flag = esd_flag;
netif_stop_queue(dev);
netif_carrier_off(dev);
rtl8168_hw_reset(dev);
rtl8168_tx_clear(tp);
rtl8168_rx_clear(tp);
rtl8168_init_ring(dev);
rtl8168_hw_init(dev);
rtl8168_powerup_pll(dev);
rtl8168_hw_ephy_config(dev);
rtl8168_hw_phy_config(dev);
rtl8168_hw_config(dev);
rtl8168_set_speed(dev, tp->autoneg, tp->speed, tp->duplex);
tp->esd_flag = 0;
spin_unlock_irqrestore(&tp->lock, flags);
}
mod_timer(timer, jiffies + timeout);
}
static void
rtl8168_link_timer(unsigned long __opaque)
{
struct net_device *dev = (struct net_device *)__opaque;
struct rtl8168_private *tp = netdev_priv(dev);
struct timer_list *timer = &tp->link_timer;
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
rtl8168_check_link_status(dev);
spin_unlock_irqrestore(&tp->lock, flags);
mod_timer(timer, jiffies + RTL8168_LINK_TIMEOUT);
}
/* Cfg9346_Unlock assumed. */
static unsigned rtl8168_try_msi(struct pci_dev *pdev, struct rtl8168_private *tp)
{
unsigned msi = 0;
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,13)
switch (tp->mcfg) {
case CFG_METHOD_1:
case CFG_METHOD_2:
case CFG_METHOD_3:
case CFG_METHOD_4:
case CFG_METHOD_5:
case CFG_METHOD_6:
case CFG_METHOD_7:
case CFG_METHOD_8:
dev_info(&pdev->dev, "Default use INTx.\n");
break;
default:
if (pci_enable_msi(pdev))
dev_info(&pdev->dev, "no MSI. Back to INTx.\n");
else
msi |= RTL_FEATURE_MSI;
break;
}
#endif
return msi;
}
static void rtl8168_disable_msi(struct pci_dev *pdev, struct rtl8168_private *tp)
{
if (tp->features & RTL_FEATURE_MSI) {
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,13)
pci_disable_msi(pdev);
#endif
tp->features &= ~RTL_FEATURE_MSI;
}
}
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,29)
static const struct net_device_ops rtl8168_netdev_ops = {
.ndo_open = rtl8168_open,
.ndo_stop = rtl8168_close,
.ndo_get_stats = rtl8168_get_stats,
.ndo_start_xmit = rtl8168_start_xmit,
.ndo_tx_timeout = rtl8168_tx_timeout,
.ndo_change_mtu = rtl8168_change_mtu,
.ndo_set_mac_address = rtl8168_set_mac_address,
.ndo_do_ioctl = rtl8168_do_ioctl,
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,1,0)
.ndo_set_multicast_list = rtl8168_set_rx_mode,
#else
.ndo_set_rx_mode = rtl8168_set_rx_mode,
#endif
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
#ifdef CONFIG_R8168_VLAN
.ndo_vlan_rx_register = rtl8168_vlan_rx_register,
#endif
#else
.ndo_fix_features = rtl8168_fix_features,
.ndo_set_features = rtl8168_set_features,
#endif
#ifdef CONFIG_NET_POLL_CONTROLLER
.ndo_poll_controller = rtl8168_netpoll,
#endif
};
#endif
int __devinit
rtl8168_init_one(struct pci_dev *pdev, const struct pci_device_id *ent)
{
struct net_device *dev = NULL;
struct rtl8168_private *tp;
void __iomem *ioaddr = NULL;
static int board_idx = -1;
int rc;
assert(pdev != NULL);
assert(ent != NULL);
board_idx++;
if (netif_msg_drv(&debug))
printk(KERN_INFO "%s Gigabit Ethernet driver %s loaded\n",
MODULENAME, RTL8168_VERSION);
rc = rtl8168_init_board(pdev, &dev, &ioaddr);
if (rc) {
dev_err(&pdev->dev, "%s: failed to initialize. Error: %d\n",
MODULENAME, rc);
goto out;
}
tp = netdev_priv(dev);
assert(ioaddr != NULL);
tp->mmio_addr = ioaddr;
tp->set_speed = rtl8168_set_speed_xmii;
tp->get_settings = rtl8168_gset_xmii;
tp->phy_reset_enable = rtl8168_xmii_reset_enable;
tp->phy_reset_pending = rtl8168_xmii_reset_pending;
tp->link_ok = rtl8168_xmii_link_ok;
tp->features |= rtl8168_try_msi(pdev, tp);
RTL_NET_DEVICE_OPS(rtl8168_netdev_ops);
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,22)
SET_ETHTOOL_OPS(dev, &rtl8168_ethtool_ops);
#endif
dev->watchdog_timeo = RTL8168_TX_TIMEOUT;
dev->irq = pdev->irq;
dev->base_addr = (unsigned long) ioaddr;
#ifdef CONFIG_R8168_NAPI
RTL_NAPI_CONFIG(dev, tp, rtl8168_poll, R8168_NAPI_WEIGHT);
#endif
#ifdef CONFIG_R8168_VLAN
if (tp->mcfg != CFG_METHOD_DEFAULT) {
dev->features |= NETIF_F_HW_VLAN_TX | NETIF_F_HW_VLAN_RX;
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,22)
dev->vlan_rx_kill_vid = rtl8168_vlan_rx_kill_vid;
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,22)
}
#endif
tp->cp_cmd |= RTL_R16(CPlusCmd);
if (tp->mcfg != CFG_METHOD_DEFAULT) {
dev->features |= NETIF_F_IP_CSUM;
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
tp->cp_cmd |= RxChkSum;
#else
dev->features |= NETIF_F_RXCSUM | NETIF_F_SG | NETIF_F_TSO;
dev->hw_features = NETIF_F_SG | NETIF_F_IP_CSUM | NETIF_F_TSO |
NETIF_F_RXCSUM | NETIF_F_HW_VLAN_TX | NETIF_F_HW_VLAN_RX;
dev->vlan_features = NETIF_F_SG | NETIF_F_IP_CSUM | NETIF_F_TSO |
NETIF_F_HIGHDMA;
dev->hw_features |= NETIF_F_RXALL;
dev->hw_features |= NETIF_F_RXFCS;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,22)
if ((tp->mcfg == CFG_METHOD_1) || (tp->mcfg == CFG_METHOD_2) || (tp->mcfg == CFG_METHOD_3)) {
dev->hw_features &= ~NETIF_F_IPV6_CSUM;
netif_set_gso_max_size(dev, LSO_32K);
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,18,0)
dev->gso_max_segs = NIC_MAX_PHYS_BUF_COUNT_LSO_64K;
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,7,0)
dev->gso_min_segs = NIC_MIN_PHYS_BUF_COUNT;
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(4,7,0)
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(3,18,0)
} else {
dev->hw_features |= NETIF_F_IPV6_CSUM | NETIF_F_TSO6;
dev->features |= NETIF_F_IPV6_CSUM | NETIF_F_TSO6;
netif_set_gso_max_size(dev, LSO_64K);
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,18,0)
dev->gso_max_segs = NIC_MAX_PHYS_BUF_COUNT_LSO2;
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,7,0)
dev->gso_min_segs = NIC_MIN_PHYS_BUF_COUNT;
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(4,7,0)
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(3,18,0)
}
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,22)
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
}
tp->pci_dev = pdev;
spin_lock_init(&tp->lock);
spin_lock_init(&tp->phy_lock);
rtl8168_init_software_variable(dev);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH)
AllocateDashShareMemory(dev);
#endif
rtl8168_exit_oob(dev);
rtl8168_hw_init(dev);
rtl8168_hw_reset(dev);
/* Get production from EEPROM */
if (((tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_29 ||
tp->mcfg == CFG_METHOD_30) && (mac_ocp_read(tp, 0xDC00) & BIT_3)) ||
((tp->mcfg == CFG_METHOD_26) && (mac_ocp_read(tp, 0xDC00) & BIT_4)))
tp->eeprom_type = EEPROM_TYPE_NONE;
else
rtl_eeprom_type(tp);
if (tp->eeprom_type == EEPROM_TYPE_93C46 || tp->eeprom_type == EEPROM_TYPE_93C56)
rtl_set_eeprom_sel_low(ioaddr);
rtl8168_get_mac_address(dev);
#if defined(ENABLE_DASH_PRINTER_SUPPORT)
init_completion(&tp->fw_host_ok);
init_completion(&tp->fw_ack);
init_completion(&tp->fw_req);
#endif
tp->tally_vaddr = pci_alloc_consistent(pdev, sizeof(*tp->tally_vaddr), &tp->tally_paddr);
if (!tp->tally_vaddr) {
rc = -ENOMEM;
goto err_out;
}
rtl8168_tally_counter_clear(tp);
pci_set_drvdata(pdev, dev);
rc = register_netdev(dev);
if (rc) {
dev_err(&pdev->dev, "%s: failed to register netdev. Error %d\n",
MODULENAME, rc);
goto err_out;
}
printk(KERN_INFO "%s: This product is covered by one or more of the following patents: US6,570,884, US6,115,776, and US6,327,625.\n", MODULENAME);
rtl8168_sysfs_register();
device_set_wakeup_enable(&pdev->dev, tp->wol_enabled);
netif_carrier_off(dev);
printk("%s", GPL_CLAIM);
out:
return rc;
err_out:
if (tp->tally_vaddr != NULL) {
pci_free_consistent(pdev, sizeof(*tp->tally_vaddr), tp->tally_vaddr,
tp->tally_paddr);
tp->tally_vaddr = NULL;
}
#ifdef CONFIG_R8168_NAPI
RTL_NAPI_DEL(tp);
#endif
rtl8168_disable_msi(pdev, tp);
rtl8168_release_board(pdev, dev, ioaddr);
goto out;
}
void __devexit rtl8168_remove_one(struct pci_dev *pdev)
{
struct net_device *dev = pci_get_drvdata(pdev);
struct rtl8168_private *tp = netdev_priv(dev);
assert(dev != NULL);
assert(tp != NULL);
#ifdef CONFIG_R8168_NAPI
RTL_NAPI_DEL(tp);
#endif
rtl8168_sysfs_remove();
if (tp->DASH)
rtl8168_driver_stop(tp);
unregister_netdev(dev);
rtl8168_disable_msi(pdev, tp);
#ifdef ENABLE_R8168_PROCFS
rtl8168_proc_remove(dev);
#endif
if (tp->tally_vaddr != NULL) {
pci_free_consistent(pdev, sizeof(*tp->tally_vaddr), tp->tally_vaddr, tp->tally_paddr);
tp->tally_vaddr = NULL;
}
rtl8168_release_board(pdev, dev, tp->mmio_addr);
pci_set_drvdata(pdev, NULL);
}
static void
rtl8168_set_rxbufsize(struct rtl8168_private *tp,
struct net_device *dev)
{
unsigned int mtu = dev->mtu;
tp->rx_buf_sz = (mtu > ETH_DATA_LEN) ? mtu + ETH_HLEN + 8 + 1 : RX_BUF_SIZE;
}
static int rtl8168_open(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
int retval;
retval = -ENOMEM;
#ifdef ENABLE_R8168_PROCFS
rtl8168_proc_init(dev);
#endif
rtl8168_set_rxbufsize(tp, dev);
/*
* Rx and Tx descriptors needs 256 bytes alignment.
* pci_alloc_consistent provides more.
*/
tp->TxDescArray = pci_alloc_consistent(pdev, R8168_TX_RING_BYTES,
&tp->TxPhyAddr);
if (!tp->TxDescArray)
goto err_free_all_allocated_mem;
tp->RxDescArray = pci_alloc_consistent(pdev, R8168_RX_RING_BYTES,
&tp->RxPhyAddr);
if (!tp->RxDescArray)
goto err_free_all_allocated_mem;
if (tp->UseSwPaddingShortPkt) {
tp->ShortPacketEmptyBuffer = pci_alloc_consistent(pdev, SHORT_PACKET_PADDING_BUF_SIZE,
&tp->ShortPacketEmptyBufferPhy);
if (!tp->ShortPacketEmptyBuffer)
goto err_free_all_allocated_mem;
memset(tp->ShortPacketEmptyBuffer, 0x0, SHORT_PACKET_PADDING_BUF_SIZE);
}
retval = rtl8168_init_ring(dev);
if (retval < 0)
goto err_free_all_allocated_mem;
if (netif_msg_probe(tp)) {
printk(KERN_INFO "%s: 0x%lx, "
"%2.2x:%2.2x:%2.2x:%2.2x:%2.2x:%2.2x, "
"IRQ %d\n",
dev->name,
dev->base_addr,
dev->dev_addr[0], dev->dev_addr[1],
dev->dev_addr[2], dev->dev_addr[3],
dev->dev_addr[4], dev->dev_addr[5], dev->irq);
}
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,20)
INIT_WORK(&tp->task, NULL, dev);
#else
INIT_DELAYED_WORK(&tp->task, NULL);
#endif
#ifdef CONFIG_R8168_NAPI
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
RTL_NAPI_ENABLE(dev, &tp->napi);
#endif
#endif
rtl8168_exit_oob(dev);
rtl8168_hw_init(dev);
rtl8168_hw_reset(dev);
rtl8168_powerup_pll(dev);
rtl8168_hw_ephy_config(dev);
rtl8168_hw_phy_config(dev);
rtl8168_hw_config(dev);
rtl8168_dsm(dev, DSM_IF_UP);
rtl8168_set_speed(dev, tp->autoneg, tp->speed, tp->duplex);
retval = request_irq(dev->irq, rtl8168_interrupt, (tp->features & RTL_FEATURE_MSI) ? 0 : SA_SHIRQ, dev->name, dev);
if (retval<0)
goto err_free_all_allocated_mem;
tp->first_link_up = true;
if (tp->esd_flag == 0)
rtl8168_request_esd_timer(dev);
rtl8168_request_link_timer(dev);
out:
return retval;
err_free_all_allocated_mem:
if (tp->RxDescArray != NULL) {
pci_free_consistent(pdev, R8168_RX_RING_BYTES, tp->RxDescArray,
tp->RxPhyAddr);
tp->RxDescArray = NULL;
}
if (tp->TxDescArray != NULL) {
pci_free_consistent(pdev, R8168_TX_RING_BYTES, tp->TxDescArray,
tp->TxPhyAddr);
tp->TxDescArray = NULL;
}
if (tp->ShortPacketEmptyBuffer != NULL) {
pci_free_consistent(pdev, ETH_ZLEN, tp->ShortPacketEmptyBuffer,
tp->ShortPacketEmptyBufferPhy);
tp->ShortPacketEmptyBuffer = NULL;
}
goto out;
}
static void
rtl8168_dsm(struct net_device *dev, int dev_state)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
switch (dev_state) {
case DSM_MAC_INIT:
if ((tp->mcfg == CFG_METHOD_5) || (tp->mcfg == CFG_METHOD_6)) {
if (RTL_R8(MACDBG) & 0x80)
RTL_W8(GPIO, RTL_R8(GPIO) | GPIO_en);
else
RTL_W8(GPIO, RTL_R8(GPIO) & ~GPIO_en);
}
break;
case DSM_NIC_GOTO_D3:
case DSM_IF_DOWN:
if ((tp->mcfg == CFG_METHOD_5) || (tp->mcfg == CFG_METHOD_6)) {
if (RTL_R8(MACDBG) & 0x80)
RTL_W8(GPIO, RTL_R8(GPIO) & ~GPIO_en);
}
break;
case DSM_NIC_RESUME_D3:
case DSM_IF_UP:
if ((tp->mcfg == CFG_METHOD_5) || (tp->mcfg == CFG_METHOD_6)) {
if (RTL_R8(MACDBG) & 0x80)
RTL_W8(GPIO, RTL_R8(GPIO) | GPIO_en);
}
break;
}
}
static void
set_offset70F(struct rtl8168_private *tp, u8 setting)
{
u32 csi_tmp;
u32 temp = (u32)setting;
temp = temp << 24;
/*set PCI configuration space offset 0x70F to setting*/
/*When the register offset of PCI configuration space larger than 0xff, use CSI to access it.*/
csi_tmp = rtl8168_csi_read(tp, 0x70c) & 0x00ffffff;
rtl8168_csi_write(tp, 0x70c, csi_tmp | temp);
}
static void
set_offset79(struct rtl8168_private *tp, u8 setting)
{
//Set PCI configuration space offset 0x79 to setting
struct pci_dev *pdev = tp->pci_dev;
u8 device_control;
if (hwoptimize & HW_PATCH_SOC_LAN) return;
pci_read_config_byte(pdev, 0x79, &device_control);
device_control &= ~0x70;
device_control |= setting;
pci_write_config_byte(pdev, 0x79, device_control);
}
static void
set_offset711(struct rtl8168_private *tp, u8 setting)
{
u32 csi_tmp;
u32 temp = (u32)setting;
temp &= 0x0f;
temp = temp << 12;
/*set PCI configuration space offset 0x711 to setting*/
csi_tmp = rtl8168_csi_read(tp, 0x710) & 0xffff0fff;
rtl8168_csi_write(tp, 0x710, csi_tmp | temp);
}
static void
rtl8168_hw_set_rx_packet_filter(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
u32 mc_filter[2]; /* Multicast hash filter */
int rx_mode;
u32 tmp = 0;
if (dev->flags & IFF_PROMISC) {
/* Unconditionally log net taps. */
if (netif_msg_link(tp))
printk(KERN_NOTICE "%s: Promiscuous mode enabled.\n",
dev->name);
rx_mode =
AcceptBroadcast | AcceptMulticast | AcceptMyPhys |
AcceptAllPhys;
mc_filter[1] = mc_filter[0] = 0xffffffff;
} else if ((netdev_mc_count(dev) > multicast_filter_limit)
|| (dev->flags & IFF_ALLMULTI)) {
/* Too many to filter perfectly -- accept all multicasts. */
rx_mode = AcceptBroadcast | AcceptMulticast | AcceptMyPhys;
mc_filter[1] = mc_filter[0] = 0xffffffff;
} else {
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,35)
struct dev_mc_list *mclist;
unsigned int i;
rx_mode = AcceptBroadcast | AcceptMyPhys;
mc_filter[1] = mc_filter[0] = 0;
for (i = 0, mclist = dev->mc_list; mclist && i < dev->mc_count;
i++, mclist = mclist->next) {
int bit_nr = ether_crc(ETH_ALEN, mclist->dmi_addr) >> 26;
mc_filter[bit_nr >> 5] |= 1 << (bit_nr & 31);
rx_mode |= AcceptMulticast;
}
#else
struct netdev_hw_addr *ha;
rx_mode = AcceptBroadcast | AcceptMyPhys;
mc_filter[1] = mc_filter[0] = 0;
netdev_for_each_mc_addr(ha, dev) {
int bit_nr = ether_crc(ETH_ALEN, ha->addr) >> 26;
mc_filter[bit_nr >> 5] |= 1 << (bit_nr & 31);
rx_mode |= AcceptMulticast;
}
#endif
}
if (dev->features & NETIF_F_RXALL)
rx_mode |= (AcceptErr | AcceptRunt);
tmp = mc_filter[0];
mc_filter[0] = swab32(mc_filter[1]);
mc_filter[1] = swab32(tmp);
tp->rtl8168_rx_config = rtl_chip_info[tp->chipset].RCR_Cfg;
tmp = tp->rtl8168_rx_config | rx_mode | (RTL_R32(RxConfig) & rtl_chip_info[tp->chipset].RxConfigMask);
RTL_W32(RxConfig, tmp);
RTL_W32(MAR0 + 0, mc_filter[0]);
RTL_W32(MAR0 + 4, mc_filter[1]);
}
static void
rtl8168_set_rx_mode(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
rtl8168_hw_set_rx_packet_filter(dev);
spin_unlock_irqrestore(&tp->lock, flags);
}
static void
rtl8168_hw_config(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
struct pci_dev *pdev = tp->pci_dev;
u8 device_control;
u16 mac_ocp_data;
u32 csi_tmp;
unsigned long flags;
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
if (dev->mtu > ETH_DATA_LEN) {
dev->features &= ~(NETIF_F_IP_CSUM);
} else {
dev->features |= NETIF_F_IP_CSUM;
}
#endif
RTL_W32(RxConfig, (RX_DMA_BURST << RxCfgDMAShift));
rtl8168_hw_reset(dev);
rtl8168_enable_cfg9346_write(tp);
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W8(0xF1, RTL_R8(0xF1) & ~BIT_7);
RTL_W8(Config2, RTL_R8(Config2) & ~BIT_7);
RTL_W8(Config5, RTL_R8(Config5) & ~BIT_0);
break;
}
//clear io_rdy_l23
switch (tp->mcfg) {
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
RTL_W8(Config3, RTL_R8(Config3) & ~BIT_1);
break;
}
RTL_W8(MTPS, Reserved1_data);
tp->cp_cmd |= INTT_1;
if (tp->use_timer_interrrupt)
tp->cp_cmd |= PktCntrDisable;
else
tp->cp_cmd &= ~PktCntrDisable;
RTL_W16(IntrMitigate, 0x5f51);
rtl8168_tally_counter_addr_fill(tp);
rtl8168_desc_addr_fill(tp);
/* Set DMA burst size and Interframe Gap Time */
if (tp->mcfg == CFG_METHOD_1)
RTL_W32(TxConfig, (TX_DMA_BURST_512 << TxDMAShift) |
(InterFrameGap << TxInterFrameGapShift));
else
RTL_W32(TxConfig, (TX_DMA_BURST_unlimited << TxDMAShift) |
(InterFrameGap << TxInterFrameGapShift));
if (tp->mcfg == CFG_METHOD_4) {
set_offset70F(tp, 0x27);
RTL_W8(DBG_reg, (0x0E << 4) | Fix_Nak_1 | Fix_Nak_2);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
//disable clock request.
pci_write_config_byte(pdev, 0x81, 0x00);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
//rx checksum offload enable
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
tp->cp_cmd |= RxChkSum;
#else
dev->features |= NETIF_F_RXCSUM;
#endif
tp->cp_cmd &= ~(EnableBist | Macdbgo_oe | Force_halfdup |
Force_rxflow_en | Force_txflow_en | Cxpl_dbg_sel |
ASF | PktCntrDisable | Macdbgo_sel);
} else if (tp->mcfg == CFG_METHOD_5) {
set_offset70F(tp, 0x27);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
//disable clock request.
pci_write_config_byte(pdev, 0x81, 0x00);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
//rx checksum offload enable
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
tp->cp_cmd |= RxChkSum;
#else
dev->features |= NETIF_F_RXCSUM;
#endif
} else if (tp->mcfg == CFG_METHOD_6) {
set_offset70F(tp, 0x27);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
//disable clock request.
pci_write_config_byte(pdev, 0x81, 0x00);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
//rx checksum offload enable
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
tp->cp_cmd |= RxChkSum;
#else
dev->features |= NETIF_F_RXCSUM;
#endif
} else if (tp->mcfg == CFG_METHOD_7) {
set_offset70F(tp, 0x27);
rtl8168_eri_write(ioaddr, 0x1EC, 1, 0x07, ERIAR_ASF);
//disable clock request.
pci_write_config_byte(pdev, 0x81, 0x00);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
} else if (tp->mcfg == CFG_METHOD_8) {
set_offset70F(tp, 0x27);
rtl8168_eri_write(ioaddr, 0x1EC, 1, 0x07, ERIAR_ASF);
//disable clock request.
pci_write_config_byte(pdev, 0x81, 0x00);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
RTL_W8(0xD1, 0x20);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
} else if (tp->mcfg == CFG_METHOD_9) {
set_offset70F(tp, 0x27);
/* disable clock request. */
pci_write_config_byte(pdev, 0x81, 0x00);
RTL_W8(Config3, RTL_R8(Config3) & ~BIT_4);
RTL_W8(DBG_reg, RTL_R8(DBG_reg) | BIT_7 | BIT_1);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
RTL_W8(TDFNR, 0x8);
} else if (tp->mcfg == CFG_METHOD_10) {
set_offset70F(tp, 0x27);
RTL_W8(DBG_reg, RTL_R8(DBG_reg) | BIT_7 | BIT_1);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | Jumbo_En1);
set_offset79(tp, 0x20);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~Jumbo_En1);
set_offset79(tp, 0x50);
}
RTL_W8(TDFNR, 0x8);
RTL_W8(Config1, RTL_R8(Config1) | 0x10);
/* disable clock request. */
pci_write_config_byte(pdev, 0x81, 0x00);
} else if (tp->mcfg == CFG_METHOD_11 || tp->mcfg == CFG_METHOD_13) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
else
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
pci_write_config_byte(pdev, 0x81, 0x00);
RTL_W8(Config1, RTL_R8(Config1) | 0x10);
} else if (tp->mcfg == CFG_METHOD_12) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
else
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
pci_write_config_byte(pdev, 0x81, 0x01);
RTL_W8(Config1, RTL_R8(Config1) | 0x10);
} else if (tp->mcfg == CFG_METHOD_14 || tp->mcfg == CFG_METHOD_15) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
if (dev->mtu > ETH_DATA_LEN) {
RTL_W8(MTPS, 0x24);
RTL_W8(Config3, RTL_R8(Config3) | Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) | 0x01);
} else {
RTL_W8(Config3, RTL_R8(Config3) & ~Jumbo_En0);
RTL_W8(Config4, RTL_R8(Config4) & ~0x01);
}
RTL_W8(0xF3, RTL_R8(0xF3) | BIT_5);
RTL_W8(0xF3, RTL_R8(0xF3) & ~BIT_5);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_7 | BIT_6);
RTL_W8(0xD1, RTL_R8(0xD1) | BIT_2 | BIT_3);
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_6 | BIT_5 | BIT_4 | BIT_2 | BIT_1);
RTL_W8(TDFNR, 0x8);
if (aspm)
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_7);
RTL_W8(Config5, RTL_R8(Config5) & ~BIT_3);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
RTL_W8(Config1, RTL_R8(Config1) & ~0x10);
} else if (tp->mcfg == CFG_METHOD_16 || tp->mcfg == CFG_METHOD_17) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
rtl8168_eri_write(ioaddr, 0xC0, 2, 0x0000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xB8, 4, 0x00000000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xC8, 4, 0x00100002, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xE8, 4, 0x00100006, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12);
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1D0, 4, ERIAR_ExGMAC);
csi_tmp |= BIT_1;
rtl8168_eri_write(ioaddr, 0x1D0, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
RTL_W32(TxConfig, RTL_R32(TxConfig) | BIT_7);
RTL_W8(0xD3, RTL_R8(0xD3) & ~BIT_7);
RTL_W8(0x1B, RTL_R8(0x1B) & ~0x07);
if (tp->mcfg == CFG_METHOD_16) {
RTL_W32(0xB0, 0xEE480010);
RTL_W8(0x1A, RTL_R8(0x1A) & ~(BIT_2|BIT_3));
rtl8168_eri_write(ioaddr, 0x1DC, 1, 0x64, ERIAR_ExGMAC);
} else {
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp |= BIT_4;
rtl8168_eri_write(ioaddr, 0x1B0, 1, csi_tmp, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xCC, 4, 0x00000050, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xD0, 4, 0x07ff0060, ERIAR_ExGMAC);
}
RTL_W8(TDFNR, 0x8);
RTL_W8(Config2, RTL_R8(Config2) & ~PMSTS_En);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_6);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(MTPS, 0x27);
/* disable clock request. */
pci_write_config_byte(pdev, 0x81, 0x00);
} else if (tp->mcfg == CFG_METHOD_18 || tp->mcfg == CFG_METHOD_19) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
rtl8168_eri_write(ioaddr, 0xC8, 4, 0x00100002, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xE8, 4, 0x00100006, ERIAR_ExGMAC);
RTL_W32(TxConfig, RTL_R32(TxConfig) | BIT_7);
RTL_W8(0xD3, RTL_R8(0xD3) & ~BIT_7);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
if (aspm)
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_7);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(MTPS, 0x27);
RTL_W8(TDFNR, 0x8);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_6);
rtl8168_eri_write(ioaddr, 0xC0, 2, 0x0000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xB8, 4, 0x00000000, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12);
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
RTL_W8(0x1B,RTL_R8(0x1B) & ~0x07);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_4;
rtl8168_eri_write(ioaddr, 0x1B0, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1d0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_4 | BIT_1;
rtl8168_eri_write(ioaddr, 0x1d0, 1, csi_tmp, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xCC, 4, 0x00000050, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xd0, 4, 0x00000060, ERIAR_ExGMAC);
} else if (tp->mcfg == CFG_METHOD_20) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
rtl8168_eri_write(ioaddr, 0xC8, 4, 0x00100002, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xE8, 4, 0x00100006, ERIAR_ExGMAC);
RTL_W32(TxConfig, RTL_R32(TxConfig) | BIT_7);
RTL_W8(0xD3, RTL_R8(0xD3) & ~BIT_7);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
if (aspm)
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_7);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(MTPS, 0x27);
RTL_W8(TDFNR, 0x8);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_6);
rtl8168_eri_write(ioaddr, 0xC0, 2, 0x0000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xB8, 4, 0x00000000, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= BIT_10 | BIT_11;
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_4;
rtl8168_eri_write(ioaddr, 0x1B0, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1d0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_4 | BIT_1;
rtl8168_eri_write(ioaddr, 0x1d0, 1, csi_tmp, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xCC, 4, 0x00000050, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xd0, 4, 0x00000060, ERIAR_ExGMAC);
} else if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_24 || tp->mcfg == CFG_METHOD_25 ||
tp->mcfg == CFG_METHOD_26 || tp->mcfg == CFG_METHOD_29 ||
tp->mcfg == CFG_METHOD_30) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22)
set_offset711(tp, 0x04);
rtl8168_eri_write(ioaddr, 0xC8, 4, 0x00080002, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xCC, 1, 0x38, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xD0, 1, 0x48, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xE8, 4, 0x00100006, ERIAR_ExGMAC);
RTL_W32(TxConfig, RTL_R32(TxConfig) | BIT_7);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
if (tp->mcfg == CFG_METHOD_26) {
mac_ocp_data = mac_ocp_read(tp, 0xD3C0);
mac_ocp_data &= ~(BIT_11 | BIT_10 | BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4 | BIT_3 | BIT_2 | BIT_1 | BIT_0);
mac_ocp_data |= 0x03A9;
mac_ocp_write(tp, 0xD3C0, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xD3C2);
mac_ocp_data &= ~(BIT_7 | BIT_6 | BIT_5 | BIT_4 | BIT_3 | BIT_2 | BIT_1 | BIT_0);
mac_ocp_write(tp, 0xD3C2, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xD3C4);
mac_ocp_data |= BIT_0;
mac_ocp_write(tp, 0xD3C4, mac_ocp_data);
} else if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30) {
if (tp->RequireAdjustUpsTxLinkPulseTiming) {
mac_ocp_data = mac_ocp_read(tp, 0xD412);
mac_ocp_data &= ~(0x0FFF);
mac_ocp_data |= tp->SwrCnt1msIni;
mac_ocp_write(tp, 0xD412, mac_ocp_data);
}
mac_ocp_data = mac_ocp_read(tp, 0xE056);
mac_ocp_data &= ~(BIT_7 | BIT_6 | BIT_5 | BIT_4);
mac_ocp_data |= (BIT_6 | BIT_5 | BIT_4);
mac_ocp_write(tp, 0xE056, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xE052);
mac_ocp_data &= ~( BIT_14 | BIT_13);
mac_ocp_data |= BIT_15;
mac_ocp_data |= BIT_3;
mac_ocp_write(tp, 0xE052, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xD420);
mac_ocp_data &= ~(BIT_11 | BIT_10 | BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4 | BIT_3 | BIT_2 | BIT_1 | BIT_0);
mac_ocp_data |= 0x47F;
mac_ocp_write(tp, 0xD420, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xE0D6);
mac_ocp_data &= ~(BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4 | BIT_3 | BIT_2 | BIT_1 | BIT_0);
mac_ocp_data |= 0x17F;
mac_ocp_write(tp, 0xE0D6, mac_ocp_data);
}
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
RTL_W8(0x1B, RTL_R8(0x1B) & ~0x07);
RTL_W8(TDFNR, 0x4);
RTL_W8(Config2, RTL_R8(Config2) & ~PMSTS_En);
if (aspm)
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_7);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(MTPS, 0x27);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_6);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_7);
rtl8168_eri_write(ioaddr, 0xC0, 2, 0x0000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xB8, 4, 0x00000000, ERIAR_ExGMAC);
if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30)
mac_ocp_write(tp, 0xE054, 0xFC01);
rtl8168_eri_write(ioaddr, 0x5F0, 2, 0x4F87, ERIAR_ExGMAC);
if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30) {
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12);
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_2 | BIT_3 | BIT_4);
rtl8168_eri_write(ioaddr, 0xDC, 4, csi_tmp, ERIAR_ExGMAC);
} else {
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_7 | BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12);
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
}
if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_24 || tp->mcfg == CFG_METHOD_25) {
mac_ocp_write(tp, 0xC140, 0xFFFF);
} else if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30) {
mac_ocp_write(tp, 0xC140, 0xFFFF);
mac_ocp_write(tp, 0xC142, 0xFFFF);
}
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp &= ~BIT_12;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
if (tp->mcfg == CFG_METHOD_29 || tp->mcfg == CFG_METHOD_30) {
csi_tmp = rtl8168_eri_read(ioaddr, 0x2FC, 1, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_2);
rtl8168_eri_write(ioaddr, 0x2FC, 1, csi_tmp, ERIAR_ExGMAC);
} else {
csi_tmp = rtl8168_eri_read(ioaddr, 0x2FC, 1, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_0 | BIT_1 | BIT_2);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x2FC, 1, csi_tmp, ERIAR_ExGMAC);
}
csi_tmp = rtl8168_eri_read(ioaddr, 0x1D0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_1;
rtl8168_eri_write(ioaddr, 0x1D0, 1, csi_tmp, ERIAR_ExGMAC);
} else if (tp->mcfg == CFG_METHOD_23 || tp->mcfg == CFG_METHOD_27 ||
tp->mcfg == CFG_METHOD_28) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
rtl8168_eri_write(ioaddr, 0xC8, 4, 0x00080002, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xCC, 1, 0x2F, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xD0, 1, 0x5F, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xE8, 4, 0x00100006, ERIAR_ExGMAC);
RTL_W32(TxConfig, RTL_R32(TxConfig) | BIT_7);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_6);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_7);
rtl8168_eri_write(ioaddr, 0xC0, 2, 0x0000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xB8, 4, 0x00000000, ERIAR_ExGMAC);
RTL_W8(0x1B, RTL_R8(0x1B) & ~0x07);
RTL_W8(TDFNR, 0x4);
if (aspm)
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_7);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp &= ~BIT_12;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x2FC, 1, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_0 | BIT_1 | BIT_2);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x2FC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1D0, 1, ERIAR_ExGMAC);
csi_tmp |= BIT_1;
rtl8168_eri_write(ioaddr, 0x1D0, 1, csi_tmp, ERIAR_ExGMAC);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(MTPS, 0x27);
if (tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28) {
OOB_mutex_lock(tp);
rtl8168_eri_write(ioaddr, 0x5F0, 2, 0x4F87, ERIAR_ExGMAC);
OOB_mutex_unlock(tp);
}
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= ( BIT_7 | BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12 );
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xC140, 0xFFFF);
mac_ocp_write(tp, 0xC142, 0xFFFF);
if (tp->mcfg == CFG_METHOD_28) {
mac_ocp_data = mac_ocp_read(tp, 0xD3E2);
mac_ocp_data &= 0xF000;
mac_ocp_data |= 0x3A9;
mac_ocp_write(tp, 0xD3E2, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xD3E4);
mac_ocp_data &= 0xFF00;
mac_ocp_write(tp, 0xD3E4, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xE860);
mac_ocp_data |= BIT_7;
mac_ocp_write(tp, 0xE860, mac_ocp_data);
}
rtl8168_csi_set_dash_other_fun(tp, 0x04, 0x00, (BIT_0 | BIT_1 | BIT_2), FALSE);
rtl8168_csi_set_dash_other_fun(tp, 0x80, 0x00, (BIT_0 | BIT_1 | BIT_8), FALSE);
rtl8168_csi_set_dash_other_fun(tp, 0x44, 0x00, (BIT_0 | BIT_1), FALSE);
} else if (tp->mcfg == CFG_METHOD_31 || tp->mcfg == CFG_METHOD_32) {
set_offset70F(tp, 0x27);
set_offset79(tp, 0x50);
rtl8168_eri_write(ioaddr, 0xC8, 4, 0x00080002, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xCC, 1, 0x2F, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xD0, 1, 0x5F, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xE8, 4, 0x00100006, ERIAR_ExGMAC);
RTL_W32(TxConfig, RTL_R32(TxConfig) | BIT_7);
csi_tmp = rtl8168_eri_read(ioaddr, 0xDC, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0xDC, 1, csi_tmp, ERIAR_ExGMAC);
if (tp->RequireAdjustUpsTxLinkPulseTiming) {
mac_ocp_data = mac_ocp_read(tp, 0xD412);
mac_ocp_data &= ~(0x0FFF);
mac_ocp_data |= tp->SwrCnt1msIni;
mac_ocp_write(tp, 0xD412, mac_ocp_data);
}
mac_ocp_data = mac_ocp_read(tp, 0xE056);
mac_ocp_data &= ~(BIT_7 | BIT_6 | BIT_5 | BIT_4);
mac_ocp_data |= (BIT_6 | BIT_5 | BIT_4);
mac_ocp_write(tp, 0xE056, mac_ocp_data);
mac_ocp_write(tp, 0xEA80, 0x0003);
OOB_mutex_lock(tp);
mac_ocp_data = mac_ocp_read(tp, 0xE052);
if (tp->mcfg == CFG_METHOD_32)
mac_ocp_data |= BIT_3;
else
mac_ocp_data &= ~BIT_3;
mac_ocp_write(tp, 0xE052, mac_ocp_data);
OOB_mutex_unlock(tp);
mac_ocp_data = mac_ocp_read(tp, 0xD420);
mac_ocp_data &= ~(BIT_11 | BIT_10 | BIT_9 | BIT_8 | BIT_7 | BIT_6 | BIT_5 | BIT_4 | BIT_3 | BIT_2 | BIT_1 | BIT_0);
mac_ocp_data |= 0x47F;
mac_ocp_write(tp, 0xD420, mac_ocp_data);
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
RTL_W8(0x1B, RTL_R8(0x1B) & ~0x07);
RTL_W8(TDFNR, 0x4);
RTL_W8(Config2, RTL_R8(Config2) & ~PMSTS_En);
if (aspm)
RTL_W8(0xF1, RTL_R8(0xF1) | BIT_7);
if (dev->mtu > ETH_DATA_LEN)
RTL_W8(MTPS, 0x27);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_6);
RTL_W8(0xF2, RTL_R8(0xF2) | BIT_6);
RTL_W8(0xD0, RTL_R8(0xD0) | BIT_7);
rtl8168_eri_write(ioaddr, 0xC0, 2, 0x0000, ERIAR_ExGMAC);
rtl8168_eri_write(ioaddr, 0xB8, 4, 0x00000000, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xE054, 0xFC01);
OOB_mutex_lock(tp);
csi_tmp = rtl8168_eri_read(ioaddr, 0x5F0, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_8 | BIT_9 | BIT_10 | BIT_11);
rtl8168_eri_write(ioaddr, 0x5F0, 4, csi_tmp, ERIAR_ExGMAC);
OOB_mutex_unlock(tp);
csi_tmp = rtl8168_eri_read(ioaddr, 0xD4, 4, ERIAR_ExGMAC);
csi_tmp |= (BIT_7 | BIT_8 | BIT_9 | BIT_10 | BIT_11 | BIT_12);
rtl8168_eri_write(ioaddr, 0xD4, 4, csi_tmp, ERIAR_ExGMAC);
mac_ocp_write(tp, 0xC140, 0xFFFF);
mac_ocp_write(tp, 0xC142, 0xFFFF);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1B0, 4, ERIAR_ExGMAC);
csi_tmp &= ~BIT_12;
rtl8168_eri_write(ioaddr, 0x1B0, 4, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x2FC, 1, ERIAR_ExGMAC);
csi_tmp &= ~(BIT_0 | BIT_1 | BIT_2);
csi_tmp |= BIT_0;
rtl8168_eri_write(ioaddr, 0x2FC, 1, csi_tmp, ERIAR_ExGMAC);
csi_tmp = rtl8168_eri_read(ioaddr, 0x1D0, 1, ERIAR_ExGMAC);
csi_tmp &= ~BIT_1;
rtl8168_eri_write(ioaddr, 0x1D0, 1, csi_tmp, ERIAR_ExGMAC);
mac_ocp_data = mac_ocp_read(tp, 0xD3E2);
mac_ocp_data &= 0xF000;
mac_ocp_data |= 0x3A9;
mac_ocp_write(tp, 0xD3E2, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xD3E4);
mac_ocp_data &= 0xFF00;
mac_ocp_write(tp, 0xD3E4, mac_ocp_data);
mac_ocp_data = mac_ocp_read(tp, 0xE860);
mac_ocp_data |= BIT_7;
mac_ocp_write(tp, 0xE860, mac_ocp_data);
rtl8168_csi_set_dash_other_fun(tp, 0x80, 0x00, (BIT_0 | BIT_1 | BIT_8), FALSE);
rtl8168_csi_set_dash_other_fun(tp, 0x44, 0x00, (BIT_0 | BIT_1), FALSE);
} else if (tp->mcfg == CFG_METHOD_1) {
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
if (dev->mtu > ETH_DATA_LEN) {
pci_read_config_byte(pdev, 0x69, &device_control);
device_control &= ~0x70;
device_control |= 0x28;
pci_write_config_byte(pdev, 0x69, device_control);
} else {
pci_read_config_byte(pdev, 0x69, &device_control);
device_control &= ~0x70;
device_control |= 0x58;
pci_write_config_byte(pdev, 0x69, device_control);
}
} else if (tp->mcfg == CFG_METHOD_2) {
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
if (dev->mtu > ETH_DATA_LEN) {
pci_read_config_byte(pdev, 0x69, &device_control);
device_control &= ~0x70;
device_control |= 0x28;
pci_write_config_byte(pdev, 0x69, device_control);
RTL_W8(Config4, RTL_R8(Config4) | (1 << 0));
} else {
pci_read_config_byte(pdev, 0x69, &device_control);
device_control &= ~0x70;
device_control |= 0x58;
pci_write_config_byte(pdev, 0x69, device_control);
RTL_W8(Config4, RTL_R8(Config4) & ~(1 << 0));
}
} else if (tp->mcfg == CFG_METHOD_3) {
RTL_W8(Config3, RTL_R8(Config3) & ~Beacon_en);
if (dev->mtu > ETH_DATA_LEN) {
pci_read_config_byte(pdev, 0x69, &device_control);
device_control &= ~0x70;
device_control |= 0x28;
pci_write_config_byte(pdev, 0x69, device_control);
RTL_W8(Config4, RTL_R8(Config4) | (1 << 0));
} else {
pci_read_config_byte(pdev, 0x69, &device_control);
device_control &= ~0x70;
device_control |= 0x58;
pci_write_config_byte(pdev, 0x69, device_control);
RTL_W8(Config4, RTL_R8(Config4) & ~(1 << 0));
}
}
if ((tp->mcfg == CFG_METHOD_1) || (tp->mcfg == CFG_METHOD_2) || (tp->mcfg == CFG_METHOD_3)) {
/* csum offload command for RTL8168B/8111B */
tp->tx_tcp_csum_cmd = TxTCPCS;
tp->tx_udp_csum_cmd = TxUDPCS;
tp->tx_ip_csum_cmd = TxIPCS;
tp->tx_ipv6_csum_cmd = 0;
} else {
/* csum offload command for RTL8168C/8111C and RTL8168CP/8111CP */
tp->tx_tcp_csum_cmd = TxTCPCS_C;
tp->tx_udp_csum_cmd =TxUDPCS_C;
tp->tx_ip_csum_cmd = TxIPCS_C;
tp->tx_ipv6_csum_cmd = TxIPV6F_C;
}
//other hw parameters
if (tp->mcfg == CFG_METHOD_21 || tp->mcfg == CFG_METHOD_22 ||
tp->mcfg == CFG_METHOD_23 || tp->mcfg == CFG_METHOD_24 ||
tp->mcfg == CFG_METHOD_25 || tp->mcfg == CFG_METHOD_26 ||
tp->mcfg == CFG_METHOD_27 || tp->mcfg == CFG_METHOD_28)
rtl8168_eri_write(ioaddr, 0x2F8, 2, 0x1D8F, ERIAR_ExGMAC);
if (tp->bios_setting & BIT_28) {
if (tp->mcfg == CFG_METHOD_18 || tp->mcfg == CFG_METHOD_19 ||
tp->mcfg == CFG_METHOD_20) {
u32 gphy_val;
spin_lock_irqsave(&tp->phy_lock, flags);
mdio_write(tp, 0x1F, 0x0007);
mdio_write(tp, 0x1E, 0x002C);
gphy_val = mdio_read(tp, 0x16);
gphy_val |= BIT_10;
mdio_write(tp, 0x16, gphy_val);
mdio_write(tp, 0x1F, 0x0005);
mdio_write(tp, 0x05, 0x8B80);
gphy_val = mdio_read(tp, 0x06);
gphy_val |= BIT_7;
mdio_write(tp, 0x06, gphy_val);
mdio_write(tp, 0x1F, 0x0000);
spin_unlock_irqrestore(&tp->phy_lock, flags);
}
}
rtl8168_hw_clear_timer_int(dev);
switch (tp->mcfg) {
case CFG_METHOD_25:
mac_ocp_write(tp, 0xD3C0, 0x03F8);
mac_ocp_write(tp, 0xD3C2, 0x0000);
break;
case CFG_METHOD_29:
case CFG_METHOD_30:
mac_ocp_write(tp, 0xE098, 0x0AA2);
break;
case CFG_METHOD_31:
case CFG_METHOD_32:
mac_ocp_write(tp, 0xE098, mac_ocp_read(tp, 0xE098) | (0x64 << 4));
break;
}
switch (tp->mcfg) {
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
if (aspm) {
rtl8168_init_pci_offset_99(tp);
}
break;
}
switch (tp->mcfg) {
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
if (aspm) {
rtl8168_init_pci_offset_180(tp);
}
break;
}
tp->cp_cmd &= ~(EnableBist | Macdbgo_oe | Force_halfdup |
Force_rxflow_en | Force_txflow_en | Cxpl_dbg_sel |
ASF | Macdbgo_sel);
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,0,0)
RTL_W16(CPlusCmd, tp->cp_cmd);
#else
rtl8168_hw_set_features(dev, dev->features);
#endif
switch (tp->mcfg) {
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32: {
int timeout;
for (timeout = 0; timeout < 10; timeout++) {
if ((rtl8168_eri_read(ioaddr, 0x1AE, 2, ERIAR_ExGMAC) & BIT_13)==0)
break;
mdelay(1);
}
}
break;
}
RTL_W16(RxMaxSize, tp->rx_buf_sz);
rtl8168_disable_rxdvgate(dev);
if (tp->mcfg == CFG_METHOD_11 || tp->mcfg == CFG_METHOD_12)
rtl8168_mac_loopback_test(tp);
if (!tp->pci_cfg_is_read) {
pci_read_config_byte(pdev, PCI_COMMAND, &tp->pci_cfg_space.cmd);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_0, &tp->pci_cfg_space.io_base_l);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_0 + 2, &tp->pci_cfg_space.io_base_h);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_2, &tp->pci_cfg_space.mem_base_l);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_2 + 2, &tp->pci_cfg_space.mem_base_h);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_3, &tp->pci_cfg_space.resv_0x1c_l);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_3 + 2, &tp->pci_cfg_space.resv_0x1c_h);
pci_read_config_byte(pdev, PCI_INTERRUPT_LINE, &tp->pci_cfg_space.ilr);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_4, &tp->pci_cfg_space.resv_0x20_l);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_4 + 2, &tp->pci_cfg_space.resv_0x20_h);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_5, &tp->pci_cfg_space.resv_0x24_l);
pci_read_config_word(pdev, PCI_BASE_ADDRESS_5 + 2, &tp->pci_cfg_space.resv_0x24_h);
pci_read_config_word(pdev, PCI_SUBSYSTEM_VENDOR_ID, &tp->pci_cfg_space.resv_0x2c_l);
pci_read_config_word(pdev, PCI_SUBSYSTEM_VENDOR_ID + 2, &tp->pci_cfg_space.resv_0x2c_h);
tp->pci_cfg_space.pci_sn_l = rtl8168_csi_read(tp, PCI_DEVICE_SERIAL_NUMBER);
tp->pci_cfg_space.pci_sn_h = rtl8168_csi_read(tp, PCI_DEVICE_SERIAL_NUMBER + 4);
tp->pci_cfg_is_read = 1;
}
rtl8168_dsm(dev, DSM_MAC_INIT);
/* Set Rx packet filter */
rtl8168_hw_set_rx_packet_filter(dev);
#ifdef ENABLE_DASH_SUPPORT
if (tp->DASH && !tp->dash_printer_enabled)
NICChkTypeEnableDashInterrupt(tp);
#endif
switch (tp->mcfg) {
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
if (aspm) {
RTL_W8(Config5, RTL_R8(Config5) | BIT_0);
RTL_W8(Config2, RTL_R8(Config2) | BIT_7);
} else {
RTL_W8(Config2, RTL_R8(Config2) & ~BIT_7);
RTL_W8(Config5, RTL_R8(Config5) & ~BIT_0);
}
break;
}
rtl8168_disable_cfg9346_write(tp);
udelay(10);
}
static void
rtl8168_hw_start(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
RTL_W8(ChipCmd, CmdTxEnb | CmdRxEnb);
rtl8168_enable_hw_interrupt(tp, ioaddr);
}
static int
rtl8168_change_mtu(struct net_device *dev,
int new_mtu)
{
struct rtl8168_private *tp = netdev_priv(dev);
int ret = 0;
unsigned long flags;
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,10,0)
if (new_mtu < ETH_ZLEN)
return -EINVAL;
else if (new_mtu > tp->max_jumbo_frame_size)
new_mtu = tp->max_jumbo_frame_size;
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(4,10,0)
spin_lock_irqsave(&tp->lock, flags);
dev->mtu = new_mtu;
spin_unlock_irqrestore(&tp->lock, flags);
if (!netif_running(dev))
goto out;
rtl8168_down(dev);
spin_lock_irqsave(&tp->lock, flags);
rtl8168_set_rxbufsize(tp, dev);
ret = rtl8168_init_ring(dev);
if (ret < 0) {
spin_unlock_irqrestore(&tp->lock, flags);
goto err_out;
}
#ifdef CONFIG_R8168_NAPI
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
RTL_NAPI_ENABLE(dev, &tp->napi);
#endif
#endif//CONFIG_R8168_NAPI
netif_stop_queue(dev);
netif_carrier_off(dev);
rtl8168_hw_config(dev);
spin_unlock_irqrestore(&tp->lock, flags);
rtl8168_set_speed(dev, tp->autoneg, tp->speed, tp->duplex);
mod_timer(&tp->esd_timer, jiffies + RTL8168_ESD_TIMEOUT);
mod_timer(&tp->link_timer, jiffies + RTL8168_LINK_TIMEOUT);
out:
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,0,0)
netdev_update_features(dev);
#endif
err_out:
return ret;
}
static inline void
rtl8168_make_unusable_by_asic(struct RxDesc *desc)
{
desc->addr = 0x0badbadbadbadbadull;
desc->opts1 &= ~cpu_to_le32(DescOwn | RsvdMask);
}
static void
rtl8168_free_rx_skb(struct rtl8168_private *tp,
struct sk_buff **sk_buff,
struct RxDesc *desc)
{
struct pci_dev *pdev = tp->pci_dev;
pci_unmap_single(pdev, le64_to_cpu(desc->addr), tp->rx_buf_sz,
PCI_DMA_FROMDEVICE);
dev_kfree_skb(*sk_buff);
*sk_buff = NULL;
rtl8168_make_unusable_by_asic(desc);
}
static inline void
rtl8168_mark_to_asic(struct RxDesc *desc,
u32 rx_buf_sz)
{
u32 eor = le32_to_cpu(desc->opts1) & RingEnd;
desc->opts1 = cpu_to_le32(DescOwn | eor | rx_buf_sz);
}
static inline void
rtl8168_map_to_asic(struct RxDesc *desc,
dma_addr_t mapping,
u32 rx_buf_sz)
{
desc->addr = cpu_to_le64(mapping);
wmb();
rtl8168_mark_to_asic(desc, rx_buf_sz);
}
static int
rtl8168_alloc_rx_skb(struct rtl8168_private *tp,
struct sk_buff **sk_buff,
struct RxDesc *desc,
int rx_buf_sz,
u8 in_intr)
{
struct sk_buff *skb;
dma_addr_t mapping;
int ret = 0;
if (in_intr)
skb = RTL_ALLOC_SKB_INTR(tp, rx_buf_sz + RTK_RX_ALIGN);
else
skb = dev_alloc_skb(rx_buf_sz + RTK_RX_ALIGN);
if (unlikely(!skb))
goto err_out;
skb_reserve(skb, RTK_RX_ALIGN);
mapping = pci_map_single(tp->pci_dev, skb->data, rx_buf_sz,
PCI_DMA_FROMDEVICE);
if (unlikely(dma_mapping_error(&tp->pci_dev->dev, mapping))) {
if (unlikely(net_ratelimit()))
netif_err(tp, drv, tp->dev, "Failed to map RX DMA!\n");
goto err_out;
}
*sk_buff = skb;
rtl8168_map_to_asic(desc, mapping, rx_buf_sz);
out:
return ret;
err_out:
if (skb)
dev_kfree_skb(skb);
ret = -ENOMEM;
rtl8168_make_unusable_by_asic(desc);
goto out;
}
static void
rtl8168_rx_clear(struct rtl8168_private *tp)
{
int i;
for (i = 0; i < NUM_RX_DESC; i++) {
if (tp->Rx_skbuff[i])
rtl8168_free_rx_skb(tp, tp->Rx_skbuff + i,
tp->RxDescArray + i);
}
}
static u32
rtl8168_rx_fill(struct rtl8168_private *tp,
struct net_device *dev,
u32 start,
u32 end,
u8 in_intr)
{
u32 cur;
for (cur = start; end - cur > 0; cur++) {
int ret, i = cur % NUM_RX_DESC;
if (tp->Rx_skbuff[i])
continue;
ret = rtl8168_alloc_rx_skb(tp, tp->Rx_skbuff + i,
tp->RxDescArray + i,
tp->rx_buf_sz,
in_intr);
if (ret < 0)
break;
}
return cur - start;
}
static inline void
rtl8168_mark_as_last_descriptor(struct RxDesc *desc)
{
desc->opts1 |= cpu_to_le32(RingEnd);
}
static void
rtl8168_desc_addr_fill(struct rtl8168_private *tp)
{
void __iomem *ioaddr = tp->mmio_addr;
if (!tp->TxPhyAddr || !tp->RxPhyAddr)
return;
RTL_W32(TxDescStartAddrLow, ((u64) tp->TxPhyAddr & DMA_BIT_MASK(32)));
RTL_W32(TxDescStartAddrHigh, ((u64) tp->TxPhyAddr >> 32));
RTL_W32(RxDescAddrLow, ((u64) tp->RxPhyAddr & DMA_BIT_MASK(32)));
RTL_W32(RxDescAddrHigh, ((u64) tp->RxPhyAddr >> 32));
}
static void
rtl8168_tx_desc_init(struct rtl8168_private *tp)
{
int i = 0;
memset(tp->TxDescArray, 0x0, NUM_TX_DESC * sizeof(struct TxDesc));
for (i = 0; i < NUM_TX_DESC; i++) {
if (i == (NUM_TX_DESC - 1))
tp->TxDescArray[i].opts1 = cpu_to_le32(RingEnd);
}
}
static void
rtl8168_rx_desc_offset0_init(struct rtl8168_private *tp, int own)
{
int i = 0;
int ownbit = 0;
if (own)
ownbit = DescOwn;
for (i = 0; i < NUM_RX_DESC; i++) {
if (i == (NUM_RX_DESC - 1))
tp->RxDescArray[i].opts1 = cpu_to_le32((ownbit | RingEnd) | (unsigned long)tp->rx_buf_sz);
else
tp->RxDescArray[i].opts1 = cpu_to_le32(ownbit | (unsigned long)tp->rx_buf_sz);
}
}
static void
rtl8168_rx_desc_init(struct rtl8168_private *tp)
{
memset(tp->RxDescArray, 0x0, NUM_RX_DESC * sizeof(struct RxDesc));
}
static int
rtl8168_init_ring(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
rtl8168_init_ring_indexes(tp);
memset(tp->tx_skb, 0x0, NUM_TX_DESC * sizeof(struct ring_info));
memset(tp->Rx_skbuff, 0x0, NUM_RX_DESC * sizeof(struct sk_buff *));
rtl8168_tx_desc_init(tp);
rtl8168_rx_desc_init(tp);
if (rtl8168_rx_fill(tp, dev, 0, NUM_RX_DESC, 0) != NUM_RX_DESC)
goto err_out;
rtl8168_mark_as_last_descriptor(tp->RxDescArray + NUM_RX_DESC - 1);
return 0;
err_out:
rtl8168_rx_clear(tp);
return -ENOMEM;
}
static void
rtl8168_unmap_tx_skb(struct pci_dev *pdev,
struct ring_info *tx_skb,
struct TxDesc *desc)
{
unsigned int len = tx_skb->len;
pci_unmap_single(pdev, le64_to_cpu(desc->addr), len, PCI_DMA_TODEVICE);
desc->opts1 = 0x00;
desc->opts2 = 0x00;
desc->addr = 0x00;
tx_skb->len = 0;
}
static void rtl8168_tx_clear_range(struct rtl8168_private *tp, u32 start,
unsigned int n)
{
unsigned int i;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,22)
struct net_device *dev = tp->dev;
#endif
for (i = 0; i < n; i++) {
unsigned int entry = (start + i) % NUM_TX_DESC;
struct ring_info *tx_skb = tp->tx_skb + entry;
unsigned int len = tx_skb->len;
if (len) {
struct sk_buff *skb = tx_skb->skb;
rtl8168_unmap_tx_skb(tp->pci_dev, tx_skb,
tp->TxDescArray + entry);
if (skb) {
RTLDEV->stats.tx_dropped++;
dev_kfree_skb_any(skb);
tx_skb->skb = NULL;
}
}
}
}
static void
rtl8168_tx_clear(struct rtl8168_private *tp)
{
rtl8168_tx_clear_range(tp, tp->dirty_tx, NUM_TX_DESC);
tp->cur_tx = tp->dirty_tx = 0;
}
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,20)
static void rtl8168_schedule_work(struct net_device *dev, void (*task)(void *))
{
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
struct rtl8168_private *tp = netdev_priv(dev);
INIT_WORK(&tp->task, task, dev);
schedule_delayed_work(&tp->task, 4);
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
}
#define rtl8168_cancel_schedule_work(a)
#else
static void rtl8168_schedule_work(struct net_device *dev, work_func_t task)
{
struct rtl8168_private *tp = netdev_priv(dev);
INIT_DELAYED_WORK(&tp->task, task);
schedule_delayed_work(&tp->task, 4);
}
static void rtl8168_cancel_schedule_work(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
cancel_delayed_work_sync(&tp->task);
}
#endif
static void
rtl8168_wait_for_quiescence(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
synchronize_irq(dev->irq);
/* Wait for any pending NAPI task to complete */
#ifdef CONFIG_R8168_NAPI
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
RTL_NAPI_DISABLE(dev, &tp->napi);
#endif
#endif//CONFIG_R8168_NAPI
rtl8168_irq_mask_and_ack(tp, ioaddr);
#ifdef CONFIG_R8168_NAPI
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
RTL_NAPI_ENABLE(dev, &tp->napi);
#endif
#endif//CONFIG_R8168_NAPI
}
#if 0
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,20)
static void rtl8168_reinit_task(void *_data)
#else
static void rtl8168_reinit_task(struct work_struct *work)
#endif
{
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,20)
struct net_device *dev = _data;
#else
struct rtl8168_private *tp =
container_of(work, struct rtl8168_private, task.work);
struct net_device *dev = tp->dev;
#endif
int ret;
if (netif_running(dev)) {
rtl8168_wait_for_quiescence(dev);
rtl8168_close(dev);
}
ret = rtl8168_open(dev);
if (unlikely(ret < 0)) {
if (unlikely(net_ratelimit())) {
struct rtl8168_private *tp = netdev_priv(dev);
if (netif_msg_drv(tp)) {
printk(PFX KERN_ERR
"%s: reinit failure (status = %d)."
" Rescheduling.\n", dev->name, ret);
}
}
rtl8168_schedule_work(dev, rtl8168_reinit_task);
}
}
#endif
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,20)
static void rtl8168_reset_task(void *_data)
{
struct net_device *dev = _data;
struct rtl8168_private *tp = netdev_priv(dev);
#else
static void rtl8168_reset_task(struct work_struct *work)
{
struct rtl8168_private *tp =
container_of(work, struct rtl8168_private, task.work);
struct net_device *dev = tp->dev;
#endif
u32 budget = ~(u32)0;
unsigned long flags;
if (!netif_running(dev))
return;
rtl8168_wait_for_quiescence(dev);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,24)
rtl8168_rx_interrupt(dev, tp, tp->mmio_addr, &budget);
#else
rtl8168_rx_interrupt(dev, tp, tp->mmio_addr, budget);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,24)
spin_lock_irqsave(&tp->lock, flags);
rtl8168_tx_clear(tp);
if (tp->dirty_rx == tp->cur_rx) {
rtl8168_rx_clear(tp);
rtl8168_init_ring(dev);
rtl8168_set_speed(dev, tp->autoneg, tp->speed, tp->duplex);
spin_unlock_irqrestore(&tp->lock, flags);
} else {
spin_unlock_irqrestore(&tp->lock, flags);
if (unlikely(net_ratelimit())) {
struct rtl8168_private *tp = netdev_priv(dev);
if (netif_msg_intr(tp)) {
printk(PFX KERN_EMERG
"%s: Rx buffers shortage\n", dev->name);
}
}
rtl8168_schedule_work(dev, rtl8168_reset_task);
}
}
static void
rtl8168_tx_timeout(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
spin_lock_irqsave(&tp->lock, flags);
netif_stop_queue(dev);
netif_carrier_off(dev);
rtl8168_hw_reset(dev);
spin_unlock_irqrestore(&tp->lock, flags);
/* Let's wait a bit while any (async) irq lands on */
rtl8168_schedule_work(dev, rtl8168_reset_task);
}
static int
rtl8168_xmit_frags(struct rtl8168_private *tp,
struct sk_buff *skb,
u32 opts1,
u32 opts2)
{
struct skb_shared_info *info = skb_shinfo(skb);
unsigned int cur_frag, entry;
struct TxDesc *txd = NULL;
entry = tp->cur_tx;
for (cur_frag = 0; cur_frag < info->nr_frags; cur_frag++) {
skb_frag_t *frag = info->frags + cur_frag;
dma_addr_t mapping;
u32 status, len;
void *addr;
entry = (entry + 1) % NUM_TX_DESC;
txd = tp->TxDescArray + entry;
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,2,0)
len = frag->size;
addr = ((void *) page_address(frag->page)) + frag->page_offset;
#else
len = skb_frag_size(frag);
addr = skb_frag_address(frag);
#endif
mapping = pci_map_single(tp->pci_dev, addr, len, PCI_DMA_TODEVICE);
if (unlikely(dma_mapping_error(&tp->pci_dev->dev, mapping))) {
if (unlikely(net_ratelimit()))
netif_err(tp, drv, tp->dev,
"Failed to map TX fragments DMA!\n");
goto err_out;
}
/* anti gcc 2.95.3 bugware (sic) */
status = opts1 | len | (RingEnd * !((entry + 1) % NUM_TX_DESC));
txd->addr = cpu_to_le64(mapping);
tp->tx_skb[entry].len = len;
txd->opts1 = cpu_to_le32(status);
txd->opts2 = cpu_to_le32(opts2);
}
if (cur_frag) {
tp->tx_skb[entry].skb = skb;
wmb();
txd->opts1 |= cpu_to_le32(LastFrag);
}
return cur_frag;
err_out:
rtl8168_tx_clear_range(tp, tp->cur_tx + 1, cur_frag);
return -EIO;
}
static inline
__be16 get_protocol(struct sk_buff *skb)
{
__be16 protocol;
if (skb->protocol == htons(ETH_P_8021Q))
protocol = vlan_eth_hdr(skb)->h_vlan_encapsulated_proto;
else
protocol = skb->protocol;
return protocol;
}
static inline u32
rtl8168_tx_csum(struct sk_buff *skb,
struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
u32 csum_cmd = 0;
u8 sw_calc_csum = FALSE;
if (skb->ip_summed == CHECKSUM_PARTIAL) {
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,22)
const struct iphdr *ip = skb->nh.iph;
if (dev->features & NETIF_F_IP_CSUM) {
if (ip->protocol == IPPROTO_TCP)
csum_cmd = tp->tx_tcp_csum_cmd;
else if (ip->protocol == IPPROTO_UDP)
csum_cmd = tp->tx_udp_csum_cmd;
else if (ip->protocol == IPPROTO_IP)
csum_cmd = tp->tx_ip_csum_cmd;
}
#else
u8 ip_protocol = IPPROTO_RAW;
switch (get_protocol(skb)) {
case htons(ETH_P_IP):
if (dev->features & NETIF_F_IP_CSUM) {
ip_protocol = ip_hdr(skb)->protocol;
csum_cmd = tp->tx_ip_csum_cmd;
}
break;
case htons(ETH_P_IPV6):
if (dev->features & NETIF_F_IPV6_CSUM) {
u32 transport_offset = (u32)skb_transport_offset(skb);
if (transport_offset > 0 && transport_offset <= TCPHO_MAX) {
ip_protocol = ipv6_hdr(skb)->nexthdr;
csum_cmd = tp->tx_ipv6_csum_cmd;
csum_cmd |= transport_offset << TCPHO_SHIFT;
}
}
break;
default:
if (unlikely(net_ratelimit()))
dprintk("checksum_partial proto=%x!\n", skb->protocol);
break;
}
if (ip_protocol == IPPROTO_TCP)
csum_cmd |= tp->tx_tcp_csum_cmd;
else if (ip_protocol == IPPROTO_UDP)
csum_cmd |= tp->tx_udp_csum_cmd;
#endif
if (csum_cmd == 0) {
sw_calc_csum = TRUE;
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
WARN_ON(1); /* we need a WARN() */
#endif
}
}
if (tp->ShortPacketSwChecksum && skb->len < 60 && csum_cmd != 0)
sw_calc_csum = TRUE;
if (sw_calc_csum) {
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,10) && LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,7)
skb_checksum_help(&skb, 0);
#elif LINUX_VERSION_CODE < KERNEL_VERSION(2,6,19) && LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,10)
skb_checksum_help(skb, 0);
#else
skb_checksum_help(skb);
#endif
csum_cmd = 0;
}
return csum_cmd;
}
static int
rtl8168_sw_padding_short_pkt(struct rtl8168_private *tp,
struct sk_buff *skb,
u32 opts1,
u32 opts2)
{
unsigned int entry;
dma_addr_t mapping;
u32 status, len;
void *addr;
struct TxDesc *txd = NULL;
int ret = 0;
if (skb->len >= ETH_ZLEN)
goto out;
entry = tp->cur_tx;
entry = (entry + 1) % NUM_TX_DESC;
txd = tp->TxDescArray + entry;
len = ETH_ZLEN - skb->len;
addr = tp->ShortPacketEmptyBuffer;
mapping = pci_map_single(tp->pci_dev, addr, len, PCI_DMA_TODEVICE);
if (unlikely(dma_mapping_error(&tp->pci_dev->dev, mapping))) {
if (unlikely(net_ratelimit()))
netif_err(tp, drv, tp->dev,
"Failed to map Short Packet Buffer DMA!\n");
ret = -ENOMEM;
goto out;
}
status = opts1 | len | (RingEnd * !((entry + 1) % NUM_TX_DESC));
txd->addr = cpu_to_le64(mapping);
txd->opts1 = cpu_to_le32(status);
txd->opts2 = cpu_to_le32(opts2);
wmb();
txd->opts1 |= cpu_to_le32(LastFrag);
out:
return ret;
}
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,14,0)
/* r8169_csum_workaround()
* The hw limites the value the transport offset. When the offset is out of the
* range, calculate the checksum by sw.
*/
static void r8168_csum_workaround(struct rtl8168_private *tp,
struct sk_buff *skb)
{
if (skb_shinfo(skb)->gso_size) {
netdev_features_t features = tp->dev->features;
struct sk_buff *segs, *nskb;
features &= ~(NETIF_F_SG | NETIF_F_IPV6_CSUM | NETIF_F_TSO6);
segs = skb_gso_segment(skb, features);
if (IS_ERR(segs) || !segs)
goto drop;
do {
nskb = segs;
segs = segs->next;
nskb->next = NULL;
rtl8168_start_xmit(nskb, tp->dev);
} while (segs);
dev_consume_skb_any(skb);
} else if (skb->ip_summed == CHECKSUM_PARTIAL) {
if (skb_checksum_help(skb) < 0)
goto drop;
rtl8168_start_xmit(skb, tp->dev);
} else {
struct net_device_stats *stats;
drop:
stats = &tp->dev->stats;
stats->tx_dropped++;
dev_kfree_skb_any(skb);
}
}
/* msdn_giant_send_check()
* According to the document of microsoft, the TCP Pseudo Header excludes the
* packet length for IPv6 TCP large packets.
*/
static int msdn_giant_send_check(struct sk_buff *skb)
{
const struct ipv6hdr *ipv6h;
struct tcphdr *th;
int ret;
ret = skb_cow_head(skb, 0);
if (ret)
return ret;
ipv6h = ipv6_hdr(skb);
th = tcp_hdr(skb);
th->check = 0;
th->check = ~tcp_v6_check(0, &ipv6h->saddr, &ipv6h->daddr, 0);
return ret;
}
#endif
static int
rtl8168_start_xmit(struct sk_buff *skb,
struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned int entry;
struct TxDesc *txd;
void __iomem *ioaddr = tp->mmio_addr;
dma_addr_t mapping;
u32 len;
u32 opts1;
u32 opts2;
int ret = NETDEV_TX_OK;
unsigned long flags, large_send;
int frags;
spin_lock_irqsave(&tp->lock, flags);
if (unlikely(TX_BUFFS_AVAIL(tp) < skb_shinfo(skb)->nr_frags)) {
if (netif_msg_drv(tp)) {
printk(KERN_ERR
"%s: BUG! Tx Ring full when queue awake!\n",
dev->name);
}
goto err_stop;
}
entry = tp->cur_tx % NUM_TX_DESC;
txd = tp->TxDescArray + entry;
if (unlikely(le32_to_cpu(txd->opts1) & DescOwn))
goto err_stop;
opts1 = DescOwn;
opts2 = rtl8168_tx_vlan_tag(tp, skb);
large_send = 0;
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (dev->features & (NETIF_F_TSO | NETIF_F_TSO6)) {
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,18)
u32 mss = skb_shinfo(skb)->tso_size;
#else
u32 mss = skb_shinfo(skb)->gso_size;
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,18)
/* TCP Segmentation Offload (or TCP Large Send) */
if (mss) {
if ((tp->mcfg == CFG_METHOD_1) ||
(tp->mcfg == CFG_METHOD_2) ||
(tp->mcfg == CFG_METHOD_3)) {
opts1 |= LargeSend | (min(mss, MSS_MAX) << 16);
large_send = 1;
} else {
u32 transport_offset = (u32)skb_transport_offset(skb);
switch (get_protocol(skb)) {
case htons(ETH_P_IP):
if (transport_offset <= 128) {
opts1 |= GiantSendv4;
opts1 |= transport_offset << GTTCPHO_SHIFT;
opts2 |= min(mss, MSS_MAX) << 18;
large_send = 1;
}
break;
case htons(ETH_P_IPV6):
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,14,0)
if (msdn_giant_send_check(skb)) {
spin_unlock_irqrestore(&tp->lock, flags);
r8168_csum_workaround(tp, skb);
goto out;
}
#endif
if (transport_offset <= 128) {
opts1 |= GiantSendv6;
opts1 |= transport_offset << GTTCPHO_SHIFT;
opts2 |= min(mss, MSS_MAX) << 18;
large_send = 1;
}
break;
default:
if (unlikely(net_ratelimit()))
dprintk("tso proto=%x!\n", skb->protocol);
break;
}
}
if (large_send == 0)
goto err_dma_0;
}
}
#endif //LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
if (large_send == 0) {
if (skb->ip_summed == CHECKSUM_PARTIAL) {
if ((tp->mcfg == CFG_METHOD_1) || (tp->mcfg == CFG_METHOD_2) || (tp->mcfg == CFG_METHOD_3))
opts1 |= rtl8168_tx_csum(skb, dev);
else
opts2 |= rtl8168_tx_csum(skb, dev);
}
}
frags = rtl8168_xmit_frags(tp, skb, opts1, opts2);
if (unlikely(frags < 0))
goto err_dma_0;
if (frags) {
len = skb_headlen(skb);
opts1 |= FirstFrag;
} else {
len = skb->len;
tp->tx_skb[entry].skb = skb;
if (tp->UseSwPaddingShortPkt && len < 60) {
if (unlikely(rtl8168_sw_padding_short_pkt(tp, skb, opts1, opts2)))
goto err_dma_1;
opts1 |= FirstFrag;
frags++;
} else {
opts1 |= FirstFrag | LastFrag;
}
}
opts1 |= len | (RingEnd * !((entry + 1) % NUM_TX_DESC));
mapping = pci_map_single(tp->pci_dev, skb->data, len, PCI_DMA_TODEVICE);
if (unlikely(dma_mapping_error(&tp->pci_dev->dev, mapping))) {
if (unlikely(net_ratelimit()))
netif_err(tp, drv, dev, "Failed to map TX DMA!\n");
goto err_dma_1;
}
tp->tx_skb[entry].len = len;
txd->addr = cpu_to_le64(mapping);
txd->opts2 = cpu_to_le32(opts2);
txd->opts1 = cpu_to_le32(opts1&~DescOwn);
wmb();
txd->opts1 = cpu_to_le32(opts1);
#if LINUX_VERSION_CODE < KERNEL_VERSION(3,5,0)
dev->trans_start = jiffies;
#else
skb_tx_timestamp(skb);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(3,5,0)
tp->cur_tx += frags + 1;
wmb();
RTL_W8(TxPoll, NPQ); /* set polling bit */
if (TX_BUFFS_AVAIL(tp) < MAX_SKB_FRAGS) {
netif_stop_queue(dev);
smp_rmb();
if (TX_BUFFS_AVAIL(tp) >= MAX_SKB_FRAGS)
netif_wake_queue(dev);
}
spin_unlock_irqrestore(&tp->lock, flags);
out:
return ret;
err_dma_1:
tp->tx_skb[entry].skb = NULL;
rtl8168_tx_clear_range(tp, tp->cur_tx + 1, frags);
err_dma_0:
RTLDEV->stats.tx_dropped++;
spin_unlock_irqrestore(&tp->lock, flags);
dev_kfree_skb_any(skb);
ret = NETDEV_TX_OK;
goto out;
err_stop:
netif_stop_queue(dev);
ret = NETDEV_TX_BUSY;
RTLDEV->stats.tx_dropped++;
spin_unlock_irqrestore(&tp->lock, flags);
goto out;
}
static void
rtl8168_tx_interrupt(struct net_device *dev,
struct rtl8168_private *tp,
void __iomem *ioaddr)
{
unsigned int dirty_tx, tx_left;
assert(dev != NULL);
assert(tp != NULL);
assert(ioaddr != NULL);
dirty_tx = tp->dirty_tx;
smp_rmb();
tx_left = tp->cur_tx - dirty_tx;
while (tx_left > 0) {
unsigned int entry = dirty_tx % NUM_TX_DESC;
struct ring_info *tx_skb = tp->tx_skb + entry;
u32 len = tx_skb->len;
u32 status;
rmb();
status = le32_to_cpu(tp->TxDescArray[entry].opts1);
if (status & DescOwn)
break;
RTLDEV->stats.tx_bytes += len;
RTLDEV->stats.tx_packets++;
rtl8168_unmap_tx_skb(tp->pci_dev,
tx_skb,
tp->TxDescArray + entry);
if (tx_skb->skb!=NULL) {
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,14,0)
dev_consume_skb_any(tx_skb->skb);
#else
dev_kfree_skb_any(tx_skb->skb);
#endif
tx_skb->skb = NULL;
}
dirty_tx++;
tx_left--;
}
if (tp->dirty_tx != dirty_tx) {
tp->dirty_tx = dirty_tx;
smp_wmb();
if (netif_queue_stopped(dev) &&
(TX_BUFFS_AVAIL(tp) >= MAX_SKB_FRAGS)) {
netif_wake_queue(dev);
}
smp_rmb();
if (tp->cur_tx != dirty_tx)
RTL_W8(TxPoll, NPQ);
}
}
static inline int
rtl8168_fragmented_frame(u32 status)
{
return (status & (FirstFrag | LastFrag)) != (FirstFrag | LastFrag);
}
static inline void
rtl8168_rx_csum(struct rtl8168_private *tp,
struct sk_buff *skb,
struct RxDesc *desc)
{
u32 opts1 = le32_to_cpu(desc->opts1);
u32 opts2 = le32_to_cpu(desc->opts2);
if ((tp->mcfg == CFG_METHOD_1) ||
(tp->mcfg == CFG_METHOD_2) ||
(tp->mcfg == CFG_METHOD_3)) {
u32 status = opts1 & RxProtoMask;
/* rx csum offload for RTL8168B/8111B */
if (((status == RxProtoTCP) && !(opts1 & RxTCPF)) ||
((status == RxProtoUDP) && !(opts1 & RxUDPF)) ||
((status == RxProtoIP) && !(opts1 & RxIPF)))
skb->ip_summed = CHECKSUM_UNNECESSARY;
else
skb->ip_summed = CHECKSUM_NONE;
} else {
/* rx csum offload for RTL8168C/8111C and RTL8168CP/8111CP */
if ((opts2 & RxV4F) || (opts2 & RxV6F))
if (((opts1 & RxTCPF) && (opts1 & RxTCPT)) ||
((opts1 & RxUDPF) && (opts1 & RxUDPT)) ||
((opts2 & RxIPF) && (opts1 & (RxV4F | RxV6F))))
skb->ip_summed = CHECKSUM_NONE;
else
skb->ip_summed = CHECKSUM_UNNECESSARY;
else
skb->ip_summed = CHECKSUM_NONE;
}
}
static inline int
rtl8168_try_rx_copy(struct rtl8168_private *tp,
struct sk_buff **sk_buff,
int pkt_size,
struct RxDesc *desc,
int rx_buf_sz)
{
int ret = -1;
if (pkt_size < rx_copybreak) {
struct sk_buff *skb;
skb = RTL_ALLOC_SKB_INTR(tp, pkt_size + RTK_RX_ALIGN);
if (skb) {
u8 *data;
data = sk_buff[0]->data;
skb_reserve(skb, RTK_RX_ALIGN);
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,4,37)
prefetch(data - RTK_RX_ALIGN);
#endif
eth_copy_and_sum(skb, data, pkt_size, 0);
*sk_buff = skb;
rtl8168_mark_to_asic(desc, rx_buf_sz);
ret = 0;
}
}
return ret;
}
static inline void
rtl8168_rx_skb(struct rtl8168_private *tp,
struct sk_buff *skb)
{
#ifdef CONFIG_R8168_NAPI
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,29)
netif_receive_skb(skb);
#else
napi_gro_receive(&tp->napi, skb);
#endif
#else
netif_rx(skb);
#endif
}
static int
rtl8168_rx_interrupt(struct net_device *dev,
struct rtl8168_private *tp,
void __iomem *ioaddr, napi_budget budget)
{
unsigned int cur_rx, rx_left;
unsigned int delta, count = 0;
unsigned int entry;
struct RxDesc *desc;
u32 status;
u32 rx_quota;
assert(dev != NULL);
assert(tp != NULL);
assert(ioaddr != NULL);
if ((tp->RxDescArray == NULL) || (tp->Rx_skbuff == NULL))
goto rx_out;
rx_quota = RTL_RX_QUOTA(budget);
cur_rx = tp->cur_rx;
entry = cur_rx % NUM_RX_DESC;
desc = tp->RxDescArray + entry;
rx_left = NUM_RX_DESC + tp->dirty_rx - cur_rx;
rx_left = rtl8168_rx_quota(rx_left, (u32)rx_quota);
for (; rx_left > 0; rx_left--) {
rmb();
status = le32_to_cpu(desc->opts1);
if (status & DescOwn)
break;
if (unlikely(status & RxRES)) {
if (netif_msg_rx_err(tp)) {
printk(KERN_INFO
"%s: Rx ERROR. status = %08x\n",
dev->name, status);
}
RTLDEV->stats.rx_errors++;
if (status & (RxRWT | RxRUNT))
RTLDEV->stats.rx_length_errors++;
if (status & RxCRC)
RTLDEV->stats.rx_crc_errors++;
if (dev->features & NETIF_F_RXALL)
goto process_pkt;
rtl8168_mark_to_asic(desc, tp->rx_buf_sz);
} else {
struct sk_buff *skb;
int pkt_size;
void (*pci_action)(struct pci_dev *, dma_addr_t,
size_t, int);
process_pkt:
if (likely(!(dev->features & NETIF_F_RXFCS)))
pkt_size = (status & 0x00003fff) - 4;
else
pkt_size = status & 0x00003fff;
/*
* The driver does not support incoming fragmented
* frames. They are seen as a symptom of over-mtu
* sized frames.
*/
if (unlikely(rtl8168_fragmented_frame(status))) {
RTLDEV->stats.rx_dropped++;
RTLDEV->stats.rx_length_errors++;
rtl8168_mark_to_asic(desc, tp->rx_buf_sz);
continue;
}
skb = tp->Rx_skbuff[entry];
if (tp->cp_cmd & RxChkSum)
rtl8168_rx_csum(tp, skb, desc);
pci_dma_sync_single_for_cpu(tp->pci_dev,
le64_to_cpu(desc->addr), tp->rx_buf_sz,
PCI_DMA_FROMDEVICE);
pci_action = pci_dma_sync_single_for_device;
if (rtl8168_try_rx_copy(tp, &skb, pkt_size,
desc, tp->rx_buf_sz)) {
pci_action = pci_unmap_single;
tp->Rx_skbuff[entry] = NULL;
}
pci_action(tp->pci_dev, le64_to_cpu(desc->addr),
tp->rx_buf_sz, PCI_DMA_FROMDEVICE);
skb->dev = dev;
skb_put(skb, pkt_size);
skb->protocol = eth_type_trans(skb, dev);
if (skb->pkt_type == PACKET_MULTICAST)
RTLDEV->stats.multicast++;
if (rtl8168_rx_vlan_skb(tp, desc, skb) < 0)
rtl8168_rx_skb(tp, skb);
#if LINUX_VERSION_CODE < KERNEL_VERSION(4,11,0)
dev->last_rx = jiffies;
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(4,11,0)
RTLDEV->stats.rx_bytes += pkt_size;
RTLDEV->stats.rx_packets++;
}
cur_rx++;
entry = cur_rx % NUM_RX_DESC;
desc = tp->RxDescArray + entry;
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,4,37)
prefetch(desc);
#endif
}
count = cur_rx - tp->cur_rx;
tp->cur_rx = cur_rx;
delta = rtl8168_rx_fill(tp, dev, tp->dirty_rx, tp->cur_rx, 1);
if (!delta && count && netif_msg_intr(tp))
printk(KERN_INFO "%s: no Rx buffer allocated\n", dev->name);
tp->dirty_rx += delta;
/*
* FIXME: until there is periodic timer to try and refill the ring,
* a temporary shortage may definitely kill the Rx process.
* - disable the asic to try and avoid an overflow and kick it again
* after refill ?
* - how do others driver handle this condition (Uh oh...).
*/
if ((tp->dirty_rx + NUM_RX_DESC == tp->cur_rx) && netif_msg_intr(tp))
printk(KERN_EMERG "%s: Rx buffers exhausted\n", dev->name);
rx_out:
return count;
}
/*
*The interrupt handler does all of the Rx thread work and cleans up after
*the Tx thread.
*/
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,19)
static irqreturn_t rtl8168_interrupt(int irq, void *dev_instance, struct pt_regs *regs)
#else
static irqreturn_t rtl8168_interrupt(int irq, void *dev_instance)
#endif
{
struct net_device *dev = (struct net_device *) dev_instance;
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
int status;
int handled = 0;
do {
status = RTL_R16(IntrStatus);
if (!(tp->features & RTL_FEATURE_MSI)) {
/* hotplug/major error/no more work/shared irq */
if ((status == 0xFFFF) || !status)
break;
if (!(status & (tp->intr_mask | tp->timer_intr_mask)))
break;
}
handled = 1;
rtl8168_disable_hw_interrupt(tp, ioaddr);
switch (tp->mcfg) {
case CFG_METHOD_9:
case CFG_METHOD_10:
case CFG_METHOD_11:
case CFG_METHOD_12:
case CFG_METHOD_13:
case CFG_METHOD_14:
case CFG_METHOD_15:
case CFG_METHOD_16:
case CFG_METHOD_17:
case CFG_METHOD_18:
case CFG_METHOD_19:
case CFG_METHOD_20:
case CFG_METHOD_21:
case CFG_METHOD_22:
case CFG_METHOD_23:
case CFG_METHOD_24:
case CFG_METHOD_25:
case CFG_METHOD_26:
case CFG_METHOD_27:
case CFG_METHOD_28:
case CFG_METHOD_29:
case CFG_METHOD_30:
case CFG_METHOD_31:
case CFG_METHOD_32:
/* RX_OVERFLOW RE-START mechanism now HW handles it automatically*/
RTL_W16(IntrStatus, status&~RxFIFOOver);
break;
default:
RTL_W16(IntrStatus, status);
break;
}
//Work around for rx fifo overflow
if (unlikely(status & RxFIFOOver)) {
if (tp->mcfg == CFG_METHOD_1) {
netif_stop_queue(dev);
udelay(300);
rtl8168_hw_reset(dev);
rtl8168_tx_clear(tp);
rtl8168_rx_clear(tp);
rtl8168_init_ring(dev);
rtl8168_hw_config(dev);
rtl8168_hw_start(dev);
netif_wake_queue(dev);
}
}
#ifdef ENABLE_DASH_SUPPORT
if ( tp->DASH ) {
if (HW_DASH_SUPPORT_TYPE_2(tp) || HW_DASH_SUPPORT_TYPE_3(tp)) {
u8 DashIntType2Status;
if (status & ISRIMR_DASH_INTR_CMAC_RESET)
tp->CmacResetIntr = TRUE;
DashIntType2Status = RTL_CMAC_R8(CMAC_IBISR0);
if (DashIntType2Status & ISRIMR_DASH_TYPE2_ROK) {
tp->RcvFwDashOkEvt = TRUE;
}
if (DashIntType2Status & ISRIMR_DASH_TYPE2_TOK) {
tp->SendFwHostOkEvt = TRUE;
}
if (DashIntType2Status & ISRIMR_DASH_TYPE2_RX_DISABLE_IDLE) {
tp->DashFwDisableRx = TRUE;
}
RTL_CMAC_W8(CMAC_IBISR0, DashIntType2Status);
} else {
if (IntrStatus & ISRIMR_DP_REQSYS_OK) {
tp->RcvFwReqSysOkEvt = TRUE;
}
if (IntrStatus & ISRIMR_DP_DASH_OK) {
tp->RcvFwDashOkEvt = TRUE;
}
if (IntrStatus & ISRIMR_DP_HOST_OK) {
tp->SendFwHostOkEvt = TRUE;
}
}
}
#endif
#ifdef CONFIG_R8168_NAPI
if (status & tp->intr_mask || tp->keep_intr_cnt-- > 0) {
if (status & tp->intr_mask)
tp->keep_intr_cnt = RTK_KEEP_INTERRUPT_COUNT;
if (likely(RTL_NETIF_RX_SCHEDULE_PREP(dev, &tp->napi)))
__RTL_NETIF_RX_SCHEDULE(dev, &tp->napi);
else if (netif_msg_intr(tp))
printk(KERN_INFO "%s: interrupt %04x in poll\n",
dev->name, status);
} else {
tp->keep_intr_cnt = RTK_KEEP_INTERRUPT_COUNT;
rtl8168_switch_to_hw_interrupt(tp, ioaddr);
}
#else
if (status & tp->intr_mask || tp->keep_intr_cnt-- > 0) {
u32 budget = ~(u32)0;
if (status & tp->intr_mask)
tp->keep_intr_cnt = RTK_KEEP_INTERRUPT_COUNT;
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,24)
rtl8168_rx_interrupt(dev, tp, tp->mmio_addr, &budget);
#else
rtl8168_rx_interrupt(dev, tp, tp->mmio_addr, budget);
#endif //LINUX_VERSION_CODE < KERNEL_VERSION(2,6,24)
rtl8168_tx_interrupt(dev, tp, ioaddr);
#ifdef ENABLE_DASH_SUPPORT
if ( tp->DASH ) {
struct net_device *dev = tp->dev;
HandleDashInterrupt(dev);
}
#endif
rtl8168_switch_to_timer_interrupt(tp, ioaddr);
} else {
tp->keep_intr_cnt = RTK_KEEP_INTERRUPT_COUNT;
rtl8168_switch_to_hw_interrupt(tp, ioaddr);
}
#endif
} while (false);
return IRQ_RETVAL(handled);
}
#ifdef CONFIG_R8168_NAPI
static int rtl8168_poll(napi_ptr napi, napi_budget budget)
{
struct rtl8168_private *tp = RTL_GET_PRIV(napi, struct rtl8168_private);
void __iomem *ioaddr = tp->mmio_addr;
RTL_GET_NETDEV(tp)
unsigned int work_to_do = RTL_NAPI_QUOTA(budget, dev);
unsigned int work_done;
unsigned long flags;
work_done = rtl8168_rx_interrupt(dev, tp, ioaddr, budget);
spin_lock_irqsave(&tp->lock, flags);
rtl8168_tx_interrupt(dev, tp, ioaddr);
spin_unlock_irqrestore(&tp->lock, flags);
RTL_NAPI_QUOTA_UPDATE(dev, work_done, budget);
if (work_done < work_to_do) {
#ifdef ENABLE_DASH_SUPPORT
if ( tp->DASH ) {
struct net_device *dev = tp->dev;
spin_lock_irqsave(&tp->lock, flags);
HandleDashInterrupt(dev);
spin_unlock_irqrestore(&tp->lock, flags);
}
#endif
#if LINUX_VERSION_CODE >= KERNEL_VERSION(4,10,0)
if (RTL_NETIF_RX_COMPLETE(dev, napi, work_done) == FALSE) return RTL_NAPI_RETURN_VALUE;
#else
RTL_NETIF_RX_COMPLETE(dev, napi, work_done);
#endif
/*
* 20040426: the barrier is not strictly required but the
* behavior of the irq handler could be less predictable
* without it. Btw, the lack of flush for the posted pci
* write is safe - FR
*/
smp_wmb();
rtl8168_switch_to_timer_interrupt(tp, ioaddr);
}
return RTL_NAPI_RETURN_VALUE;
}
#endif//CONFIG_R8168_NAPI
static void rtl8168_sleep_rx_enable(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
void __iomem *ioaddr = tp->mmio_addr;
if ((tp->mcfg == CFG_METHOD_1) || (tp->mcfg == CFG_METHOD_2)) {
RTL_W8(ChipCmd, CmdReset);
rtl8168_rx_desc_offset0_init(tp, 0);
RTL_W8(ChipCmd, CmdRxEnb);
} else if (tp->mcfg == CFG_METHOD_14 || tp->mcfg == CFG_METHOD_15) {
rtl8168_ephy_write(ioaddr, 0x19, 0xFF64);
RTL_W32(RxConfig, RTL_R32(RxConfig) | AcceptBroadcast | AcceptMulticast | AcceptMyPhys);
}
}
static void rtl8168_down(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
unsigned long flags;
rtl8168_delete_esd_timer(dev, &tp->esd_timer);
rtl8168_delete_link_timer(dev, &tp->link_timer);
#ifdef CONFIG_R8168_NAPI
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
RTL_NAPI_DISABLE(dev, &tp->napi);
#endif
#endif//CONFIG_R8168_NAPI
netif_stop_queue(dev);
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,11)
/* Give a racing hard_start_xmit a few cycles to complete. */
synchronize_sched(); /* FIXME: should this be synchronize_irq()? */
#endif
spin_lock_irqsave(&tp->lock, flags);
netif_carrier_off(dev);
rtl8168_dsm(dev, DSM_IF_DOWN);
rtl8168_hw_reset(dev);
spin_unlock_irqrestore(&tp->lock, flags);
synchronize_irq(dev->irq);
spin_lock_irqsave(&tp->lock, flags);
rtl8168_tx_clear(tp);
rtl8168_rx_clear(tp);
rtl8168_sleep_rx_enable(dev);
spin_unlock_irqrestore(&tp->lock, flags);
}
static int rtl8168_close(struct net_device *dev)
{
struct rtl8168_private *tp = netdev_priv(dev);
struct pci_dev *pdev = tp->pci_dev;
/*
* ASPM is disabled after eth link up if flow control is disabled.
* If the interface is brought down when eth link is up, link down
* event is not expected. So enable ASPM in interface down sequence.
*/
if (aspm)
pci_enable_link_state(tp->pci_dev, PCIE_LINK_STATE_L1);
if (tp->TxDescArray!=NULL && tp->RxDescArray!=NULL) {
rtl8168_cancel_schedule_work(dev);
rtl8168_down(dev);
rtl8168_hw_d3_para(dev);
rtl8168_powerdown_pll(dev);
free_irq(dev->irq, dev);
pci_free_consistent(pdev, R8168_RX_RING_BYTES, tp->RxDescArray,
tp->RxPhyAddr);
pci_free_consistent(pdev, R8168_TX_RING_BYTES, tp->TxDescArray,
tp->TxPhyAddr);
tp->TxDescArray = NULL;
tp->RxDescArray = NULL;
if (tp->ShortPacketEmptyBuffer != NULL) {
pci_free_consistent(pdev, SHORT_PACKET_PADDING_BUF_SIZE, tp->ShortPacketEmptyBuffer,
tp->ShortPacketEmptyBufferPhy);
tp->ShortPacketEmptyBuffer = NULL;
}
}
return 0;
}
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,11)
static void rtl8168_shutdown(struct pci_dev *pdev)
{
struct net_device *dev = pci_get_drvdata(pdev);
struct rtl8168_private *tp = netdev_priv(dev);
if (tp->DASH)
rtl8168_driver_stop(tp);
rtl8168_set_bios_setting(dev);
if (s5_keep_curr_mac == 0 && tp->random_mac == 0)
rtl8168_rar_set(tp, tp->org_mac_addr);
#ifdef ENABLE_REALWOW_SUPPORT
set_realwow_d3_para(dev);
#endif
if (s5wol == 0)
tp->wol_enabled = WOL_DISABLED;
rtl8168_close(dev);
rtl8168_disable_msi(pdev, tp);
}
#endif
/**
* rtl8168_get_stats - Get rtl8168 read/write statistics
* @dev: The Ethernet Device to get statistics for
*
* Get TX/RX statistics for rtl8168
*/
static struct
net_device_stats *rtl8168_get_stats(struct net_device *dev)
{
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,22)
struct rtl8168_private *tp = netdev_priv(dev);
#endif
if (netif_running(dev)) {
// spin_lock_irqsave(&tp->lock, flags);
// spin_unlock_irqrestore(&tp->lock, flags);
}
return &RTLDEV->stats;
}
#ifdef CONFIG_PM
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,11)
static int
rtl8168_suspend(struct pci_dev *pdev, u32 state)
#else
static int
rtl8168_suspend(struct pci_dev *pdev, pm_message_t state)
#endif
{
struct net_device *dev = pci_get_drvdata(pdev);
struct rtl8168_private *tp = netdev_priv(dev);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,10)
u32 pci_pm_state = pci_choose_state(pdev, state);
#endif
unsigned long flags;
if (!netif_running(dev))
goto out;
rtl8168_cancel_schedule_work(dev);
rtl8168_delete_esd_timer(dev, &tp->esd_timer);
rtl8168_delete_link_timer(dev, &tp->link_timer);
netif_stop_queue(dev);
netif_carrier_off(dev);
rtl8168_dsm(dev, DSM_NIC_GOTO_D3);
netif_device_detach(dev);
spin_lock_irqsave(&tp->lock, flags);
rtl8168_hw_reset(dev);
rtl8168_sleep_rx_enable(dev);
rtl8168_hw_d3_para(dev);
#ifdef ENABLE_REALWOW_SUPPORT
set_realwow_d3_para(dev);
#endif
rtl8168_powerdown_pll(dev);
spin_unlock_irqrestore(&tp->lock, flags);
if (tp->DASH)
rtl8168_driver_stop(tp);
out:
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,10)
pci_save_state(pdev, &pci_pm_state);
#else
pci_save_state(pdev);
#endif
pci_enable_wake(pdev, pci_choose_state(pdev, state), tp->wol_enabled);
// pci_set_power_state(pdev, pci_choose_state(pdev, state));
return 0;
}
static int
rtl8168_resume(struct pci_dev *pdev)
{
struct net_device *dev = pci_get_drvdata(pdev);
struct rtl8168_private *tp = netdev_priv(dev);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,10)
u32 pci_pm_state = PCI_D0;
#endif
pci_set_power_state(pdev, PCI_D0);
#if LINUX_VERSION_CODE < KERNEL_VERSION(2,6,10)
pci_restore_state(pdev, &pci_pm_state);
#else
pci_restore_state(pdev);
#endif
pci_enable_wake(pdev, PCI_D0, 0);
/* restore last modified mac address */
rtl8168_rar_set(tp, dev->dev_addr);
if (!netif_running(dev))
goto out;
rtl8168_exit_oob(dev);
rtl8168_dsm(dev, DSM_NIC_RESUME_D3);
rtl8168_hw_init(dev);
rtl8168_powerup_pll(dev);
rtl8168_hw_ephy_config(dev);
rtl8168_hw_phy_config(dev);
rtl8168_schedule_work(dev, rtl8168_reset_task);
netif_device_attach(dev);
mod_timer(&tp->esd_timer, jiffies + RTL8168_ESD_TIMEOUT);
mod_timer(&tp->link_timer, jiffies + RTL8168_LINK_TIMEOUT);
out:
return 0;
}
#endif /* CONFIG_PM */
static int __devinit
rtl8168_probe(struct pci_dev *pdev, const struct pci_device_id *id)
{
struct rtl8168_private *tp;
struct net_device *dev;
PPGDEV mydev;
int ret;
if (of_property_read_bool(pci_device_to_OF_node(pdev), "enable-aspm"))
aspm = 1;
else
aspm = 0;
ret = pgdrv_prob(pdev, id);
if (ret) {
dev_err(&pdev->dev, "%s: Unable to probe pgdrv.\n",
MODULENAME);
goto exit_probe;
}
mydev = pci_get_drvdata(pdev);
pci_set_drvdata(pdev, NULL);
ret = rtl8168_init_one(pdev, id);
if (ret) {
dev_err(&pdev->dev, "%s: Unable to initialize rtl8168.\n",
MODULENAME);
pgdrv_remove(pdev);
goto exit_probe;
}
dev = pci_get_drvdata(pdev);
tp = netdev_priv(dev);
tp->pgdev = mydev;
exit_probe:
return ret;
}
static void __devexit rtl8168_remove(struct pci_dev *pdev)
{
struct net_device *dev = pci_get_drvdata(pdev);
struct rtl8168_private *tp = netdev_priv(dev);
PPGDEV mydev = tp->pgdev;
rtl8168_remove_one(pdev);
pci_set_drvdata(pdev, mydev);
pgdrv_remove(pdev);
}
static struct pci_driver rtl8168_pci_driver = {
.name = MODULENAME,
.id_table = rtl8168_pci_tbl,
.probe = rtl8168_probe,
.remove = __devexit_p(rtl8168_remove),
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,11)
.shutdown = rtl8168_shutdown,
#endif
#ifdef CONFIG_PM
.suspend = rtl8168_suspend,
.resume = rtl8168_resume,
#endif
};
static int __init
rtl8168_init_module(void)
{
int ret;
ret = pgdrv_init();
if (ret < 0)
return ret;
#ifdef ENABLE_R8168_PROCFS
rtl8168_proc_module_init();
#endif
#if LINUX_VERSION_CODE > KERNEL_VERSION(2,6,0)
return pci_register_driver(&rtl8168_pci_driver);
#else
return pci_module_init(&rtl8168_pci_driver);
#endif
}
static void __exit
rtl8168_cleanup_module(void)
{
pci_unregister_driver(&rtl8168_pci_driver);
pgdrv_exit();
#ifdef ENABLE_R8168_PROCFS
if (rtl8168_proc) {
#if LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
remove_proc_subtree(MODULENAME, init_net.proc_net);
#else
#if LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,32)
remove_proc_entry(MODULENAME, init_net.proc_net);
#else
remove_proc_entry(MODULENAME, proc_net);
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(2,6,32)
#endif //LINUX_VERSION_CODE >= KERNEL_VERSION(3,10,0)
rtl8168_proc = NULL;
}
#endif
}
module_init(rtl8168_init_module);
module_exit(rtl8168_cleanup_module);
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